基于低功耗双边沿JK触发器的异步时序电路设计 被引量：8

1

作者 赵敏笑 余红娟 陈偕雄 《浙江大学学报（理学版）》 CAS CSCD 北大核心 2005年第1期45-48,共4页

从JK触发器的激励表出发,介绍了基于单边沿JK触发器的同步时序电路和异步时序电路设计,提出了双边沿JK触发器的完整状态方程,并以此为基础讨论了基于双边沿JK触发器的异步时序电路的设计方法.

关键词 低功耗 双边沿触发器 异步时序电路 逻辑设计

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一种高效的时序转换电路设计与实现 被引量：2

2

作者 杜斐 何嘉文 +2 位作者 刘承禹 张骏 田泽 《计算机技术与发展》 2021年第5期96-101,共6页

嵌入式处理器是目前片上系统中常用的处理器引擎,包括处理器、PLB总线系统、软件驱动等部分,其性能高、功耗低、使用灵活,通过处理器自带的PLB总线,可将成熟IP与嵌入式处理器相连接。由于PLB总线结构复杂,时序多样,且其接口时序与常用... 嵌入式处理器是目前片上系统中常用的处理器引擎,包括处理器、PLB总线系统、软件驱动等部分,其性能高、功耗低、使用灵活,通过处理器自带的PLB总线,可将成熟IP与嵌入式处理器相连接。由于PLB总线结构复杂,时序多样,且其接口时序与常用的寄存器接口访问时序差距较大,不利于迅速建立成熟IP和PLB总线连接。为解决此问题,首先深入研究了嵌入式处理器内部PLB总线协议和PLB总线各个接口的结构及机制,然后在理解PLB总线系统时序以及内部各子模块的功能与工作机制的基础上,提出一种高效时序转换电路解决方案,以满足PLB总线端单拍传输、Line传输和Burst传输,从设备端同步时序传输、异步时序传输的通信需求。通过功能仿真和工程实践表明,该时序转换电路工作稳定,性能良好,具有配置灵活、使用方便、数据传输效率高等优点,较好地满足了应用需求,且对其他类似接口转换设计具有一定的借鉴意义。 展开更多

关键词 嵌入式处理器 PLB总线 同步时序 异步时序 转换电路

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电位异步时序电路的冒险现象 被引量：1

3

作者 冼志妙 李廷洪 《河南职业技术师范学院学报》 2004年第4期134-135,共2页

时序逻辑电路中的竞争冒险是电路设计中必须考虑到的重要方面。本文在分析电位异步时序电路模型、电位异步时序电路的竞争冒险后,提出了电位异步时序电路冒险的分析判断方法和冒险现象的避免方案。

关键词 时序电路 异步 竞争冒险 时序逻辑电路 电路设计 电位 方案 模型 现象

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基于低功耗双边沿T触发器的异步时序电路设计 被引量：1

4

作者 赵敏笑 陈桂兰 陈偕雄 《科技通报》 2007年第3期430-433,共4页

从T触发器的逻辑功能入手,介绍了基于单边沿T触发器和双边沿T触发器的同步时序电路设计方法,并在分析异步触发条件的基础上,分别给出了基于单边沿T触发和双沿T触发器2n进制异步计数器的设计公式。在此基础上,讨论用双边沿T触发器设计异... 从T触发器的逻辑功能入手,介绍了基于单边沿T触发器和双边沿T触发器的同步时序电路设计方法,并在分析异步触发条件的基础上,分别给出了基于单边沿T触发和双沿T触发器2n进制异步计数器的设计公式。在此基础上,讨论用双边沿T触发器设计异步时序电路的方法,以十二进制计数器的设计为例验证了设计的正确性。 展开更多

关键词 低功耗 双边沿触发器 计数器 异步时序电路 逻辑设计

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K变模可拟计数器竞争冒险现象的消除 被引量：1

5

作者 李莉 《现代电子技术》 2007年第24期185-186,190,共3页

竞争冒险作为数字电路设计中经常会遇到的现象,存在可能导致高速电路或毛刺敏感电路的逻辑错误。以k变模可逆计数器设计中出现的竞争冒险现象为例,从程序、仿真波形、综合电路等方面较为详细地介绍了应用VHDL进行数字电路设计中竞争冒... 竞争冒险作为数字电路设计中经常会遇到的现象,存在可能导致高速电路或毛刺敏感电路的逻辑错误。以k变模可逆计数器设计中出现的竞争冒险现象为例,从程序、仿真波形、综合电路等方面较为详细地介绍了应用VHDL进行数字电路设计中竞争冒险现象产生的原因,并提出了采用同步时序电路设计的原则消除竞争冒险的方法。 展开更多

关键词 竞争冒险 计数器 VHDI 同步时序电路

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论异步时序线路特征表达式中的CP

6

作者 康裕荣 康向东 《南方冶金学院学报》 2003年第2期28-31,共4页

论述了异步时序线路特征表达式中的CP脉冲.用一个实例说明了各触发器的状态方程的表示及分析,并用状态表、状态图说明了其逻辑功能.

关键词 异步时序线路 特征表达式 触发器 CP脉冲

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由触发器构成的异步计数器的一种新分析方法

7

作者 赵显红 张晓红 张立文 《山西电子技术》 2020年第2期39-41,共3页

提出一种新的由触发器构成的异步计数器的分析方法,将计数器的时钟信号作为输入条件写入原触发器的驱动方程构成新的驱动方程,代入触发器的特征方程获得次态方程;将次态方程化为状态变量的最小项之和的标准形式,在不需要进行任何逻辑运... 提出一种新的由触发器构成的异步计数器的分析方法,将计数器的时钟信号作为输入条件写入原触发器的驱动方程构成新的驱动方程,代入触发器的特征方程获得次态方程;将次态方程化为状态变量的最小项之和的标准形式,在不需要进行任何逻辑运算的前提下,实现状态转换表的填写,从而获得计数器的变化规律。该方法省去了繁琐的计算,且与传统的真值表填写方法一致,实现了与同步时序逻辑电路的分析方法的一致性。 展开更多

关键词 计数器 异步时序逻辑电路 触发器 次态方程 真值表

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小规模集成电路异步十一进制加法计数器设计分析

8

作者 刘树平 吴勇灵 钱莉 《黔南民族师范学院学报》 2014年第2期101-104,共4页

采用小规模集成电路作为电路单元进行异步时序电路设计时,除了需要完成设计同步时序电路所做的各项工作之外,还要遵循挑选时钟信号的原则、求解状态方程的原则。本文通过一个设计实例,讨论、分析了异步时序电路设计的一般规律及其特殊... 采用小规模集成电路作为电路单元进行异步时序电路设计时,除了需要完成设计同步时序电路所做的各项工作之外,还要遵循挑选时钟信号的原则、求解状态方程的原则。本文通过一个设计实例,讨论、分析了异步时序电路设计的一般规律及其特殊的特点。 展开更多

关键词 异步时序电路 触发器 卡若图 状态转换表 自启动

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异步时序电路的功能测试自动生成方法

9

作者 徐敬波 郑明 薄亚明 《计算机工程》 CAS CSCD 北大核心 2003年第16期71-72,102,共3页

异步时序电路的测试一直是一个比较困难的问题。该文通过在前人研究的基础上，提出了一种实用、高效的自动测试生成方法。该方法通过使用基于OBDD（有序二元判决图）的布尔特征函数的运算求解来确定电路的状态转换图，然后通过对转换图... 异步时序电路的测试一直是一个比较困难的问题。该文通过在前人研究的基础上，提出了一种实用、高效的自动测试生成方法。该方法通过使用基于OBDD（有序二元判决图）的布尔特征函数的运算求解来确定电路的状态转换图，然后通过对转换图的强连通图的搜索运算简化状态转换图，最后使用图论的方法求出测试序列。 展开更多

关键词 异步时序电路 功能测试 有序二元判决图 状态转换图

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异步时序逻辑电路设计的一种简明方法 被引量：3

10

作者 赵兴强 《西华师范大学学报（自然科学版）》 2004年第2期227-230,共4页

提出了一种异步时序电路设计的新方法:时钟信号与次态卡诺图联立法.根据时钟信号填写次态卡诺图,当触发器满足时钟信号时其次态由状态转换图决定,否则其次态为约束项.据此可方便求出驱动方程并判断自启动.

关键词 异步时序逻辑电路 电路设计 时钟信号 次态卡诺图 状态转换图 约束项

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异步时序逻辑电路分析方法的研究 被引量：2

11

作者 齐耀辉 《现代电子技术》 2008年第6期14-18,共5页

首先对异步时序逻辑电路的特点和分类进行描述,接着从具体的操作步骤、结果的表现方式等方面结合具体实例阐述其一般的分析方法和新出现的分析方法:计算分析法和卡诺图分析法,并对计算分析法进行改进,以期能够更好地指导异步时序电路的... 首先对异步时序逻辑电路的特点和分类进行描述,接着从具体的操作步骤、结果的表现方式等方面结合具体实例阐述其一般的分析方法和新出现的分析方法:计算分析法和卡诺图分析法,并对计算分析法进行改进,以期能够更好地指导异步时序电路的分析。通过实例分别阐述3种分析方法,并进行对比,在保证分析结果的前提下,改进的计算分析法分析异步时序逻辑电路时不用考虑时钟信号,使分析变得简单;而卡诺图分析法使分析过程思路清晰,状态转换更加直观化。 展开更多

关键词 异步时序逻辑电路 触发器 计算分析法 卡诺图分析法

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基于时钟设计的异步时序逻辑电路设计法 被引量：2

12

作者 吕虹 张海峰 《电气电子教学学报》 2002年第3期72-74,共3页

基于时钟设计的异步时序逻辑电路设计法 ,根据电路状态转换规律 ,立足电路中各位触发器时钟设计 ,使电路完成所要求的逻辑功能 ,从而避免了求解电路状态方程、驱动方程。

关键词 时钟设计 异步时序逻辑电路 时钟信号 时钟函数

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异步时序逻辑电路的分析与设计 被引量：2

13

作者 雷轩 卢超 《计算机时代》 2014年第5期19-22,共4页

异步时序逻辑电路状态的改变必须考虑外部输入信号以及对应存储器的时钟端或控制端有无信号作用,这是分析与设计的一个难点。针对这一难点进行了详细的讨论,通过系统框图给出了分析和设计的一般步骤;总结了分析和设计中对一般问题的解... 异步时序逻辑电路状态的改变必须考虑外部输入信号以及对应存储器的时钟端或控制端有无信号作用,这是分析与设计的一个难点。针对这一难点进行了详细的讨论,通过系统框图给出了分析和设计的一般步骤;总结了分析和设计中对一般问题的解决方法以及应该注意的问题。通过举例验证了该方法的正确性、通用性和快速性。 展开更多

关键词 异步时序逻辑电路 分析和设计 系统框图 方法

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基于时序图的异步时序逻辑电路的设计 被引量：2

14

作者 高美蓉 《新技术新工艺》 2016年第2期37-39,共3页

在异步时序逻辑电路的设计过程中,以波形分析为基础,通过电路的状态转换图得到电路的时序图,通过时序图的分析确定触发器的时钟方程,在时钟方程的作用下得到状态转换,填写次态卡诺图,通过次态卡诺图的化简得到输出方程和状态方程的设计... 在异步时序逻辑电路的设计过程中,以波形分析为基础,通过电路的状态转换图得到电路的时序图,通过时序图的分析确定触发器的时钟方程,在时钟方程的作用下得到状态转换,填写次态卡诺图,通过次态卡诺图的化简得到输出方程和状态方程的设计方法。该方法简单实用,学生易于理解和接受。 展开更多

关键词 异步时序逻辑电路 时序图 时钟信号

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脉冲型异步时序网络的分析

15

作者 谭岳衡 《衡阳师范学院学报》 2001年第3期47-50,共4页

通过对三种典型的脉冲型异步时序网络的分析 ,提出了一种利用“激励—次态表”

关键词 异步时序网络 激励一次态表

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基于时钟信号的异步时序逻辑电路设计

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作者 陈华 周家萍 《兴义民族师范学院学报》 2013年第4期120-121,共2页

与其他异步时序逻辑电路设计方法相比,基于时钟信号的设计法更简便、快捷。使用该方法时,不用画出时序图,直接从次态卡诺图中选定正确的时钟信号,再快速求出触发器状态方程。

关键词 异步时序逻辑电路 时钟信号 次态卡诺图

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