基于RISC-V的多核可重构处理器架构研究
Research for multi-core reconfigurable processor architecture based on RISC-V
摘要
介绍了一种多核可重构处理器架构。该架构利用可重构片上互连使得锁步技术引入的冗余核可以分时复用,充分发挥多核带来的性能增长。在该架构下,软件开发人员可以通过对任务进行关键等级划分,使得非关键任务可以线程级并行执行,关键任务锁步执行,满足星载计算机对高可靠和高性能的需求。提供了该架构基于RISC-V(第五代精简指令集)的一种实现,并阐述了该架构下的软硬件配合机制。
出处
《航天标准化》
2020年第2期24-27,共4页
Aerospace Standardization
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