集成电路测试相关标准研究与探讨 被引量：13

1

作者 谢正光 《微电子学》 CAS CSCD 北大核心 2004年第3期246-249,253,共5页

　重点研究了纯数字信号、混合信号和片上系统测试的一些问题及相关标准,阐述了各标准的作用,分析了这些标准在实际应用中存在的一些问题及其局限性。

关键词 集成电路 边界扫描 混合信号电路 片上系统 可测性设计

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重掺杂型混合信号集成电路衬底的噪声模型研究 被引量：3

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作者 师奕兵 陈光禑 +1 位作者 王厚军 JiannS.Yuan 《微电子学》 CAS CSCD 北大核心 2001年第1期13-15,共3页

应用器件模拟软件 SILVACO模拟三种结构重掺杂型衬底中注入高频电流的分布 ,根据模拟结果分析得出重掺杂型衬底的简化模型为一单节点 ,进而将简化模型与实际的混合信号集成电路结合 ,建立起重掺杂型衬底的噪声模型 。

关键词 混合信号集成电路 衬底噪声 器件模拟 掺杂

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混合信号集成电路数字PLL衬底噪声的SPICE模拟及分析 被引量：3

3

作者 师奕兵 陈光 +1 位作者 王厚军 Jiann S.Yuan 《电子科技大学学报》 EI CAS CSCD 北大核心 2000年第3期273-277,共5页

应用PSPICE及采用C语言自编的外部程序，对单片数字锁相环电路中的衬底噪声及对电路性能的影响进行了模拟研究和分析，有助于进一步理解衬底噪声及衬底噪声对复杂的混合信号电路工作的影响，提出了实际应用中选择衬底类型的方法。

关键词 混合信号集成电路 衬底噪声 数字锁相环 SPicE模

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混合信号集成电路的衬底耦合噪声分析

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作者 杨银堂 付晓东 朱樟明 《电路与系统学报》 CSCD 北大核心 2006年第2期74-79,共6页

本文系统分析了混合信号集成电路的衬底噪声耦合的研究进展。简要分析了衬底噪声的基本机理,及其对混合信号电路的影响,在此基础上分析比较了目前已提出的几种主要的衬底耦合噪声模型。通过分析不同类型衬底内的噪声耦合,介绍了一些电... 本文系统分析了混合信号集成电路的衬底噪声耦合的研究进展。简要分析了衬底噪声的基本机理,及其对混合信号电路的影响,在此基础上分析比较了目前已提出的几种主要的衬底耦合噪声模型。通过分析不同类型衬底内的噪声耦合,介绍了一些电路设计中的去耦方法。最后讨论了衬底耦合噪声研究的发展方向。 展开更多

关键词 衬底耦合噪声 混合信号集成电路 电阻宏模型 保护环

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一种数模混合集成电路衬底耦合参数快速提取算法

5

作者 吴智 唐璞山 黄均鼐 《微电子学》 CAS CSCD 北大核心 2000年第3期150-154,共5页

边界元方法在计算衬底耦合电阻时 ,需要直接求解稠密矩阵方程 Φ=Z· I,时间复杂度为 O( N3 ) ,N是总的衬底端口单元数 ,使得能计算的电路规模受到很大的限制。根据阻抗矩阵 Z中元素的物理意义 ,采用分段曲线拟合的方法 ,把它很好... 边界元方法在计算衬底耦合电阻时 ,需要直接求解稠密矩阵方程 Φ=Z· I,时间复杂度为 O( N3 ) ,N是总的衬底端口单元数 ,使得能计算的电路规模受到很大的限制。根据阻抗矩阵 Z中元素的物理意义 ,采用分段曲线拟合的方法 ,把它很好地表示成距离倒数的多项式形式。在此基础上 ,采用多极点 GMRES算法迅速求解 Φ=Z·I矩阵方程 ,时间复杂度为 O( N) ,而结果和直接求解的结果非常接近。 展开更多

关键词 参数提取 衬底耦合 数模混合集成电路

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一种离散点式IC衬底噪声有源抵消方法

6

作者 黄小伟 韩雁 周海峰 《微电子学》 CAS CSCD 北大核心 2008年第4期465-468,共4页

在混合信号集成电路中,衬底耦合噪声是一个很大的问题。文章在现有噪声有源抵消电路的基础上,提出了一种新的多抵消点离散式有源噪声抵消方法。它采用有源放大器,产生负相噪声,通过若干个离散抵消点输出,与原来噪声相叠加、互相抵消,起... 在混合信号集成电路中,衬底耦合噪声是一个很大的问题。文章在现有噪声有源抵消电路的基础上,提出了一种新的多抵消点离散式有源噪声抵消方法。它采用有源放大器,产生负相噪声,通过若干个离散抵消点输出,与原来噪声相叠加、互相抵消,起到削弱噪声影响的作用。与原有噪声抵消电路相比,这种多抵消点离散式电路能更为显著地减小通过衬底传导的耦合噪声对模拟电路的影响,噪声幅度削减50%。 展开更多

关键词 混合信号电路 衬底噪声 有源抵消 璃散点式

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混合信号集成电路衬底噪声的一种连续时间直接测试方法

7

作者 师奕兵 陈光 王厚军 《电子测量与仪器学报》 CSCD 2002年第1期18-22,共5页

建立了混合信号集成电路中衬底噪声对模拟电路影响的一种通用模型 ,在此基础上 ,提出了衬底噪声测试的一种新的连续时间直接测试方法。该方法采用差分放大器作为衬底噪声探测器 。

关键词 混合信号集成电路 衬底噪声 模型 测试 差分放大器

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一种基于电压比较器衬底噪声的测试方法

8

作者 师奕兵 陈光 +1 位作者 王厚军 Jiann S.Yuan 《电子科技大学学报》 EI CAS CSCD 北大核心 2002年第1期35-38,共4页

论述了一种测试混合信号集成电路衬底噪声波形的方法采用电压比较器利用衬底电压对比较器状态的影响对噪声作出统计测试根据测试结果重建噪声波形设计了一测试系统的原理框图推导出了用于衬底噪声波形重建的表征取样噪声电压的平均电压... 论述了一种测试混合信号集成电路衬底噪声波形的方法采用电压比较器利用衬底电压对比较器状态的影响对噪声作出统计测试根据测试结果重建噪声波形设计了一测试系统的原理框图推导出了用于衬底噪声波形重建的表征取样噪声电压的平均电压和表征测试误差的均方根值的计算公式建立了模拟实验电路给出了SPICE模拟实验结果 展开更多

关键词 混合信号集成电路 衬底噪声 电压比较器 测试

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手机用TFT-LCD驱动控制芯片的测试电路结构设计 被引量：8

9

作者 李博 魏廷存 樊晓桠 《微电子学与计算机》 CSCD 北大核心 2006年第12期125-128,共4页

文章从分析手机用TFT-LCD驱动控制芯片的测试需求和芯片结构出发,提出了一种针对该芯片的测试电路结构设计方案。该方案采用多条扫描链对芯片内的多个异构的模块进行隔离,保证了各个模块有较高的测试独立性。考虑到内置SRAM的特殊性,采... 文章从分析手机用TFT-LCD驱动控制芯片的测试需求和芯片结构出发,提出了一种针对该芯片的测试电路结构设计方案。该方案采用多条扫描链对芯片内的多个异构的模块进行隔离,保证了各个模块有较高的测试独立性。考虑到内置SRAM的特殊性,采用边界扫描方式进行测试,提高了测试的灵活性,减少了测试电路的面积。电平敏化扫描链的引入,大大提高了SourceDriver测试的可控制性。该方案支持手机用TFT-LCD驱动控制芯片的常规以及特殊项目的测试。 展开更多

关键词 测试电路 TFT—LCD驱动芯片 混合信号电路测试

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数模混合电路的全芯片防静电保护 被引量：5

10

作者 徐代果 赵建明 李儒章 《微电子学》 CAS CSCD 北大核心 2008年第4期534-539,共6页

随着集成电路的迅速发展,特别是数模混合电路的广泛应用,静电放电(ESD)已成为导致集成电路内部静电损伤的可靠性问题,它常常在集成电路的输入、输出端口以及从电源到地的电路内部形成,给芯片的制造和设计带来了很大的困难。文章对芯片... 随着集成电路的迅速发展,特别是数模混合电路的广泛应用,静电放电(ESD)已成为导致集成电路内部静电损伤的可靠性问题,它常常在集成电路的输入、输出端口以及从电源到地的电路内部形成,给芯片的制造和设计带来了很大的困难。文章对芯片防静电保护电路进行了总结,分析和讨论了几种数模混合电路防静电保护技术。 展开更多

关键词 静电保护 数模混合电路 诊测电路 总线结构

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一种电阻串加内插结构的16位D/A转换器

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作者 张俊安 肖怡 +2 位作者 徐金贵 李新星 李铁虎 《微电子学》 CAS 北大核心 2023年第3期413-418,共6页

设计了一种10位电阻串分压加6位内插结构的16位电压输出型D/A转换器。高10位采用1024个电阻串分压网络,低6位采用64个运放输入级内插结构,均采用温度计的方式进行线性叠加,从结构上保证了16位D/A转换器的单调性。该D/A转换器的输出运放... 设计了一种10位电阻串分压加6位内插结构的16位电压输出型D/A转换器。高10位采用1024个电阻串分压网络,低6位采用64个运放输入级内插结构,均采用温度计的方式进行线性叠加,从结构上保证了16位D/A转换器的单调性。该D/A转换器的输出运放采用了PMOS输入折叠式共源共栅加Class AB输出缓冲结构、多级嵌套式密勒补偿(NMCNR),实现了高直流增益和大电容负载下的稳定性。该16位D/A转换器基于0.6μm CMOS工艺设计,在5 V电源电压下,仿真结果表明,微分非线性误差为0.35 LSB,积分非线性误差为3.05 LSB,建立时间为6.12μs,无杂散度动态范围(SFDR)为93.41 dB,功耗为1.84 mW。在接470 pF电容负载的条件下,输出运放直流增益为150.63 dB,单位增益带宽为1.59 MHz,相位裕度为65.84°。 展开更多

关键词 数模转换器 内插结构 电阻分压网络 混合信号集成电路

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光栅测量系统芯片后端物理设计与实现 被引量：4

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作者 王伟 刘成 +2 位作者 侯立刚 张健 吴武臣 《微电子学》 CAS CSCD 北大核心 2007年第4期579-583,共5页

阐述了一款光栅精密测量系统芯片"EYAS"的后端物理设计与实现。考虑到深亚微米工艺下的互连寄生效应,采用基于硅虚拟原型(SVP)的设计和迭代策略,以布线为中心,并适时进行全面的分析和迭代验证。采用"模拟IP"和改进... 阐述了一款光栅精密测量系统芯片"EYAS"的后端物理设计与实现。考虑到深亚微米工艺下的互连寄生效应,采用基于硅虚拟原型(SVP)的设计和迭代策略,以布线为中心,并适时进行全面的分析和迭代验证。采用"模拟IP"和改进的数模混合芯片设计流程,实现了模拟和数字部分的联合设计,保证了时序驱动下的持续收敛和可制造性。"EYAS"芯片采用HJTC 0.18μm工艺流片,并经板级测试成功;芯片工作频率为10 MHz,正交信号采样率为1.25 MHz,封装后芯片面积仅为1.5 mm×2.0 mm,各项功能正常稳定。以该芯片为控制内核,构建了光栅精密角度/位移测量系统,并应于火炮炮膛螺纹磨损度的精密测量。 展开更多

关键词 光栅测量系统 数模混合集成电路 物理设计 布局布线 迭代

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单片数字锁相环衬底噪声的SPICE模拟及分析 被引量：1

13

作者 师奕兵 陈光 +1 位作者 王厚军 Jiann S.Yuan 《微电子学》 CAS CSCD 北大核心 2001年第5期333-336,346,共5页

应用 PSPICE及采用 C语言自编的外部程序 ,对单片数字锁相环中衬底噪声耦合及衬底噪声对电路性能的影响进行了模拟和分析 ,有助于进一步理解衬底噪声以及衬底噪声对复杂的混合信号电路工作的影响。

关键词 集成电路 衬底噪声 SPicE模型 数字锁相环

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CMOS混合信号集成电路中的串扰效应 被引量：2

14

作者 董刚 杨银堂 《半导体技术》 CAS CSCD 北大核心 2002年第10期34-37,共4页

论述了混合信号集成电路中的串扰效应及其对电路本身的影响,重点讨论了在重掺杂衬底中数字干扰对模拟器件的影响,并给出了数字噪声注入等效电路。同时从制造工艺和设计技术方面讨论了降低串扰效应的方法。

关键词 CMOS 混合信号 集成电路 串扰效应 设计技术

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一种多倍频选择的高倍频锁相环频率合成器 被引量：2

15

作者 司龙 熊元新 蒋叶强 《微电子学》 CAS CSCD 北大核心 2005年第4期424-427,共4页

文章描述了一个基准频率为32768Hz的锁相环频率合成器的设计。该频率合成器有1250、1500、2000、2500、3000等5个倍频选择。电路设计基于1stSilicon2.5V0.25μmCMOS工艺。CadenceArtistAnalog仿真显示,该电路可以实现快速锁定,且具有较... 文章描述了一个基准频率为32768Hz的锁相环频率合成器的设计。该频率合成器有1250、1500、2000、2500、3000等5个倍频选择。电路设计基于1stSilicon2.5V0.25μmCMOS工艺。CadenceArtistAnalog仿真显示,该电路可以实现快速锁定,且具有较小的相位抖动。文章研究和总结了频率合成器系统参数的设计理论,对其各个子电路进行了结构优化,并且按MPW流片要求,进行了版图的布局设计。 展开更多

关键词 混合信号集成电路 频率合成器 锁相环 CMOS

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一种快速并行协同仿真的验证方法 被引量：2

16

作者 刘军华 杨海钢 《微电子学》 CAS CSCD 北大核心 2008年第4期520-523,543,共5页

针对具有多个数字和模拟模块的混合信号SoC,提出了一种快速并行协同仿真的验证方法。在保证精度的前提下,该方法在很大程度上减小了验证难度,缩短了验证时间,很好地解决了系统的前端和后端SPICE验证的瓶颈问题。所提出的方法充分利用主... 针对具有多个数字和模拟模块的混合信号SoC,提出了一种快速并行协同仿真的验证方法。在保证精度的前提下,该方法在很大程度上减小了验证难度,缩短了验证时间,很好地解决了系统的前端和后端SPICE验证的瓶颈问题。所提出的方法充分利用主流EDA工具,具有很强的硬件/硬件和软件/硬件协同仿真能力。对于用户来说,具有操作简单、容易实现的特点。同时,该方法也可用来验证具有全定制模块的数字电路。 展开更多

关键词 协同仿真 片上系统 混合信号电路

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虚拟仪器技术在混合集成电路测试中的应用 被引量：2

17

作者 柴海峰 皮志松 《计算机与数字工程》 2010年第9期9-12,共4页

介绍了一种音频接口电路测试方法。测试系统使用LabVIEW软件结合NI公司数据采集卡,对电路DAC、ADC动态参数和滤波器频率特性进行了测试。LabVIEW的数据采集、信号产生、信号调理、数字信号处理等模块在该数模混合电路测试中被使用。与... 介绍了一种音频接口电路测试方法。测试系统使用LabVIEW软件结合NI公司数据采集卡,对电路DAC、ADC动态参数和滤波器频率特性进行了测试。LabVIEW的数据采集、信号产生、信号调理、数字信号处理等模块在该数模混合电路测试中被使用。与传统仪器相比,虚拟仪器开发更方便、人机界面更友好。 展开更多

关键词 虚拟仪器 数模混合集成电路 LABVIEW

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混合信号IC的ESD保护电路设计

18

作者 刘军 傅东兵 《微电子学》 CAS CSCD 北大核心 2009年第1期62-64,68,共4页

从电路设计的角度,介绍了混合信号IC的输入、输出、电源箝位ESD保护电路。在此基础上,构建了一种混合信号IC全芯片ESD保护电路结构。该结构采用二极管正偏放电模式,以实现在较小的寄生电容情况下达到足够的ESD强度;另外,该结构在任意两... 从电路设计的角度,介绍了混合信号IC的输入、输出、电源箝位ESD保护电路。在此基础上,构建了一种混合信号IC全芯片ESD保护电路结构。该结构采用二极管正偏放电模式,以实现在较小的寄生电容情况下达到足够的ESD强度;另外,该结构在任意两个pad间均能形成ESD放电通路,同时将不同的电源域进行了隔离。 展开更多

关键词 静电放电 ESD保护电路 混合信号电路

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有源功率因数校正控制芯片的设计与实现 被引量：1

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作者 徐孝如 赵梦恋 +2 位作者 吴晓波 章丹艳 严晓浪 《浙江大学学报（工学版）》 EI CAS CSCD 北大核心 2008年第4期618-621,626,共5页

为了有效改善电网供电质量,提高电能利用率,针对中大功率电器功率因数校正的需要,设计了一种带输入电压前馈的基于平均电流模式控制的有源功率因数校正(APFC)控制芯片.该芯片集成了输出过压保护和涌入电流限制等保护电路,采用1.5μm双极... 为了有效改善电网供电质量,提高电能利用率,针对中大功率电器功率因数校正的需要,设计了一种带输入电压前馈的基于平均电流模式控制的有源功率因数校正(APFC)控制芯片.该芯片集成了输出过压保护和涌入电流限制等保护电路,采用1.5μm双极型-CMOS(BiCMOS)工艺实现,芯片面积为2.44 mm×2.38 mm.基于该芯片设计了一250 W功率因数校正电路,测试结果表明,芯片在12 V供电电压的条件下,静态功耗为48 mW(不包括开关损耗);在220 V交流输入、满负载下的功率因数为0.993. 展开更多

关键词 功率因数 有源功率因数校正 模拟与混合集成电路 双极型-CMOS

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一种可与微机兼容的12位D／A转换器

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作者 龚剑波 《微电子学》 CAS CSCD 1995年第5期1-3,共3页

本文介绍并分析了一种可与微机兼容的１２位Ｄ／Ａ转换器的工作原理及其应用。该Ｄ／Ａ电路内有高稳定的齐纳隐埋基准，数字输入采用了两级缓冲锁存结构，片内含高速输出放大器。本文给出了其主要性能指标及典型应用连接图。

关键词 数-模转换器 模拟ic 混合信号ic

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