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极化码原理及应用 被引量:14
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作者 李斌 王学东 王继伟 《通信技术》 2012年第10期21-23,共3页
基于信道的组合和分离,当组合信道的数量趋于无穷大的时候,一部分信道趋向于完美的信道,而一部分信道则趋向于纯噪声信道,即信道极化现象。基于此信道极化现象可以构造一种极化码,选择性使用组合信道中比较好的,因此极化码理论上可以达... 基于信道的组合和分离,当组合信道的数量趋于无穷大的时候,一部分信道趋向于完美的信道,而一部分信道则趋向于纯噪声信道,即信道极化现象。基于此信道极化现象可以构造一种极化码,选择性使用组合信道中比较好的,因此极化码理论上可以达到香农限。极化码的原理包括极化码基础、极化码结构、极化码编码、SC译码。最后给出了在源编码的领域里应用极化码的一种方法,较小的牺牲码率而带来性能上较大的提高。 展开更多
关键词 极化 极化现象 极化编码 SC译 编码
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极化码的原理及分析 被引量:4
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作者 孙超 林宝军 《广东通信技术》 2019年第3期26-31,共6页
极化码是基于信道极化现象而设计的新型编码,是目前理论上唯一能达到香农限的线性纠错信道编码,其编译码复杂度低,性能优越。极化码基于信道分裂与组合,其中一部分信道容量趋于无噪,另一部分信道趋于全噪,将无噪信道传输信息比特,全噪... 极化码是基于信道极化现象而设计的新型编码,是目前理论上唯一能达到香农限的线性纠错信道编码,其编译码复杂度低,性能优越。极化码基于信道分裂与组合,其中一部分信道容量趋于无噪,另一部分信道趋于全噪,将无噪信道传输信息比特,全噪信道传输固定比特。极化码随着5G的到来,也逐渐受到重视。被选定为三大应用场景中eMBB场景下的控制信道编码。极化码在长度较短时性能输于LDPC码,然而在eMBB场景下长码方案中依然以三票差距输给LDPC码,因此需要我们继续对此进行探究。本文在阐述极化码的原理基础上,基于matlab软件,信道极化现象与信道索引的关系对主要研究极化码的原理包括极化码的基础,极化码的编码,极化码信道极化,根据原理对传统的连续删除SC译码进行了仿真实现,并将在LDPC码中常用的置信传播BP译码和最小和BP译码方式引入,在基于matlab软件下进行了仿真对比,并对全文进行了总结。 展开更多
关键词 极化 信道极化 极化编码 SC译 MATLAB
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极化码编码理论综述 被引量:2
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作者 李莉萍 侯妍妍 《无线电通信技术》 2021年第1期19-24,共6页
极化码在2009年被提出,因其理论上可被证明能实现二进制离散对称无记忆信道(B-DMC)的信道容量,且编解码复杂度低,因此引起学术界及工业界的广泛关注。随着极化码在2018年被选做第五代移动通信(5G)中增强宽带(eMBB)场景下的控制信道编码... 极化码在2009年被提出,因其理论上可被证明能实现二进制离散对称无记忆信道(B-DMC)的信道容量,且编解码复杂度低,因此引起学术界及工业界的广泛关注。随着极化码在2018年被选做第五代移动通信(5G)中增强宽带(eMBB)场景下的控制信道编码方案,对极化码广泛而深入的研究愈发重要。该综述对极化码编码理论进行介绍,重点探讨极化码的编码构造难题,以及极化码自2009年提出至今在编码构造方面的进展;分析阐述了极化码的蒙特卡洛构造、Tal-Vardy构造、密度进化(Density Evolution,DE)、高斯近似(Gaussian Approximation)、部分序、极化重量(Polarization Weight,PW)、极化谱以及基于人工智能的构造等重要的极化码编码构造方向,以展现迄今为止极化码的编码理论及实践。 展开更多
关键词 极化 极化编码 高斯近似 极化重量 极化 部分序
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基于FPGA的低硬件复杂度的极化码编码实现方案 被引量:1
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作者 周秉毅 陈紫强 +1 位作者 谢跃雷 黄志成 《桂林电子科技大学学报》 2018年第6期448-452,共5页
为了降低极化码编码硬件电路的成本并提高编码结构的灵活性,从面积优化的角度,提出了一种基于FPGA的低硬件复杂度的极化码编码实现方案。采用复用结构替换极化码编码中硬件复杂度较高的直接并行克罗内克积运算结构,并将其封装成可以实... 为了降低极化码编码硬件电路的成本并提高编码结构的灵活性,从面积优化的角度,提出了一种基于FPGA的低硬件复杂度的极化码编码实现方案。采用复用结构替换极化码编码中硬件复杂度较高的直接并行克罗内克积运算结构,并将其封装成可以实现任意维数克罗内克积运算的IP核。实验结果表明,当基矩阵为2阶时,实现最小运算单元所需的寄存器数量降低至原来的1/4,整体硬件复杂度降低至与码长呈线性关系的复杂度。 展开更多
关键词 极化编码 克罗内克积 FPGA 面积优化
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系统极化码的高效低复杂度编译码算法研究 被引量:4
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作者 谭燕秋 郑郁正 杜江 《现代电子技术》 北大核心 2019年第17期25-28,共4页
系统极化码能减弱非系统极化码在连续抵消(SC)译码时的误码扩散敏感性,且在相同计算复杂度下拥有更好的误码性能,已被第五代通信系统采用,作为信道编码方式之一。在对系统极化码进行构造时采用经典的巴氏参数界法,编码时采用复杂度低且... 系统极化码能减弱非系统极化码在连续抵消(SC)译码时的误码扩散敏感性,且在相同计算复杂度下拥有更好的误码性能,已被第五代通信系统采用,作为信道编码方式之一。在对系统极化码进行构造时采用经典的巴氏参数界法,编码时采用复杂度低且高效的非迭代编码算法,译码时采用循环校验码(C RC)辅助的基于对数似然比的连续抵消列表算法(LLR SCL)与再编码结合。仿真结果表明,低信噪比下中等长度的系统极化码的SCL译码性能远优于SC译码;再加以CRC辅助译码后,其性能可得到大幅提升。 展开更多
关键词 系统极化编码 系统极化 非迭代编码算法 连续抵消译 循环校验 仿真分析
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并行高吞吐率多模极化码编码器设计 被引量:1
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作者 刘丽华 管武 梁利平 《计算机工程》 CAS CSCD 北大核心 2019年第4期72-77,共6页
为获得可以支持多种码长、具有更高吞吐率的极化码编码器,提出一种32 bit并行级联的多模极化码编码器结构。每时钟周期内更新生成矩阵的32行,进行32 bit并行编码,从而加快编码速度。通过两级编码结构的级联简化编码器结构,以支持64 bit... 为获得可以支持多种码长、具有更高吞吐率的极化码编码器,提出一种32 bit并行级联的多模极化码编码器结构。每时钟周期内更新生成矩阵的32行,进行32 bit并行编码,从而加快编码速度。通过两级编码结构的级联简化编码器结构,以支持64 bit~4 096 bit码长的极化码编码。实验结果表明,在Xilinx XC6VLX240t的FPGA上,该编码器主频为303.82 MHz,吞吐率为9.72 Gb/s,寄存器与查找表资源相比快速傅里叶变换结构分别降低了77.6%与63.3%,在65 nm CMOS工艺下主频可达0.796 GHz,吞吐率可达24.615 Gb/s。 展开更多
关键词 极化编码 高吞吐率 并行 多模 ASIC实现
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