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RSA中大素数生成算法优化及电路实现
被引量：
1
1
作者
郑朝霞
吴旭峰
+1 位作者
季媛媛
刘尹
《华中科技大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2017年第6期1-4,20,共5页
为了减少大素数生成时间并加快RSA(Rivest,Shamir&Adleman)公钥密码算法的加解密速度,并行化实现了小素数试除和Miller-Rabin素性测试两大关键步骤,使其在进行素性测试的同时能进行小素数试除,从而大幅减少了小素数试除单独运算消...
为了减少大素数生成时间并加快RSA(Rivest,Shamir&Adleman)公钥密码算法的加解密速度,并行化实现了小素数试除和Miller-Rabin素性测试两大关键步骤,使其在进行素性测试的同时能进行小素数试除,从而大幅减少了小素数试除单独运算消耗的时间.为了加速Miller-Rabin素性测试须要反复调用的模乘运算单元,采用一种基于字的高基Montgomery算法及多级流水结构,设计了一种可配置的高速模乘运算电路.经FPGA(现场可编程门阵列)测试,在100 MHz频率下,生成的512bit大素数的平均耗时约为75ms,生成的1 024bit密钥对的平均耗时约为166ms,耗时只有参照结果的54.2%左右.
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关键词
RSA算法
大素数生成
小素数试除
Miller-Rabin测试
MONTGOMERY算法
多级流水结构
原文传递
题名
RSA中大素数生成算法优化及电路实现
被引量：
1
1
作者
郑朝霞
吴旭峰
季媛媛
刘尹
机构
华中科技大学光学与电子信息学院
武汉工程大学电气信息学院
出处
《华中科技大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2017年第6期1-4,20,共5页
基金
国家自然科学基金资助项目(61006020)
科技部科技型中小企业技术创新基金资助项目(14C26214422753)
+1 种基金
湖北省重大科技项目(2015ACA063)
中央高校基本科研业务费专项资金资助项目(2014TS041)
文摘
为了减少大素数生成时间并加快RSA(Rivest,Shamir&Adleman)公钥密码算法的加解密速度,并行化实现了小素数试除和Miller-Rabin素性测试两大关键步骤,使其在进行素性测试的同时能进行小素数试除,从而大幅减少了小素数试除单独运算消耗的时间.为了加速Miller-Rabin素性测试须要反复调用的模乘运算单元,采用一种基于字的高基Montgomery算法及多级流水结构,设计了一种可配置的高速模乘运算电路.经FPGA(现场可编程门阵列)测试,在100 MHz频率下,生成的512bit大素数的平均耗时约为75ms,生成的1 024bit密钥对的平均耗时约为166ms,耗时只有参照结果的54.2%左右.
关键词
RSA算法
大素数生成
小素数试除
Miller-Rabin测试
MONTGOMERY算法
多级流水结构
Keywords
RSA（Rivest
shamir
＆
adleman
）
algorithm
big
prime
number
generation
sieve
func
tion
Miller-Rabin
test
Montgomery
algorithm
multilevel
pipeline
structure
分类号
TN47 [电子电信—微电子学与固体电子学]
原文传递
题名
作者
出处
发文年
被引量
操作
1
RSA中大素数生成算法优化及电路实现
郑朝霞
吴旭峰
季媛媛
刘尹
《华中科技大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
2017
1
原文传递
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