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简单同步时序逻辑电路设计教学内容的优化

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摘要常规同步时序逻辑电路设计步骤存在状态化简繁琐,自启动检查滞后等问题,导致电路设计工作量增大,极易出错。为此,对教学内容进行调整优化,给出了详细的优化步骤,并通过实例讲解设计方法的具体应用,原理简单,易于理解,使时序逻辑电路的设计过程更加直观、清楚。

作者李爱华王建斌张飞龙李伟

机构地区军械工程学院

出处《中国冶金教育》 2011年第6期28-32,共5页 China Metallurgical Education

关键词同步时序逻辑电路教学内容优化状态表隐含表自启动能力

分类号 TN791-4 [电子电信—电路与系统]

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中国冶金教育

2011年第6期

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