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40纳米500MHz DSP核心的时钟设计与分析
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摘要
在低于40纳米的超深亚微米VLSI设计中,时钟树网络在电路时序收敛、功耗、PVT变异容差和串扰噪声规避方面所起的作用要更重要得多。
作者
Rabby Xiao
Yang Zhang
Tommy Liu
机构地区
德州仪器ASIC中国设计中心
出处
《中国电子商情》
2010年第9期54-55,共2页
China Electronic Market
关键词
纳米
设计
时钟
DSP
VLSI
分类号
TN911.72 [电子电信—通信与信息系统]
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中国电子商情
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