基于FPGA的并行可变长解码器的实现
被引量：2
Design and implementation of a parallel VLD using FPGA
摘要
介绍了一种采用并行方式构建的多符号可变长码解码器。该解码器通过增加结构的复杂性和对硬件资源的占用,换取可变长码解码的高吞吐量。这种结构突破了可变长码码字之间的前向依赖性,可并行侦测出Buffer中的所有可能的码字。采用FPGA实现了这种结构。
出处
《电子技术应用》
北大核心
2005年第9期63-65,共3页
Application of Electronic Technique
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