蓝牙专用集成电路芯片及其后端实现 被引量：1

1

作者 唐振宇 陈咏恩 《信息技术》 2003年第9期5-7,18,共4页

蓝牙是一种短距离无线连接技术,具有广阔的应用范围和巨大的市场。自动布局布线工具使得芯片设计者更有效的利用时间并大大加速了产品投向市场。介绍了蓝牙芯片的后端设计。

关键词 蓝牙 专用集成电路 网表 布局 布线

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DTMB标准实时LDPC编码器设计 被引量：3

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作者 彭海云 徐建敏 +1 位作者 王鹏 刘玮 《电视技术》 北大核心 2010年第1期33-36,共4页

在中国数字电视广播地面传输标准(DTMB)中,使用了非规则准循环LDPC码(QC-LDPC)作为前向纠错编码的核心部分。针对该LDPC码生成矩阵的子块特点,设计了一种基于线性反馈移位寄存器结构的LDPC编码器,在45MHz的工作频率下即可实现DTMB中3种... 在中国数字电视广播地面传输标准(DTMB)中,使用了非规则准循环LDPC码(QC-LDPC)作为前向纠错编码的核心部分。针对该LDPC码生成矩阵的子块特点,设计了一种基于线性反馈移位寄存器结构的LDPC编码器,在45MHz的工作频率下即可实现DTMB中3种不同码率下的LDPC实时编码,整个设计在Altera公司的EP2S15器件上完成了布局布线,与同类设计方案相比较,减少了约20%的逻辑资源,适合于低复杂度DTMB标准发射机开发。 展开更多

关键词 中国数字电视广播地面传输标准 准循环LDPC码 实时编码 移位寄存器

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AVS数字视频解码中反量化/反变换的FPGA实现 被引量：1

3

作者 刘艳 陈永恩 《现代商贸工业》 2008年第3期293-294,共2页

介绍了一种基于FPGA的AVS标准视频部分反量化/反变换算法的实现。采用高效的全硬件实现方法,提出各模块的硬件电路结构设计,实验及仿真结果验证了该设计的有效性。

关键词 AVS 反量化 反变换 FPGA

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数字视频广播系统中交织器与解交织器的FPGA实现 被引量：1

4

作者 周加铳 《集成电路应用》 2006年第2期45-46,49,共3页

本文首先介绍了交织解交织的基本原理,并针对数字视频广播系统提出了优化方案,着重分析了其工作原理及各组成模块的具体设计,采用 Verilog HDL 编写程序,最后用 FPGA 加以实现。

关键词 数字视频广播 交织 解交织 FPGA

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基于导频的DVB-T接收端采样钟同步的算法研究

5

作者 范文婧 周加铳 《计算机工程与应用》 CSCD 北大核心 2007年第20期149-151,共3页

针对数字地面广播(DVB-T)系统中的采样钟同步进行了研究,提出了一种利用导频信息进行采样钟偏差估计,并利用多项式插值进行补偿校正的采样钟同步方案。通过引入自适应算法,上述方案能有效地缩短达到稳定同步的时间。实例仿真表明,此方... 针对数字地面广播(DVB-T)系统中的采样钟同步进行了研究,提出了一种利用导频信息进行采样钟偏差估计,并利用多项式插值进行补偿校正的采样钟同步方案。通过引入自适应算法,上述方案能有效地缩短达到稳定同步的时间。实例仿真表明,此方案能够在高斯信道下达到良好的同步效果。 展开更多

关键词 OFDM 采样钟同步 地面数字电视传输 插值滤波

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AVS视频解码器中运动矢量预测的硬件设计与实现

6

作者 温海波 潘良华 《电子设计应用》 2008年第12期87-89,共3页

AVS是我国具有自主知识产权的音视频编码国家标准。本文介绍了基于该标准的视频解码器中运动矢量预测模块的硬件设计与实现。本文采用流水线加并行的处理方式,在满足速度指标的要求下有效地减小了逻辑电路结构的面积,且完全满足高清实... AVS是我国具有自主知识产权的音视频编码国家标准。本文介绍了基于该标准的视频解码器中运动矢量预测模块的硬件设计与实现。本文采用流水线加并行的处理方式,在满足速度指标的要求下有效地减小了逻辑电路结构的面积,且完全满足高清实时解码要求。 展开更多

关键词 视频解码 AVS 运动矢量预测 FPGA

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H.264/AVC解码中的运动补偿技术

7

作者 阳恩龙 高鹏 《集成电路应用》 2005年第7期59-61,共3页

本文阐述了H.264/AVC解码器关键模块——运动补偿的原理,提出了一个运动补偿模块的硬件实现方法,并在FPGA器件上进行了验证,使它与解码器中其它部分(如VLD、IDCT)并行、流水工作。

关键词 H.264 运动补偿 FPGA

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AVS视频解码器中VLD模块的硬件设计

8

作者 郑军 《现代电子技术》 2008年第24期24-26,共3页

AVS是我国自主制定的音视频编码技术标准。提出一种新的适用于AVS视频解码的变字长解码(VLD)结构,重点研究AVS变字长码的特点,通过合理的码字分割解决码字的存储问题,采用桶式移位器,使得每个时钟能处理1个码字。采用Verilog语言进行设... AVS是我国自主制定的音视频编码技术标准。提出一种新的适用于AVS视频解码的变字长解码(VLD)结构,重点研究AVS变字长码的特点,通过合理的码字分割解决码字的存储问题,采用桶式移位器,使得每个时钟能处理1个码字。采用Verilog语言进行设计、模拟,并通过了FPGA验证。采用0.18μm CMOS工艺库综合,在50 MHz的时钟频率下工作时电路规模达到1.6万门左右。 展开更多

关键词 AVS视频标准 变长解码 FPGA VERILOG HDL

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MPEG-2解码器运动补偿模块的硬件实现

9

作者 周岩 陈泳恩 《集成电路应用》 2004年第7期43-45,共3页

本文阐述了MPEG-2解码器关键模块——运动补偿的原理及硬件实现,并讨论了其中的几个技术难点。

关键词 MPEG-2 解码器 运动补偿 图像重建 半象素滤波电路

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DVB-S2中BCH译码器的硬件设计

10

作者 潘良华 《现代电子技术》 2007年第21期25-27,33,共4页

DVB-S2是新一代数字卫星广播标准,标准采用了新的调制与编码技术,在一定的复杂程度下取得最大的信道容量与较好的系统可扩展性。其中编码方式采用了由BCH与LDPC级联的前向纠错系统,使系统性能接近香农限,但长二进制BCH码,也极大地增加... DVB-S2是新一代数字卫星广播标准,标准采用了新的调制与编码技术,在一定的复杂程度下取得最大的信道容量与较好的系统可扩展性。其中编码方式采用了由BCH与LDPC级联的前向纠错系统,使系统性能接近香农限,但长二进制BCH码,也极大地增加了译码器硬件实现难度。针对标准中BCH码的特殊性,通过对长BCH码优化方法的研究与讨论,提出实现该译码器简单有效的FPGA硬件结构,在满足速度要求的前提下尽量减小面积。 展开更多

关键词 DVB—S2 二进制BCH码 无逆Berlekamp算法 并行钱氏搜索

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基于FPGA的长PN码快速捕获方法研究

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作者 周加铳 《集成电路应用》 2004年第6期39-40,共2页

介绍了几种PN码捕获的传统方法，提出了一种用FPGA实现的快速捕获方案——分段并行捕获法，着重分析了它的工作机理，并用FPGA实现。

关键词 FPGA 分段并行捕获 长PN码 滑动相关法 串行搜索法

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DVB-T解内交织器的FPGA实现 被引量：1

12

作者 褚劲华 《集成电路应用》 2004年第2期35-38,共4页

数字电视传输技术是当前研究的热点。欧洲的DVB-T标准由于采用COFDM多载波调制方式,在性能上比其余的几种标准优越。本文介绍了DVB-T标准中解交织模块的算法,给出了在FPGA上的实现方式。

关键词 DVB—T 交织器 FPGA 数字电视 传输技术 编码正交频分复用 COFDM多载波调制方式

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AVS视频解码运动矢量预测模块的硬件设计

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作者 王凌涛 陈泳恩 《信息与电子工程》 2008年第5期338-341,共4页

提出了一种适用于数字音视频编解码标准(AVS)的视频解码帧间运动矢量预测的解码方法,根据AVS宏块模式的特点,以统一的基本运算单元处理所有的解码模式,模块化流水计算,降低了硬件实现的复杂度。采用ASIC结构并使用Verilog语言进行设计... 提出了一种适用于数字音视频编解码标准(AVS)的视频解码帧间运动矢量预测的解码方法,根据AVS宏块模式的特点,以统一的基本运算单元处理所有的解码模式,模块化流水计算,降低了硬件实现的复杂度。采用ASIC结构并使用Verilog语言进行设计、模拟,并成功通过了现场可编程门阵列验证。模块的每个功能块均为专用的VLSI结构,通过系统控制器控制各部分的运行,能有效地提高时钟频率,减小芯片的面积。使用0.18μmCMOS工艺库综合,在50MHz的时钟频率下工作时电路规模仅需1.6万门左右。 展开更多

关键词 数字音视频编解码标准 帧间预测 运动矢量解码 现场可编程门阵列

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