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基于CUDA的任意非结构化LDPC码的高吞吐量并行译码设计与实现
被引量：
1
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作者
王若天
沙金
《微电子学与计算机》
2022年第1期54-61,共8页
由于非结构化的低密度奇偶校验码(LDPC)具有更优异的纠错性能而受到广泛关注,但其非零元素分布较不规律且没有循环或准循环的子矩阵的构造方式,增加了译码器实现的设计难度.本文提出了基于CUDA的译码器设计,用于支持任意非结构化LDPC码...
由于非结构化的低密度奇偶校验码(LDPC)具有更优异的纠错性能而受到广泛关注,但其非零元素分布较不规律且没有循环或准循环的子矩阵的构造方式,增加了译码器实现的设计难度.本文提出了基于CUDA的译码器设计,用于支持任意非结构化LDPC码的高吞吐量并行译码.利用校验矩阵压缩重排、优化信息存储等手段,设计实现GPU上高效的并行译码内核进行多帧译码.在GTX1660Ti GPU平台上的结果表明,基于TPMP流程的LLR-BP和NMSA译码内核设计吞吐量可分别达到78.88~360.25 Mbps和174.38~1323.75 Mbps,实现了面向任意非结构化LDPC码的高效并行译码.
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关键词
低密度奇偶校验码(
ldpc
)
非结构化
ldpc
置信度传播算法
统一计算设备架构
异构计算
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职称材料
题名
基于CUDA的任意非结构化LDPC码的高吞吐量并行译码设计与实现
被引量：
1
1
作者
王若天
沙金
机构
南京大学电子科学与工程学院
出处
《微电子学与计算机》
2022年第1期54-61,共8页
基金
国家自然科学基金(61370040)
江苏省重点研发计划(BE2017153)。
文摘
由于非结构化的低密度奇偶校验码(LDPC)具有更优异的纠错性能而受到广泛关注,但其非零元素分布较不规律且没有循环或准循环的子矩阵的构造方式,增加了译码器实现的设计难度.本文提出了基于CUDA的译码器设计,用于支持任意非结构化LDPC码的高吞吐量并行译码.利用校验矩阵压缩重排、优化信息存储等手段,设计实现GPU上高效的并行译码内核进行多帧译码.在GTX1660Ti GPU平台上的结果表明,基于TPMP流程的LLR-BP和NMSA译码内核设计吞吐量可分别达到78.88~360.25 Mbps和174.38~1323.75 Mbps,实现了面向任意非结构化LDPC码的高效并行译码.
关键词
低密度奇偶校验码(
ldpc
)
非结构化
ldpc
置信度传播算法
统一计算设备架构
异构计算
Keywords
Low-Density
Parity-Check(
ldpc
)
unstructured
ldpc
belief
propagation(BP)algorithm
CUDA
heterogeneous
computing
分类号
TP911.2 [自动化与计算机技术]
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职称材料
题名
作者
出处
发文年
被引量
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1
基于CUDA的任意非结构化LDPC码的高吞吐量并行译码设计与实现
王若天
沙金
《微电子学与计算机》
2022
1
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