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10GHz低相噪扩频时钟发生器的设计与实现 被引量：2
1
作者 曾云 邱玉松 +1 位作者 张锋 夏宇 《湖南大学学报（自然科学版）》 EI CAS CSCD 北大核心 2016年第2期109-114,共6页
基于55nm CMOS工艺设计并制造了一款小数分频锁相环低相噪10GHz扩频时钟发生器(SSCG).该SSCG采用带有开关电容阵列的压控振荡器实现宽频和低增益,利用3阶MASHΔΣ调制技术对电路噪声整形降低带内噪声,使用三角波调制改变分频系数使扩频... 基于55nm CMOS工艺设计并制造了一款小数分频锁相环低相噪10GHz扩频时钟发生器(SSCG).该SSCG采用带有开关电容阵列的压控振荡器实现宽频和低增益,利用3阶MASHΔΣ调制技术对电路噪声整形降低带内噪声,使用三角波调制改变分频系数使扩频时钟达到5 000×10^(-6).测试结果表明:时钟发生器的中心工作频率为10GHz,扩频模式下峰值降落达到16.46dB;在1 MHz频偏处的相位噪声为-106.93dBc/Hz.芯片面积为0.7mm×0.7mm,采用1.2V的电源供电,核心电路功耗为17.4mW. 展开更多
关键词 扩频时钟发生器 锁相环 ΔΣ调制器 相位噪声
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展频时钟生成器的设计与仿真
2
作者 石铭 王新安 《微电子学与计算机》 CSCD 北大核心 2007年第4期72-75,共4页
提出了一种展频时钟生成的方法,使用MATLAB和SIMULINK开发出了快速模拟基于分数N型频率合成器的展频时钟生成器的环境。它能够帮助设计者快速准确地确定系统各个模块的参数,缩短设计的周期。仿真结果显示,这个系统达到了预期的要求,证... 提出了一种展频时钟生成的方法,使用MATLAB和SIMULINK开发出了快速模拟基于分数N型频率合成器的展频时钟生成器的环境。它能够帮助设计者快速准确地确定系统各个模块的参数,缩短设计的周期。仿真结果显示,这个系统达到了预期的要求,证明这个模拟器是比较有效的方法。 展开更多
关键词 EMI 展频时钟 分数N型频率合成器 MATLAB和SIMULINK
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10GHz扩频时钟发生器的设计 被引量：2
3
作者 胡帅帅 周玉梅 张锋 《微电子学与计算机》 CSCD 北大核心 2016年第10期63-67,共5页
扩频时钟是一种减少数字芯片电磁干扰的有效方法.它采用预设好的调制波形,在一定频率范围内对时钟信号进行频率调制.通过小数分频频率综合器和3阶ΔΣ调制器实现了一款10GHz扩频时钟发生器.通过改变多模分频器的分频比来实现扩频的功能... 扩频时钟是一种减少数字芯片电磁干扰的有效方法.它采用预设好的调制波形,在一定频率范围内对时钟信号进行频率调制.通过小数分频频率综合器和3阶ΔΣ调制器实现了一款10GHz扩频时钟发生器.通过改变多模分频器的分频比来实现扩频的功能.此扩频时钟发生器包括一个传统的锁相环,一个数字3阶MASH 1-1-1ΔΣ调制器和一个波形产生器.扩频时钟发生器产生下扩频5 000×10^(-6)的中心频率为10GHz的信号,调制波形为三角波,调制频率为30.525kHz.本设计已经采用55nm CMOS工艺流片,在1.2V电源电压下的总功耗为20mW.峰值降落为29.3dB,1 MHz频偏处的相位噪声为-110dBc/Hz. 展开更多
关键词 扩频时钟发生器 锁相环 电磁干扰 ΔΣ调制器
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基于E-TSPC技术的10 GHz低功耗多模分频器的设计 被引量：1
4
作者 胡帅帅 周玉梅 张锋 《半导体技术》 CAS CSCD 北大核心 2016年第2期96-101,共6页
基于扩展的真单相时钟（E-TSPC）技术,设计了一款用于10 GHz扩频时钟发生器（SSCG）的分频比范围为32~63的多模分频器（MMD）。在设计中,基于D触发器的2/3分频器采用了动态E-TSPC技术,这不仅降低了功耗和芯片面积,而且改善了最高工作频... 基于扩展的真单相时钟（E-TSPC）技术,设计了一款用于10 GHz扩频时钟发生器（SSCG）的分频比范围为32~63的多模分频器（MMD）。在设计中,基于D触发器的2/3分频器采用了动态E-TSPC技术,这不仅降低了功耗和芯片面积,而且改善了最高工作频率。MMD由5级2/3分频器级联而成,由5 bit数字码控制。详细介绍和讨论了2/3分频器和MMD的工作原理和优势。MMD是SSCG的一部分,采用55 nm CMOS工艺进行了流片,芯片面积为35μm×10μm,电源电压为1.2 V,最高工作频率为10 GHz,此时功耗为1.56 m W。 展开更多
关键词 扩展的真单相时钟(E-TSPC) 多模分频器(MMD) 扩频时钟发生器(sscg) 低功耗 动态逻辑
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