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基于整型提升小波变换的图像处理及DSP实现 被引量:25
1
作者 陈升来 黄廉卿 郭静寰 《光学精密工程》 EI CAS CSCD 北大核心 2006年第3期498-502,共5页
针对数字信号处理器(DSP)的并行特性,提出了一种二维整型提升小波的并行体系结构。该结构采用乒乓缓存策略,使得数据的传输和小波变换能够同时进行;用基于行的列变换方法使得列变换只需少量行变换结果就能进行列变换;用移位操作代替乘... 针对数字信号处理器(DSP)的并行特性,提出了一种二维整型提升小波的并行体系结构。该结构采用乒乓缓存策略,使得数据的传输和小波变换能够同时进行;用基于行的列变换方法使得列变换只需少量行变换结果就能进行列变换;用移位操作代替乘法操作,大大减少了算法的运算量。整个结构采用流水线设计,提高了硬件资源的利用率和降低了算法的中间存储量,实现了图像的实时小波变换。实验证明,该算法与原算法相比,速度提高了15倍,达到了每秒85帧;重构图像的峰值信噪比(PSNR)虽然比离散小波变换要低一些,但仍达到了42 dB以上,因此该算法具有广阔的应用前景。 展开更多
关键词 DSP 提升小波 乒乓缓存 小波变换 图像处理
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WinCE环境下指纹识别设备驱动的设计和实现 被引量:8
2
作者 曹瑾亮 张有光 周亮 《电子测量技术》 2007年第8期137-140,共4页
嵌入式系统以其自身的特点,能够满足指纹识别设备对可靠性、成本、体积、功耗等各方面的要求,具有广阔的应用前景。本文主要研究刮擦式指纹传感器AES2510在WinCE嵌入式系统上的驱动设计。描述了该驱动程序体系结构的组织,介绍了传感器... 嵌入式系统以其自身的特点,能够满足指纹识别设备对可靠性、成本、体积、功耗等各方面的要求,具有广阔的应用前景。本文主要研究刮擦式指纹传感器AES2510在WinCE嵌入式系统上的驱动设计。描述了该驱动程序体系结构的组织,介绍了传感器驱动功能的实现。采取乒乓缓冲区(ping-pongbuffer)进行DMA方式接收数据,并同时执行指纹图像数据预处理,利用并行工作的特点,达到提高驱动程序运行效率的目的。 展开更多
关键词 刮擦式指纹传感器 WinCE流驱动程序 乒乓缓冲区
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基于DSP和ADS8509的煤矸石振动信号实时采集 被引量:6
3
作者 刘伟 王汝琳 +2 位作者 张守祥 闫玉华 张岩 《煤矿机械》 北大核心 2009年第7期197-199,共3页
以实际项目研究为背景,介绍了一种基于新型串行A/D转换芯片ADS8509与DSP的振动信号采集方案。ADS8509输出数据采用与SPI总线协议兼容的工作模式,能与DSP的片上外设McBSP串口直接相连,避免了并行总线冲突。采用DMA和乒乓缓冲机制实现McBS... 以实际项目研究为背景,介绍了一种基于新型串行A/D转换芯片ADS8509与DSP的振动信号采集方案。ADS8509输出数据采用与SPI总线协议兼容的工作模式,能与DSP的片上外设McBSP串口直接相连,避免了并行总线冲突。采用DMA和乒乓缓冲机制实现McBSP与内存之间的数据块传输。现场测试表明,该方案实现了高速振动信号采集与传输,运行稳定可靠,具备较强通用性。 展开更多
关键词 A/D转换 数据采集 乒乓缓冲
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一种基于间歇采样的新型干扰技术及实现 被引量:7
4
作者 张建中 文树梁 +2 位作者 高红卫 沙明辉 廖胜男 《现代雷达》 CSCD 北大核心 2018年第11期81-85,共5页
干扰机为有效干扰多部雷达,须尽量增加其侦收时间,以保证不同雷达信号的接收,且干扰信号应在时域、频域、脉压域对雷达信号均能形成有效的干扰。针对线性调频信号,在侦收占空比50%基础上,通过间歇采样、时域重复叠加和移频调制,提出一... 干扰机为有效干扰多部雷达,须尽量增加其侦收时间,以保证不同雷达信号的接收,且干扰信号应在时域、频域、脉压域对雷达信号均能形成有效的干扰。针对线性调频信号,在侦收占空比50%基础上,通过间歇采样、时域重复叠加和移频调制,提出一种新型多假目标干扰和实现架构,研究了不同延迟叠加数、权值和移频调制下假目标的数目、幅度和密集度的影响。仿真实验表明:该型干扰在保证侦收占空比的同时能很好地起到多假目标的欺骗效果,K=N幅度均匀加权叠加较符合实际应用。 展开更多
关键词 间歇采样 多假目标干扰 乒乓缓存
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基于Zynq的高速数据记录仪的设计与实时性分析 被引量:6
5
作者 杜金艳 《计算机测量与控制》 2020年第1期261-265,共5页
为了在无人机飞行过程中实时监测并记录飞行数据,设计了数据记录仪,并对该数据记录仪的接口实时性进行了研究;根据实时性的分析结果,按照所需记录数据的速度和时间要求,FPGA设计中断方式和乒乓缓存,得到最优记录模式;软件根据记录数据... 为了在无人机飞行过程中实时监测并记录飞行数据,设计了数据记录仪,并对该数据记录仪的接口实时性进行了研究;根据实时性的分析结果,按照所需记录数据的速度和时间要求,FPGA设计中断方式和乒乓缓存,得到最优记录模式;软件根据记录数据的优先级进行处理,改进软件指令和中断处理方式,实际应用表明,优化后的图像数据搬移时间达到90μs,同步串口是数据搬移时间达到740μs,大大提高了实时性,同时减轻了CPU的负担,达到了无人机对数据记录仪的实时性要求。 展开更多
关键词 数据记录仪 中断方式 乒乓缓存 实时性
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基于DSP和FPGA的实时图像压缩系统设计 被引量:5
6
作者 彭旭锋 刘文怡 李金力 《微型机与应用》 2010年第11期17-20,共4页
提出了一种基于高频帧摄像头的高频帧实时图像压缩技术,以此技术为基础,使用TMS320CDM642和EP2C35FPGA相结合,设计了一种高频帧实时图像处理器硬件系统。该系统采用2片SRAM乒乓结构,以及基于TI公司DSP/BIOS和支持XDAIS的JPEG2000压缩算... 提出了一种基于高频帧摄像头的高频帧实时图像压缩技术,以此技术为基础,使用TMS320CDM642和EP2C35FPGA相结合,设计了一种高频帧实时图像处理器硬件系统。该系统采用2片SRAM乒乓结构,以及基于TI公司DSP/BIOS和支持XDAIS的JPEG2000压缩算法,实现了100帧/s的压缩速度,系统同时解决了图像压缩中容量和速度的问题,实验了采集和压缩过程的同步进行,大大提高了图像压缩速度。 展开更多
关键词 DM642 乒乓缓存 XDAIS
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基于ARM7与FPGA架构的面阵CCD图像采集系统的设计 被引量:4
7
作者 庄聪聪 王大明 《科技广场》 2010年第1期103-106,共4页
针对用于铁路、公路等行业移动检测的面阵CCD图像采集系统对于小型化与低功耗的需求,设计了一种基于ARM7与FPGA架构的面阵CCD图像采集系统。本文介绍了系统设计的基本原理,并着重阐述了图像A/D转换单元、图像缓冲单元、图像处理单元等... 针对用于铁路、公路等行业移动检测的面阵CCD图像采集系统对于小型化与低功耗的需求,设计了一种基于ARM7与FPGA架构的面阵CCD图像采集系统。本文介绍了系统设计的基本原理,并着重阐述了图像A/D转换单元、图像缓冲单元、图像处理单元等系统主要组成部分的软、硬件设计。本系统利用FPGA控制视频信号的采集、ARM7微控制器作为图像处理单元,并利用μC/OS-II实时操作系统对多任务进行管理,系统扩展灵活,满足小型化与低功耗的要求。 展开更多
关键词 面阵CCD 图像采集 FPGA 乒乓缓存
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基于SRAM乒乓缓存信号完整性分析 被引量:4
8
作者 陈治洲 曹开钦 +2 位作者 柴孟阳 孙德新 刘银年 《现代电子技术》 北大核心 2018年第5期83-88,共6页
为保证电子学系统运行的可靠性,分析电路芯片间传输信号的时序和质量至关重要。基于一块航天应用的图像数据压缩电路,在电路设计、调试过程中引入信号完整性设计方法学,对电路关键网络乒乓缓存电路进行信号完整性分析。在layout前利用Hy... 为保证电子学系统运行的可靠性,分析电路芯片间传输信号的时序和质量至关重要。基于一块航天应用的图像数据压缩电路,在电路设计、调试过程中引入信号完整性设计方法学,对电路关键网络乒乓缓存电路进行信号完整性分析。在layout前利用Hyperlynx软件对电路进行前仿真得出FPGA的管脚约束和布局布线约束,在layout后利用Ansys软件对电路进行后仿真观察布线后信号波形和时序,电路板实际加工后测量信号的波形与仿真结果一致,电路设计一次通过,大大缩短了电路的调试时间,对类似设计有一定的借鉴意义。 展开更多
关键词 电路设计 乒乓缓存 SRAM 前仿真 后仿真 信号完整性 图像压缩
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基于FPGA的双目视觉同步采集系统 被引量:4
9
作者 刘广飞 周文晖 戴国骏 《杭州电子科技大学学报(自然科学版)》 2011年第3期22-25,共4页
该文提出一种象素级的双目视觉同步采集和传输系统,可满足立体视觉对左右视频输入严格同步的需求。该同步系统包含粗略到精确的两级同步设计:硬件电路级的粗略同步及基于硬件描述语言级的精确同步。通过双路视频采集与显示实验证明,该... 该文提出一种象素级的双目视觉同步采集和传输系统,可满足立体视觉对左右视频输入严格同步的需求。该同步系统包含粗略到精确的两级同步设计:硬件电路级的粗略同步及基于硬件描述语言级的精确同步。通过双路视频采集与显示实验证明,该同步系统效果好、可靠性高。 展开更多
关键词 双目视觉 同步采集 乒乓缓存 可编程逻辑门阵列
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一种高速大容量图像存储装置的关键技术研究 被引量:3
10
作者 赵俊江 张会新 《现代电子技术》 北大核心 2017年第12期144-147,151,共5页
针对高速图像采集存储要求,设计一种高速大容量存储装置。该装置以FPGA为主控芯片,以FPGA内部集成的高速串行收发器Rocket I/O GTP作为图像数据接收单元,通过FPGA控制MCB硬核操作2片DDR2 SDRAM构成兵乓缓存单元,以32片NAND FLASH组成的... 针对高速图像采集存储要求,设计一种高速大容量存储装置。该装置以FPGA为主控芯片,以FPGA内部集成的高速串行收发器Rocket I/O GTP作为图像数据接收单元,通过FPGA控制MCB硬核操作2片DDR2 SDRAM构成兵乓缓存单元,以32片NAND FLASH组成的阵列为存储单元,采用交叉双平面页编程技术对FLASH进行数据存储。实现了对3个速率为50 MB/s的图像通道数据实时采集存储。通过对FLASH阵列中的图像数据进行回读分析,测试结果无误,验证了系统功能的有效性和可靠性。 展开更多
关键词 图像存储 RocketI/OGTP DDR2SDRAM 乒乓缓存 交叉双平面页编程
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EDMA在实时视频解码中的应用 被引量:1
11
作者 张丽娜 张涛 《电视技术》 北大核心 2014年第9期81-84,154,共5页
高清视频处理系统对实时性要求很高,解码之后的数据量很大,而且搬移到显示缓冲区有不同的排列显示要求。给出了4种情况下,解码的宏块地址到显示缓冲区地址的对应关系。针对主要出现的第一种和第三种情况,计算了搬移一帧图像的复杂度,并... 高清视频处理系统对实时性要求很高,解码之后的数据量很大,而且搬移到显示缓冲区有不同的排列显示要求。给出了4种情况下,解码的宏块地址到显示缓冲区地址的对应关系。针对主要出现的第一种和第三种情况,计算了搬移一帧图像的复杂度,并提供了多种方案解决此问题。最后通过实验进行对比说明,利用DSP中的协处理器EDMA(Enhanced Direct Memory Access)可以实现快速的搬移数据,而不占用CPU资源,并且配合使用数据缓冲区的PING-PONG结构,有助于实现视频的实时解码要求。 展开更多
关键词 EDMA 视频解码 显示缓冲区 pingpong结构 存储结构
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DSP/BIOS环境下视频图像火焰检测算法实现 被引量:1
12
作者 周一君 马莉 《机电工程》 CAS 2009年第12期34-37,61,共5页
针对DSP/BIOS环境下在线视频图像火焰检测算法实现中存在的巨量数据运算和提高CPU利用率之间的矛盾,提出了以TMS320DM642为处理器的视频图像处理硬件系统构建,并在DSP/BIOS下设计了基于任务通信的实时视频图像火焰检测系统。此外,给出... 针对DSP/BIOS环境下在线视频图像火焰检测算法实现中存在的巨量数据运算和提高CPU利用率之间的矛盾,提出了以TMS320DM642为处理器的视频图像处理硬件系统构建,并在DSP/BIOS下设计了基于任务通信的实时视频图像火焰检测系统。此外,给出了基于颜色和火焰蔓延动态特性的检测规则,利用Ping-pong缓存技术实现了EDMA数据传输和CPU处理的并行操作,大大提高了CPU的利用率。试验结果表明,该算法不仅能有效地提取火焰区域,而且能使单帧图像的处理速度较无缓存技术和缓存技术分别提高60倍和1.55倍。 展开更多
关键词 TMS320DM642 DSP/BIOS 火焰检测 pingpong缓存
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基于FPGA的多通道出砂振动信号缓存系统研究 被引量:2
13
作者 王炳友 党博 +2 位作者 党瑞荣 王港 王新亚 《石油化工应用》 CAS 2021年第4期98-104,共7页
非侵入式出砂监测是油气开采过程中涉及到的一项关键技术。针对线性阵列式出砂监测探头的多通道同步数据缓存需求以及保证波形完整性的数据预触发需求,提出了一种适合现场可编程门阵列(Field Programmable Gate Array,FPGA)实现的,具有... 非侵入式出砂监测是油气开采过程中涉及到的一项关键技术。针对线性阵列式出砂监测探头的多通道同步数据缓存需求以及保证波形完整性的数据预触发需求,提出了一种适合现场可编程门阵列(Field Programmable Gate Array,FPGA)实现的,具有自适应预触发功能的多通道出砂振动信号缓存系统架构,分析了实现该系统架构的关键技术,完成了具体的逻辑设计。这种系统架构采用新的自适应预触发方法,并利用乒乓操作原理,具有良好的通道扩展性。最后,以五通道自适应预触发数据缓存系统为例,对该多通道出砂振动信号缓存系统的功能完整性进行了功能仿真和板级测试。测试结果表明,基于该架构设计的多通道数据缓存系统能够完成连续数据流的自适应预触发缓存,系统架构功能完整有效。 展开更多
关键词 FPGA 自适应预触发 多通道同步 乒乓操作 数据流缓存
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EDMA传输机制与系统实时性的教学设计 被引量:2
14
作者 江汉 程云鹏 沈良 《电气电子教学学报》 2015年第3期63-67,共5页
针对研究生课程"实时数字信号处理"教学中存在的难题,本文讨论了增强型直接内存访问(EDMA)传输机制对于系统实时性的影响,提出了一种基于乒乓双缓存的数据流结构。为方便开展课堂教学,本文以DSK6416硬件实验板为平台,提出了... 针对研究生课程"实时数字信号处理"教学中存在的难题,本文讨论了增强型直接内存访问(EDMA)传输机制对于系统实时性的影响,提出了一种基于乒乓双缓存的数据流结构。为方便开展课堂教学,本文以DSK6416硬件实验板为平台,提出了一种系统实时性定量测量方法,通过测量结果给出了满足实时性的最佳参数组合,有效弥补了理论教学在阐述EDMA机制流程方面的不足。 展开更多
关键词 EDMA 乒乓缓冲 实时信号处理
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适合DSP处理的低内存并行SPIHT算法
15
作者 陈升来 黄廉卿 《光学技术》 EI CAS CSCD 北大核心 2006年第4期587-590,共4页
针对SPIHT(set partitioning in hierarchical trees)算法的编码过程具有重复运算、存储量大等问题,提出了一种适合于DSP(digital signal processors)处理的低内存并行SPIHT算法。该算法采用乒乓缓存策略,使得数据的传输和编码能够同时... 针对SPIHT(set partitioning in hierarchical trees)算法的编码过程具有重复运算、存储量大等问题,提出了一种适合于DSP(digital signal processors)处理的低内存并行SPIHT算法。该算法采用乒乓缓存策略,使得数据的传输和编码能够同时进行。通过引入基于行的整型提升方案,使得只需经少量行变换就能进行列变换,提高了小波的变换速度。根据DSP的并行特性和SPIHT算法的缺点,采用“改进的最大幅值求取方法”、“误差位数以及绝对零值和绝对零集合”、“最大值与零值图”和“单棵零树编码”等多种方法对其进行了改进,大大缓解了对内存的压力,减少了算法的运算量。该算法与LZC(listless zerotree coding)算法相比,重构图像的峰值信噪比相当,但速度提高了2倍,能满足一般的实时压缩要求。 展开更多
关键词 图像压缩 DSP 提升方案 SPIHT LZC 乒乓缓存
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新型高速大容量雷达数据记录器设计 被引量:1
16
作者 雷超群 苏淑靖 《电子器件》 CAS 北大核心 2016年第3期634-638,共5页
设计了一种新型高速大容量雷达数据记录器的设计。为了将有效速度为59 Mbyte/s的雷达回波数据流及时、可靠的存储到记录器中,系统逻辑使用了乒乓缓存技术将其分解为两路速度为29.5 Mbyte/s的数据流并分别交叉写入两片FLASH,这样大大减... 设计了一种新型高速大容量雷达数据记录器的设计。为了将有效速度为59 Mbyte/s的雷达回波数据流及时、可靠的存储到记录器中,系统逻辑使用了乒乓缓存技术将其分解为两路速度为29.5 Mbyte/s的数据流并分别交叉写入两片FLASH,这样大大减轻了单片FLASH操作时序的压力。同时单片FLASH运用了交错式双平面编程和高效的无效块管理,极大的提高了芯片的写入速度。此数据记录器已经通过了振动、高低温、电磁兼容和冲击等实验,运行可靠稳定,同时已经交付部队使用。 展开更多
关键词 高速存储 MT29F16G08AJADAWP 乒乓缓存 交错式双平面编程
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一种数据链FPGA不定长数据处理架构
17
作者 贾继鹏 蒋凯丽 +2 位作者 于军 韩宁 汪吕喜 《应用科技》 CAS 2022年第5期63-66,共4页
针对导弹与地面设备数据链通信时接口数据囤积多包且数量不定的问题,提出了一种基于现场可编程逻辑阵列(FPGA)的数据链不定长数据处理架构,核心是三RAM数据缓存模块的设计。通过RAM1和RAM2实现接口数据的乒乓存储,通过RAM3实现缓存数据... 针对导弹与地面设备数据链通信时接口数据囤积多包且数量不定的问题,提出了一种基于现场可编程逻辑阵列(FPGA)的数据链不定长数据处理架构,核心是三RAM数据缓存模块的设计。通过RAM1和RAM2实现接口数据的乒乓存储,通过RAM3实现缓存数据与物理层模块的数据交互,可达到接口数据无误下发的效果。架构具有通用性,不仅适用于导弹与地面设备之间应答式数据链通信,对于其他应用场景均具有借鉴意义。 展开更多
关键词 数据链 FPGA 不定长数据处理 应答式通信 乒乓RAM XILINX 数据缓存 软件无线电
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H.264/AVC编码器在TMS320DM6437上的EDMA优化 被引量:1
18
作者 崔遥 赵锴 +1 位作者 崔慧娟 唐昆 《电视技术》 北大核心 2010年第9期38-40,共3页
分析了基于TMS320DM6437平台的H.264/AVC编码器,对H.264/AVC编码器结构进行了适当的调整,对代码中大数据量搬移部分进行EDMA优化。使编码器的高速缓冲存储器(cache)命中率提高了20%~30%,编码速率提高了3~4f/s(帧/秒)。
关键词 TMS320DM6437 EDMA 乒乓缓存 编码器 缓冲存储器
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基于FPGA的数字核脉冲高速传输系统设计 被引量:1
19
作者 胡宁 庹先国 +1 位作者 王磊 王琳 《核电子学与探测技术》 CAS CSCD 北大核心 2012年第1期107-111,共5页
针对高速数字核脉冲采集中的实时传输问题,提出了一种基于FPGA和USB的传输结构。该结构采用现场可编程逻辑阵列(FPGA)作为核心控制器,并通过乒乓操作原理对高速核脉冲进行采集,定义特定的简单可靠的传输帧结构。利用USB与PC机通信,既实... 针对高速数字核脉冲采集中的实时传输问题,提出了一种基于FPGA和USB的传输结构。该结构采用现场可编程逻辑阵列(FPGA)作为核心控制器,并通过乒乓操作原理对高速核脉冲进行采集,定义特定的简单可靠的传输帧结构。利用USB与PC机通信,既实现了高速数据的实时传输又真正实现了"即插即用",提高了整套系统的实用性。实验测试验证了该系统的高效性。 展开更多
关键词 FPGA USB 高速核脉冲 乒乓缓存 数据帧结构
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基于TMS320C6416的3D虚拟声合成系统
20
作者 亢宣 付中华 +3 位作者 蒋冬梅 田霄海 须明 王博 《计算机工程与科学》 CSCD 北大核心 2011年第8期143-147,共5页
本文设计了一套基于TMS320C6416芯片的3D虚拟声合成系统。利用头相关传输函数HRTF产生适用于耳机回放的3D虚拟声,使用DSP的库函数实现合成操作,通过设置中断服务程序使DSP以双缓冲机制输出音频,编写芯片的二次加载程序(bootloader)实现... 本文设计了一套基于TMS320C6416芯片的3D虚拟声合成系统。利用头相关传输函数HRTF产生适用于耳机回放的3D虚拟声,使用DSP的库函数实现合成操作,通过设置中断服务程序使DSP以双缓冲机制输出音频,编写芯片的二次加载程序(bootloader)实现整个系统的脱机运行。最后通过TLC16C550芯片实现DSP与PC通信,完成测听实验。结果显示,本系统的测听方位感正确率能达到95%,且执行效率较PC上有显著提高。 展开更多
关键词 3D虚拟声 TMS320C6416 二次加载 头相关传输函数 双缓冲
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