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基于System Generator的任意底对数变换FPGA实现方法
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作者 李武旭 李宏 《舰船电子对抗》 2022年第6期85-89,共5页
在信号处理系统开发中,基于现场可编程门阵列(FPGA)的对数处理对开发人员的算法逻辑和硬件水平有较高的要求。针对该问题,介绍了一种基于FPGA的任意底对数变换实现方法。该方法采用分段拟合方式进行对数变换,利用简单的乘法和加法运算,... 在信号处理系统开发中,基于现场可编程门阵列(FPGA)的对数处理对开发人员的算法逻辑和硬件水平有较高的要求。针对该问题,介绍了一种基于FPGA的任意底对数变换实现方法。该方法采用分段拟合方式进行对数变换,利用简单的乘法和加法运算,在FPGA平台上实现了实时、高精度的对数运算,并在对数变换的FPGA实现时,联合System Generator、MATLAB和Simulink开展FPGA设计与验证协同开发。对比该方法与基于硬件描述语言(HDL)开发方法的计算效率和硬件资源使用情况,说明该方法能够显著提高FPGA对数处理的开发效率,并在设计实现的同时完成设计验证,便于在工程中实现设计的共享和移植。 展开更多
关键词 System Generator 现场可编程门阵列 任意底 浮点数对数变换 快速对数变换 对数转换误差分析
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