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一种用于宽电源电压域的高速低功耗动态比较器
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作者 李新 董志鹏 《半导体技术》 CAS 北大核心 2024年第11期998-1007,共10页
针对工业生产和车机系统中电压摆幅过大影响传统动态比较器精度和稳定性的问题,基于SMIC 90 nm CMOS工艺,设计了一种面向浮栅型的一次性可编程非易失性存储器的动态电流比较器。并设计了一种随电源电压变化的偏置电路,为比较器提供基准... 针对工业生产和车机系统中电压摆幅过大影响传统动态比较器精度和稳定性的问题,基于SMIC 90 nm CMOS工艺,设计了一种面向浮栅型的一次性可编程非易失性存储器的动态电流比较器。并设计了一种随电源电压变化的偏置电路,为比较器提供基准电压和电流。在动态电流比较器的第一级中,利用电流缓冲器结构隔离后续电路对输入信号的影响,通过比较存储单元电流与基准电流,生成比较结果,同时通过基准电流限制高压时的电流。比较结果经共源极放大器放大后与基准电压进行二次比较,以提升读取的准确性和速度。流片验证结果表明,与采用传统动态比较器的存储器相比,本设计读取速度提高了73.2%,低压工作条件下的读取准确性提高了95.2%,同时功耗降低了35.7%,外围电路面积减小了79.1%。 展开更多
关键词 强臂比较器 双尾型电流比较器 低延时 低功耗 宽电压裕度
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业务驱动的低轨卫星物联网终端模态切换方法
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作者 洪涛 王凡 +4 位作者 李治 钟志伟 丁晓进 刘子威 张更新 《系统工程与电子技术》 EI CSCD 北大核心 2024年第8期2867-2876,共10页
针对低轨卫星物联网场景下基于窄带物联网(narrow band Internet of Things,NB-IoT)体制的物联终端大尺度地理范围内多场景应用业务时延和终端功耗需求动态变化问题,提出一种利用马尔可夫链模型评估NB-IoT终端在扩展不连续接收(extended... 针对低轨卫星物联网场景下基于窄带物联网(narrow band Internet of Things,NB-IoT)体制的物联终端大尺度地理范围内多场景应用业务时延和终端功耗需求动态变化问题,提出一种利用马尔可夫链模型评估NB-IoT终端在扩展不连续接收(extended discontinuous reception,eDRX)和节能模式(power saving mode,PSM)下的时延功耗的方法,建立了以下行业务延迟和终端功耗为优化目标的多目标优化问题。在信关站利用终端历史业务数据信息离线训练基于支持向量机(support vector machine,SVM)的时延功耗的回归预测模型,以回归预测模型作为非支配排序遗传算法(non-dominated sorting genetic algorithms-II,NSGA-II)的目标函数,得到多目标优化问题的Pareto前沿解集,进一步从Pareto前沿解集中选择满足当前应用时延功耗需求的工作状态定时器参数值,在线配置终端。仿真结果表明,相比于传统的地面物联网终端固定式定时器参数配置方法,所提出的业务驱动的定时器参数配置方法在终端动态多场景应用下能够更好地满足业务时延和终端功耗需求。 展开更多
关键词 低轨卫星物联网 窄带物联网 马尔可夫链 时延功耗 多目标优化
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How much power is needed for a billion-thread high-throughput server? 被引量:2
3
作者 Zhiwei XU 《Frontiers of Computer Science》 SCIE EI CSCD 2012年第4期339-346,共8页
With the advent of Internet services, big data and cloud computing, high-throughput computing has generated much research interest, especially on high-throughput cloud servers. However, three basic questions are still... With the advent of Internet services, big data and cloud computing, high-throughput computing has generated much research interest, especially on high-throughput cloud servers. However, three basic questions are still not satis-factorily answered: (1) What are the basic metrics (what throughput and high-throughput of what)? (2) What are the main factors most beneficial to increasing throughput? (3) Are there any fundamental constraints and how high can the throughput go? This article addresses these issues by uti- lizing the fifty-year progress in Little's law, to reveal three fundamental relations among the seven basic quantities of throughput (2), number of active threads (L), waiting time (W), system power (P), thread energy (E), Watts per thread to, threads per Joule 0. In addition to Little's law L = λW, we obtain P =λE and λ = Lto0, under reasonable assumptions. These equations help give a first order estimation of per- formance and power consumption targets for billion-thread cloud servers. 展开更多
关键词 high-throughput computing billion-threadservers power consumption waiting time and latency per-formance formulation Little's law
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双层边缘计算结构中最小化功率开销的任务卸载策略 被引量:2
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作者 刘通 《重庆理工大学学报(自然科学)》 CAS 北大核心 2019年第8期157-164,共8页
为了应对未来网络中的海量数据请求,避免热点区域内出现网络拥塞,提出了一种异构网络中的宏-微双层边缘计算结构。在双层边缘计算结构中,移动用户可以选择将任务迁移至宏边缘或微边缘,不同的卸载方式会导致不同的时延和能耗。为了节省... 为了应对未来网络中的海量数据请求,避免热点区域内出现网络拥塞,提出了一种异构网络中的宏-微双层边缘计算结构。在双层边缘计算结构中,移动用户可以选择将任务迁移至宏边缘或微边缘,不同的卸载方式会导致不同的时延和能耗。为了节省任务执行时间,同时为了降低能量开销,提出了一种能够最小化系统总功率开销的DTOS(double-layer task offloading strategy)优化策略。基于此策略,以任务的执行时长和功率消耗为限制条件,构建了以实现最小化系统总功率开销为目的的数学优化模型,为降低优化模型的求解复杂度,提出一种嵌套迭代算法对优化模型进行求解。仿真结果证明此策略能节约系统功耗,同时还能降低任务执行时延。 展开更多
关键词 边缘计算 任务卸载 时延 功耗
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自适应多跳的无线传感器网络MAC协议 被引量:1
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作者 邹昀辛 沈崧 《计算机工程与设计》 CSCD 北大核心 2014年第7期2272-2277,2282,共7页
针对无线传感器网络多跳性的特点,以低能耗、低延迟为目标,提出了一种能够根据网络拓扑自动调整一个帧周期内侦听次数的MAC协议,AM-MAC(adaptive multi-hop MAC)。在无线传感器网络MAC层协议T-MAC和S-MAC的基础上,采用同步入网、限制MA... 针对无线传感器网络多跳性的特点,以低能耗、低延迟为目标,提出了一种能够根据网络拓扑自动调整一个帧周期内侦听次数的MAC协议,AM-MAC(adaptive multi-hop MAC)。在无线传感器网络MAC层协议T-MAC和S-MAC的基础上,采用同步入网、限制MAC包长和自适应侦听次数的方法,使网络节点在流量较小时更多地处于睡眠状态,在流量较大时较快地传播网络数据,减少数据传输的能耗,降低数据传输的延迟。仿真结果表明了该协议在能量消耗、数据延迟等方面要超过S-MAC和T-MAC。 展开更多
关键词 MAC协议 无线传感器网络 多跳 低延迟 低能耗
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优化内存系统能效的DRAM架构研究综述 被引量:1
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作者 展旭升 包云岗 孙凝晖 《高技术通讯》 EI CAS 北大核心 2018年第9期794-812,共19页
介绍了不同层次优化内存系统能效研究的现状,对通过修改动态随机存取存储器(DRAM)架构优化内存系统能效的研究进行了详细论述。概述了通过修改内存控制器和操作系统实现的高能效DRAM系统的研究。着重介绍了通过修改DRAM架构实现内存系... 介绍了不同层次优化内存系统能效研究的现状,对通过修改动态随机存取存储器(DRAM)架构优化内存系统能效的研究进行了详细论述。概述了通过修改内存控制器和操作系统实现的高能效DRAM系统的研究。着重介绍了通过修改DRAM架构实现内存系统能效优化的研究,并将这些研究分为"低延迟的DRAM架构"和"低功耗的DRAM架构"两大类进行介绍,其中低延迟架构的研究包括优化关键操作、降低平均访存延迟以及提升请求并发度等3个方面;低功耗的架构研究包括细粒度激活、低功耗与低频率芯片、优化写操作、优化刷新操作以及多粒度访存等5个方面。最后给出了关于修改DRAM架构实现内存能效优化的总结和展望。 展开更多
关键词 内存 动态随机存取存储器(DRAM) 内存控制器 架构 能效 低延迟 低功耗
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Design of Efficient Router with Low Power and Low Latency for Network on Chip
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作者 M. Deivakani D. Shanthi 《Circuits and Systems》 2016年第4期339-349,共11页
The NoC consists of processing element (PE), network interface (NI) and router. This paper proposes a hybrid scheme for Netwok of Chip (NoC), which aims at obtaining low latency and low power consumption by concerning... The NoC consists of processing element (PE), network interface (NI) and router. This paper proposes a hybrid scheme for Netwok of Chip (NoC), which aims at obtaining low latency and low power consumption by concerning wired and wireless links between routers. The main objective of this paper is to reduce the latency and power consumption of the network on chip architecture using wireless link between routers. In this paper, the power consumption is reduced by designing a low power router and latency is reduced by implementing a on-chip wireless communication as express links for transferring data from one subnet routers to another subnet routers. The average packet latency and normalized power consumption of proposed hybrid NoC router are analyzed for synthetic traffic loads as shuffle traffic, bitcomp traffic, transpose traffic and bitrev traffic. The proposed hybrid NoC router reduces the normalized power over the wired NoC by 12.18% in consumer traffic, 12.80% in AutoIndust traffic and 12.5% in MPEG2 traffic. The performance is also analyzed with real time traffic environments using Network simulator 2 tool. 展开更多
关键词 Network on Chip ROUTER Processing Element Wireless Link power consumption Average Packet latency
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一种高性能极化码SC译码器设计
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作者 王晓蕾 戴吴骏 +2 位作者 杜高明 李桢旻 张多利 《电子科技》 2022年第8期14-20,共7页
针对极化码SC译码器存在的高延时、低吞吐率、低资源效率等问题,文中提出了一种高性能SC译码器硬件架构。通过剪枝冻结比特结点的方式化简SC译码二叉树,设计跨周期的PE单元存储模块,并在译码最后一个阶段利用2b-SC算法,保证译码器具有... 针对极化码SC译码器存在的高延时、低吞吐率、低资源效率等问题,文中提出了一种高性能SC译码器硬件架构。通过剪枝冻结比特结点的方式化简SC译码二叉树,设计跨周期的PE单元存储模块,并在译码最后一个阶段利用2b-SC算法,保证译码器具有较低的延时和较高的吞吐率。采用资源复用的方法,提高译码器资源效率。测试结果表明,文中所提出的译码器周期为330,吞吐率为388.85 Mbit·s-1,资源效率为2.204 Mbit·s-1·kGE-1。与其他SC译码器的对比试验表明,该高性能SC译码器的延时、吞吐率、资源效率均得到了有效改善。此外,该译码器的功耗较低,应用前景良好。 展开更多
关键词 极化码 串行抵消 延时 功耗 吞吐率 资源效率 资源复用 专用集成电路
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多电压下的低功耗算法分析
9
作者 朱琦 吕宗伟 《仪器仪表用户》 2005年第6期129-131,共3页
随着IC的集成度、工作频率和设计复杂度的不断提高,IC的功耗问题的重要性正逐渐显现出来,功耗过大成了制约产品性能提高的重要因素。本文介绍了一种在兼顾功耗和速度的前提下,将各个运算节点合理地安排在系统内部的多级电压资源上的算法... 随着IC的集成度、工作频率和设计复杂度的不断提高,IC的功耗问题的重要性正逐渐显现出来,功耗过大成了制约产品性能提高的重要因素。本文介绍了一种在兼顾功耗和速度的前提下,将各个运算节点合理地安排在系统内部的多级电压资源上的算法,以在满足速度前提下,实现功耗量低。 展开更多
关键词 数据流表 资源和时间约束 节点 功耗
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基于概率计算的TPC译码算法研究与FPGA设计
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作者 庞宇 王小兵 +1 位作者 张颖 谭鸿浩 《电子测量技术》 北大核心 2021年第19期103-109,共7页
目前TPC码(Turbo乘积码)常用的译码算法为Pyndiah-Chase-II算法,但Pyndiah-Chase-II算法在搜索最不可靠输入比特位置和最短欧氏距离码字的过程中,涉及大量的排序运算、复杂的分支结构和存储调度使其非常不利于集成电路硬件实现。针对上... 目前TPC码(Turbo乘积码)常用的译码算法为Pyndiah-Chase-II算法,但Pyndiah-Chase-II算法在搜索最不可靠输入比特位置和最短欧氏距离码字的过程中,涉及大量的排序运算、复杂的分支结构和存储调度使其非常不利于集成电路硬件实现。针对上述问题,提出一种基于概率计算的TPC译码算法,该算法包括信息输入层、随机比特流生成层、BCH硬判决层、BCH&CRC校验层、输出层,其TPC码的子码采用BCH码,通过MATLAB软件进行译码算法的程序设计并完成译码性能和译码延时的仿真。仿真结果表明,该译码算法能够达到和传统的Pyndiah-Chase-II算法相同的译码性能,平均只需要两次迭代即可实现正确译码,能有效地降低译码的延时。最后完成基于FPGA的硬件设计,BCH硬判决层采用查找表方式实现,其他层的逻辑结构简单,均为门级操作,所以能够大幅度减小硬件开销和降低功耗,易于用集成电路实现。 展开更多
关键词 TURBO乘积码 BCH码 概率TPC算法 Pyndiah-Chase-II算法 编译码 低延时 FPGA 低功耗
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mMTC中基于功率控制的URLL上行无线资源优化方案
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作者 谢显中 黎佳 +1 位作者 黄倩 陈杰 《北京邮电大学学报》 EI CAS CSCD 北大核心 2018年第6期45-51,共7页
提出了一种大规模机器类通信(mMTC)中基于功率控制的高可靠低迟延(URLL)上行无线资源优化方案.考虑时分双工蜂窝网络,设计了上行链路传输的反向功率控制方案,并导出了基于距离的链路可靠性函数;在此基础上,建立了上行无线资源优化模型,... 提出了一种大规模机器类通信(mMTC)中基于功率控制的高可靠低迟延(URLL)上行无线资源优化方案.考虑时分双工蜂窝网络,设计了上行链路传输的反向功率控制方案,并导出了基于距离的链路可靠性函数;在此基础上,建立了上行无线资源优化模型,分析了链路可靠性函数的特性,并提出了一种基于黄金分割搜索最优的传输错误概率算法;给出了一种最小化系统所需的总带宽算法,可为每个用户分配多个子信道,用户通过判断信道增益是否超过门限值来选择子信道.仿真实验结果表明,新方案在迟延和可靠性的改进以及总带宽、功耗等方面的优势显著. 展开更多
关键词 大规模机器类通信 高可靠低迟延 功率控制 无线资源优化 总带宽 功耗
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