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几种A/D转换技术及性能特点的分析 被引量:2
1
作者 王树红 《山西电子技术》 2004年第5期35-36,42,共3页
通过对四种最为常用的模数转换技术及其特点加以分析比较 ,阐述其工作原理、性能特点及其优缺点 。
关键词 性能特点 A/D转换技术 模数转换技术 模数转换器 分析比较 工作原理 优缺点
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超高速数据采集技术发展现状 被引量:30
2
作者 马海潮 《测试技术学报》 2003年第4期287-292,共6页
 介绍超高速数据采集技术发展现状和动态.概述当前领先的几种超高速数据采集板卡;给出了目前主要超高速ADC芯片,对超高速ADC芯片静动态性能指标进行了描述.
关键词 超高速数据采集 adc 标准总线 采样率
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高速莫尔条纹信号单片机细分的一种方法 被引量:5
3
作者 王跃琼 《光学精密工程》 EI CAS CSCD 1997年第1期112-118,共7页
提出了一种莫尔条纹信号单片机细分系统。该系统采用闪电式模数转换器(简写ADC),可对高速莫尔条纹信号进行瞬间采样和转换,确定出其相对应的空间角位置。
关键词 高速 莫尔条纹信号 细分系统 计量光栅
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高速ADC(模拟数字转换器)结构设计技术 被引量:7
4
作者 朱樟明 杨银堂 《半导体技术》 CAS CSCD 北大核心 2003年第5期65-69,共5页
系统分析了当前主流的FLASHADC、折叠式ADC、流水线ADC等各种高速ADC的结构,比较各种结构之间的优缺点,阐述了高速ADC结构的发展趋势。
关键词 adc 模拟数字转换器 结构设计 结构比较 折叠式 流水线 flash-adc
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模数转换技术的分析与应用 被引量:3
5
作者 蒋臻 《电子与封装》 2007年第3期38-42,共5页
从市场角度入手分析了ADC在电子技术发展中的重要性及其特殊性;然后分析ADC不同的算法组合,如并行比较型、逐次逼近型、积分型、∑-Δ型、流水线型ADC,详细比较各种算法的优缺点及主要用途;最后结合工艺的发展,展望了ADC的发展趋势和存... 从市场角度入手分析了ADC在电子技术发展中的重要性及其特殊性;然后分析ADC不同的算法组合,如并行比较型、逐次逼近型、积分型、∑-Δ型、流水线型ADC,详细比较各种算法的优缺点及主要用途;最后结合工艺的发展,展望了ADC的发展趋势和存在困难。并指出在选用ADC时,不仅要考虑应用的精度、速度等主要指标,还要考虑输入信号的形式、输入信号范围、输入通道类型和数量、工作电源等多种具体功能上的差异。 展开更多
关键词 ∑-Δ adc 流水线型adc 逐次逼近型adc 并行比较adc
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八通道1 Gsps数据采集系统设计与测试 被引量:6
6
作者 向海生 赵豫斌 +2 位作者 江晓山 盛华义 赵京伟 《核电子学与探测技术》 CAS CSCD 北大核心 2011年第4期395-398,406,共5页
介绍了一种基于Flash ADC和FPGA(现场可编程门阵列)的八通道1Gsps数据采集系统的设计与测试。重点讨论了系统设计的关键点、难点,包括1GHz时钟信号的产生和扇出,500MHz源同步数据的捕获、处理,高速PCB设计。另外还介绍了系统的测试,描述... 介绍了一种基于Flash ADC和FPGA(现场可编程门阵列)的八通道1Gsps数据采集系统的设计与测试。重点讨论了系统设计的关键点、难点,包括1GHz时钟信号的产生和扇出,500MHz源同步数据的捕获、处理,高速PCB设计。另外还介绍了系统的测试,描述了1GHz时钟信号的测试结果以及系统主要性能的测试结果。 展开更多
关键词 数据采集 flash adc FPGA 测试
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数字滤波器对Flash ADC性能改善的研究 被引量:4
7
作者 敖奇 魏义祥 屈建石 《核电子学与探测技术》 CAS CSCD 北大核心 2009年第3期593-596,共4页
数字多道中连续采样用的Flash ADC一般微分非线性(DNL)较差,且有效位数低于转换位数。由于数字多道系统中通常在AD转换之后再进行数字滤波,因此可通过数字滤波方法来改善ADC的性能影响。文章以梯形成形为例分析了数字滤波器对于系统精度... 数字多道中连续采样用的Flash ADC一般微分非线性(DNL)较差,且有效位数低于转换位数。由于数字多道系统中通常在AD转换之后再进行数字滤波,因此可通过数字滤波方法来改善ADC的性能影响。文章以梯形成形为例分析了数字滤波器对于系统精度及DNL性能的影响,并为改善性能提出了梯形成形参数设计的原则。 展开更多
关键词 数字多道 flash adc 位增益 微分非线性(DNL)
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用于低中频GPS接收机的CMOS闪烁型模数转换器 被引量:4
8
作者 莫太山 马成炎 叶甜春 《微电子学与计算机》 CSCD 北大核心 2008年第2期71-74,79,共5页
模数转换器引入的信噪比的降低会直接影响GPS接收机的灵敏度,需仔细设计以减小信噪比的降低。采用TSMC0.25μm CMOS单层多晶硅五层金属工艺设计了一个用于低中频GPS接收机的CMOS4bit16.368MHz闪烁型模数转换器。实现一个高性能闪烁型模... 模数转换器引入的信噪比的降低会直接影响GPS接收机的灵敏度,需仔细设计以减小信噪比的降低。采用TSMC0.25μm CMOS单层多晶硅五层金属工艺设计了一个用于低中频GPS接收机的CMOS4bit16.368MHz闪烁型模数转换器。实现一个高性能闪烁型模数转换器的关键是得到一个低功耗、低回程噪声、低失调电压的前置放大器和比较器电路,因此重点放在了提出的新的前置放大器和比较器的设计和优化上。在时钟采样率16.368MHz和输入信号频率4.092MHz的条件下,转换器测试得到的信噪失真比为24.7dB,无杂散动态范围为32.1dB,积分非线性为+0.31/-0.46LSB,,差分非线性为+0.66/-0.46LSB,功耗为3.5mW。转换器占用芯片面积0.07mm2。测试结果表明了该模数转换器的有效性,并已成功应用于GPS接收机芯片中。 展开更多
关键词 闪烁型模数转换器 CMOS GPS接收机 低中频
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高速高精度比较器设计 被引量:1
9
作者 孙宇凯 王尧 王梅梅 《智能城市应用》 2022年第1期95-98,共4页
随着通讯、视频、声纳等技术发展的越来越快,超高速模数转换器(ADC)的设计也日益重要。全并行结构(Full Flash)ADC作为首选结构,被应用于超高速中精度ADC。比较器作为Flash ADC中的重要组成部分,其速度、功耗和噪声决定了ADC的速度、精... 随着通讯、视频、声纳等技术发展的越来越快,超高速模数转换器(ADC)的设计也日益重要。全并行结构(Full Flash)ADC作为首选结构,被应用于超高速中精度ADC。比较器作为Flash ADC中的重要组成部分,其速度、功耗和噪声决定了ADC的速度、精度和功耗。文中基于预放大再生锁存理论,基于65nm工艺,设计了一种工作在1GHz时钟周期下的超高速CMOS比较器电路,采用电荷存储失调校准技术使得失调电压15小于5.7mV,并采用可再生latch加速比较器输出电压翻转,可以在一个1GHz时钟周期内完成比较,分辨率在0.3mV左右。 展开更多
关键词 flash adc 比较器 预放大再生锁存
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12 bit 100 MS/s Flash-SAR混合模数转换器设计
10
作者 田芮谦 宋树祥 +3 位作者 赵媛 岑明灿 蔡超波 蒋品群 《无线电工程》 北大核心 2023年第6期1421-1429,共9页
针对传统逐次逼近型模数转换器(Successive Approximation Register Analog-to-Digital Converter,SAR ADC)采样率和能量效率低等问题,设计了一款快闪型(Flash)与逐次逼近型(SAR)相结合的新型混合架构模数转换器。利用快闪型ADC一个时... 针对传统逐次逼近型模数转换器(Successive Approximation Register Analog-to-Digital Converter,SAR ADC)采样率和能量效率低等问题,设计了一款快闪型(Flash)与逐次逼近型(SAR)相结合的新型混合架构模数转换器。利用快闪型ADC一个时钟周期内可以转换出多个数字码的优势,提高了ADC的采样率。采用新型混合开关切换策略与分段电容阵列技术相结合提升了ADC的能量效率,减小了版图面积。同时,电路采用预放大动态锁存比较器以降低噪声和失调对ADC性能的影响。采用SMIC 0.11μm工艺后,仿真结果表明,在1.2 V的工作电压下,当采样速率为100 MS/s,输入信号频率为45.04 MHz时,输出信号的信号噪声失真比(Signal-to-Noise-and-Distortion Radio,SNDR)为69.26 dB,无杂散动态范围(Spurious-free Dynamic Range,SFDR)为82.10 dB,有效位数(Effective Numbers of Bits,ENOB)达到11.21 bit,功耗为5.72 mW,版图尺寸为380μm×110μm。 展开更多
关键词 逐次逼近 快闪型模数转换器 新型混合开关切换策略 预放大动态锁存比较器 异步时序
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用于多丝漂移室读出的扇入延迟前端电子学 被引量:1
11
作者 程文静 张钊 +2 位作者 易晗 吕黎明 肖志刚 《核技术》 CAS CSCD 北大核心 2016年第4期38-44,共7页
多丝漂移室阵列是设计中的低温高密核物质测量谱仪(Cooling storage ring External-target Experiment,CEE)上的前角带电粒子径迹探测器,信号读出的一种备选方案是采用传统前置放大器和采样幅度数字转换器(Analog-to-Digital Converter,... 多丝漂移室阵列是设计中的低温高密核物质测量谱仪(Cooling storage ring External-target Experiment,CEE)上的前角带电粒子径迹探测器,信号读出的一种备选方案是采用传统前置放大器和采样幅度数字转换器(Analog-to-Digital Converter,ADC)来完成信号的放大和获取,该方案结构较简单,成本适中,而且可以处理单根丝上的多重点火信号。为了进一步降低电子学的通道数目,而又不显著影响探测器的性能,研制了一种扇入延迟电路,将漂移室上不同的多根丝信号进行扇入延迟处理,合成为一路信号后再输入到采样ADC的单个通道进行波形采样和数字化。实际的测试结果表明,该电路对信号处理产生的信号能量展宽好于1%,时间晃动好于500 ps,对应的位置分辨好于25?m,满足漂移室径迹探测器阵列对位置分辨小于300?m的要求。 展开更多
关键词 多丝漂移室 flash-adc 扇入延迟 时间分辨 能量分辨
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The Design and Optimization of a Neutron Time-of-Flight Spectrometer with Double Scintillators for Neutron Diagnostics on EAST 被引量:1
12
作者 张兴 袁熙 +3 位作者 谢旭飞 樊铁栓 陈金象 李湘庆 《Plasma Science and Technology》 SCIE EI CAS CSCD 2012年第7期675-682,共8页
Neutron energy spectrometry diagnosis plays an important role in magnetic con- finement fusion. A new neutron time-of-flight (TOF) spectrometer with double scintillators is designed and optimized for the EAST toknma... Neutron energy spectrometry diagnosis plays an important role in magnetic con- finement fusion. A new neutron time-of-flight (TOF) spectrometer with double scintillators is designed and optimized for the EAST toknmak. A set of optimM parameters is obtained by Monte Carlo simulation, based on the GEANT4 and ROOT codes. The electronic setup of the measurement system is designed. The count rate capability is increased by introducing a flash ADC. The designed spectrometer with high resolution and efficiency is capable of being applied to fusion neutron diagnostics. Applications in mixed-energy and continuous energy neutron fields can also be considered. 展开更多
关键词 magnetic confinement fusion neutron diagnostics TOF spectrometer GEANT4 flash adc
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BaF_2闪烁体探测器数字化信号中Ra本底的扣除研究 被引量:1
13
作者 赵健 颜拥军 《南华大学学报(自然科学版)》 2013年第1期22-26,共5页
基于数据采集卡采用全脉冲获取方法对BaF2闪烁体探测器探测α粒子及γ射线的核脉冲波形进行了研究,通过计算全波形的面积提取了核脉冲信号的能量信息,构建了能谱.应用脉冲形状甄别方法对α粒子和γ射线进行了鉴别研究,根据脉冲信号的快... 基于数据采集卡采用全脉冲获取方法对BaF2闪烁体探测器探测α粒子及γ射线的核脉冲波形进行了研究,通过计算全波形的面积提取了核脉冲信号的能量信息,构建了能谱.应用脉冲形状甄别方法对α粒子和γ射线进行了鉴别研究,根据脉冲信号的快/慢成分比的差别清楚地将α粒子从γ射线中鉴别开来.剔除了BaF2闪烁体探测器中固有226Ra及其子体222Rn、218Po、214Po本底的干扰. 展开更多
关键词 BaF2闪烁体 核脉冲甄别 flash adc
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A Histogram-Based Static-Error Correction Technique for Flash ADCs 被引量:1
14
作者 Armin Jalili J Jacob Wikner +1 位作者 Sayed Masoud Sayedi Rasoul Dehghani 《ZTE Communications》 2011年第4期35-41,共7页
High-speed, high-accuracy data converters are attractive for use in most RF applications. Such converters allow direct conversion to occur between the digital baseband and the antenna. However, high speed and high acc... High-speed, high-accuracy data converters are attractive for use in most RF applications. Such converters allow direct conversion to occur between the digital baseband and the antenna. However, high speed and high accuracy make the analog components in a converter more complex, and this complexity causes more power to be dissipated than if a traditional approach were taken. A static calibration technique for flash analog-to-digital converters (ADCs) is discussed in this paper. The calibration is based onhistogram test methods, and equivalent errors in the flash ADC comparators are estimated in the digital domain without any significant changes being made to the ADC comparators. In the trimming process, reference voltages are adjusted to compensate for static errors. Behavioral-level simulations of a moderate-resolution 8-bit flash ADC show that, for typical errors, ADC performance is considerably improved by the proposed technique. As a result of calibration, the differential no.nlinearities (DNLs) are reduced on average from 4 LSB to 0.5 LSB, and the integral nonlinearities (INLs) are reduced on average from 4.2 LSB to 0.35 LSB. Implementation issues for this proposed technique are discussed in our subsequent paper, “A Histogram-Based Static-Error Correction Technique for Flash ADCs: Implementation Aspects. ” 展开更多
关键词 CALIBRATION flash adc OFFSET TRIMMING uniform distribution
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一种基于时间域的4倍插值高能效Flash ADC
15
作者 刘建伟 姜俊逸 +5 位作者 叶雅倩 杨曼琳 王鹏 王育新 付晓君 李儒章 《微电子学》 CAS 北大核心 2022年第4期519-524,共6页
采用65 nm CMOS工艺,基于时间域4倍插值技术,设计了一款6位3.4 GS/s Flash ADC。该插值技术可以将N位Flash ADC的比较器数量从传统的2^(N)-1减少到2^(N-2)。与传统插值技术不同,该技术利用简单的SR锁存器有效地实现了4倍插值因子,而无... 采用65 nm CMOS工艺,基于时间域4倍插值技术,设计了一款6位3.4 GS/s Flash ADC。该插值技术可以将N位Flash ADC的比较器数量从传统的2^(N)-1减少到2^(N-2)。与传统插值技术不同,该技术利用简单的SR锁存器有效地实现了4倍插值因子,而无需额外的时钟和校准硬件开销,在插值阶段只需要校准2^(N-2)个比较器的失调电压。在不同的工艺角、电源电压和温度(PVT)下,SR锁存器中的失调电压不超过±0.5 LSB。该ADC的采样频率达到3.4 GS/s,其在Nyquist输入时的ENOB达到5.4位,在1V电源下消耗12.6 mW的功耗,其Walden FoM值为89 fJ/(conv·step)。 展开更多
关键词 flash adc 时间比较器 4倍时间域内插技术 SR锁存器
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A 500-MS/s, 2.0-mW, 8-Bit Subranging ADC with Time-Domain Quantizer
16
作者 Kenichi Ohhata Kaihei Hotta +4 位作者 Naoto Yamaguchi Daiki Hayakawa Kenji Sewaki Kento Imayanagida Yuuki Sonoda 《Circuits and Systems》 2017年第1期1-13,共13页
This paper describes a novel energy-efficient, high-speed ADC architecture combining a flash ADC and a TDC. A high conversion rate can be obtained owing to the flash coarse ADC, and low-power dissipation can be attain... This paper describes a novel energy-efficient, high-speed ADC architecture combining a flash ADC and a TDC. A high conversion rate can be obtained owing to the flash coarse ADC, and low-power dissipation can be attained using the TDC as a fine ADC. Moreover, a capacitive coupled ramp circuit is proposed to achieve high linearity. A test chip was fabricated using 65-nm digital CMOS technology. The test chip demonstrated a high sampling frequency of 500 MHz and a low-power dissipation of 2.0 mW, resulting in a low FOM of 32 fJ/conversion-step. 展开更多
关键词 Time-Based adc flash adc TDC VTC CMOS
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∑-Δ ADC在软件无线电移动终端中的应用
17
作者 李阳 《无线电工程》 2009年第2期62-64,共3页
模数转换器是基于软件无线电的多模移动终端中的关键器件。∑-Δ模数转换器(∑-ΔADC)是利用∑-Δ调制技术和数字滤波技术实现的一种高精度模数转换器,主要由∑-Δ调制器和数字降采样滤波器构成。简要描述了移动通信信号特征,对闪烁型... 模数转换器是基于软件无线电的多模移动终端中的关键器件。∑-Δ模数转换器(∑-ΔADC)是利用∑-Δ调制技术和数字滤波技术实现的一种高精度模数转换器,主要由∑-Δ调制器和数字降采样滤波器构成。简要描述了移动通信信号特征,对闪烁型模数转换器(Flash-ADC)和∑-Δ模数转换器的性能进行了详细分析与比较,指出∑-Δ模数转换器可以更好地满足多模移动终端中对大动态范围A/D转换的要求。 展开更多
关键词 软件无线电 ∑-Δ adc 闪烁型模数转换器 动态范围
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用于流水线ADC的3位Flash ADC电路
18
作者 何宁业 《黄山学院学报》 2019年第5期13-16,共4页
基于0.18μm CMOS工艺设计了一个适用于流水线ADC,采样速率达250MS/s的3位Flash ADC子级电路。该电路包括参考电压产生电路、比较器阵列电路和编码器电路3个关键模块。利用Hspice软件对Flash ADC子级电路进行仿真,仿真结果证明电路模块... 基于0.18μm CMOS工艺设计了一个适用于流水线ADC,采样速率达250MS/s的3位Flash ADC子级电路。该电路包括参考电压产生电路、比较器阵列电路和编码器电路3个关键模块。利用Hspice软件对Flash ADC子级电路进行仿真,仿真结果证明电路模块工作正常,性能指标满足设计要求。 展开更多
关键词 flashadc 流水线adc 比较器 编码器
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超高速宽带信号取样-滤波数字化机理 被引量:3
19
作者 林茂六 吴芝路 任广辉 《电子测量与仪器学报》 CSCD 1999年第4期1-8,共8页
本文首先分析了取样-保持器和闪烁式ADC用于动态模拟信号数字化时最高频率受限的主要原因。然后重点阐述了近年来在国外出现的超高速宽带信号取样-滤波数字化机理和实现方案,证明了高斯滤波器的一项重要特性。将这种技术用于超高... 本文首先分析了取样-保持器和闪烁式ADC用于动态模拟信号数字化时最高频率受限的主要原因。然后重点阐述了近年来在国外出现的超高速宽带信号取样-滤波数字化机理和实现方案,证明了高斯滤波器的一项重要特性。将这种技术用于超高速交替式(interleaving)数据采集系统中,信号的实时取样速率目前已达10Gsa/S。 展开更多
关键词 取样-滤波 数字变换器 信号处理 数据采集
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5位1.5GHz采样频率的Flash ADC的设计及数字后台校正实现 被引量:2
20
作者 杨阳 赵显利 +1 位作者 仲顺安 李国峰 《北京理工大学学报》 EI CAS CSCD 北大核心 2012年第9期932-936,共5页
基于TSMC 0.18μm工艺设计了一个单通道5位,1.5GHz Flash模数转换器(ADC),该ADC通过改进跟踪保持电路和采用动态比较器结构实现了数据的高速转换.仿真结果表明,当输入信号达到奈奎斯特频率时,信号与噪声加谐波失真比(SNDR)为24.04dB,无... 基于TSMC 0.18μm工艺设计了一个单通道5位,1.5GHz Flash模数转换器(ADC),该ADC通过改进跟踪保持电路和采用动态比较器结构实现了数据的高速转换.仿真结果表明,当输入信号达到奈奎斯特频率时,信号与噪声加谐波失真比(SNDR)为24.04dB,无杂散动态范围(SFDR)为29.97dB.为进一步提高此ADC的性能,消除非线性,基于Volterra级数搭建了数字后台校正模型.对比仿真结果,校正后谐波明显下降,SNDR提高了4.91dB,SFDR提高了6.94dB,有效位数提高了约0.82位. 展开更多
关键词 flash模数转换器 高速转换 VOLTERRA级数 数字后台校正平台
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