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带残余频偏的软扩频信号伪码序列盲估计
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作者 张天骐 张慧芝 +1 位作者 罗庆予 方蓉 《系统工程与电子技术》 EI CSCD 北大核心 2024年第10期3586-3593,共8页
针对带残余频偏的软扩频信号伪码序列盲估计难的问题,提出一种奇异值分解(singular value decomposition,SVD)结合全数字锁相环(digital phase locked loop,DPLL)的方法。所提方法首先对待处理信号通过不重叠分段生成数据矩阵,每段信号... 针对带残余频偏的软扩频信号伪码序列盲估计难的问题,提出一种奇异值分解(singular value decomposition,SVD)结合全数字锁相环(digital phase locked loop,DPLL)的方法。所提方法首先对待处理信号通过不重叠分段生成数据矩阵,每段信号长度为一倍伪码周期;然后利用其自相关矩阵的右上角元素估计失步点进行同步,并且在重新计算自相关矩阵后根据较大特征值个数估计进制数;最后通过多次快速SVD算法结合DPLL最终实现伪码序列的盲估计。仿真结果显示,所提方法在低信噪比条件下可以有效估计出带残余频偏的软扩频信号的伪码序列,并且性能优于其他对比方法。 展开更多
关键词 软扩频信号 盲估计 残余频偏 奇异值分解 全数字锁相环
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数字中频感应加热电源的研究 被引量:5
2
作者 朴兴哲 杨松 薛玉善 《电源学报》 CSCD 2013年第3期77-81,共5页
针对传统模拟中频控制系统的不足,对新型数字中频控制系统进行了研究和设计。提出一种基于DSP DS80C320微控制器为控制核心,主开关元件采用IGBT的数字感应加热系统,设计了系统的主电路、控制电路的结构。针对串联型感应加热电源频率跟... 针对传统模拟中频控制系统的不足,对新型数字中频控制系统进行了研究和设计。提出一种基于DSP DS80C320微控制器为控制核心,主开关元件采用IGBT的数字感应加热系统,设计了系统的主电路、控制电路的结构。针对串联型感应加热电源频率跟踪的要求,阐述了一种新型的数字锁相环(DPLL)控制方法,并对相位补偿与启动问题进行了探讨,最终给出了实验电路和实验结果。实际应用证明具有功率调节范围宽、频率变化小的优点,适用于在中频感应加热中的应用。 展开更多
关键词 感应加热 串联谐振 数字锁相环 相位补偿 功率调节
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基于数字锁相环的星载光谱仪本地时钟源设计 被引量:3
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作者 田禹泽 王煜 +2 位作者 代海山 方华 刘文清 《电子与信息学报》 EI CSCD 北大核心 2017年第10期2397-2403,共7页
该文针对太阳同步轨道卫星由于通讯误码导致卫星时钟不正常翻转造成的错误,提出了纠错策略。基于卫星时钟和本地时钟授时误差互补的特点,设计了一种应用于低频输入信号和大倍频系数条件下的数字锁相环(DPLL),利用数字锁相环使本地时钟... 该文针对太阳同步轨道卫星由于通讯误码导致卫星时钟不正常翻转造成的错误,提出了纠错策略。基于卫星时钟和本地时钟授时误差互补的特点,设计了一种应用于低频输入信号和大倍频系数条件下的数字锁相环(DPLL),利用数字锁相环使本地时钟跟踪卫星时钟秒脉冲的相位波动,实时消除本地时钟的累积误差。对该时钟源进行了理论分析和实验验证,用现场可编程门阵列(FPGA)予以实现。实验表明,该设计实现的时钟源可以实时纠正卫星时钟出现的秒脉冲不正常翻转、秒脉冲丢失、时间包跳变、时间包丢失等错误,最短可以在5个输入时钟周期内进入锁定状态,稳定工作时每秒累积误差小于100μs,可作为星载光谱仪本地时钟源使用。 展开更多
关键词 数字锁相环 反馈控制 比例积分控制 倍频 FPGA
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一种感应加热电源的设计 被引量:2
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作者 祁春清 索迹 《电源技术应用》 2007年第3期14-17,共4页
感应加热电源在金属熔炼、铸造、锻造、透热、淬火、弯管、烧结、表面热处理、铜焊以及晶体生长等行业得到了广泛的应用。同时,由于感应加热电源的加热特点,超音频、大功率是感应加热电源领域研究的重点之一。详细介绍了所设计的感应加... 感应加热电源在金属熔炼、铸造、锻造、透热、淬火、弯管、烧结、表面热处理、铜焊以及晶体生长等行业得到了广泛的应用。同时,由于感应加热电源的加热特点,超音频、大功率是感应加热电源领域研究的重点之一。详细介绍了所设计的感应加热电源,给出了实现的方法和实验电路,并对此方法进行了仿真。实验和仿真结果表明该设计方案具有一定的可行性。 展开更多
关键词 感应加热 串联谐振 数字锁相环
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基于数字锁相环的新型频相检测方法研究 被引量:2
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作者 王勇 廖桂生 王喜媛 《微纳电子技术》 CAS 2008年第1期55-58,共4页
在经典DPLL(数字锁相环)的基础上,提出了一种在中频过采样背景条件下利用过采样值进行相位捕捉和跟踪的新型数字锁相环。该方法利用两级鉴频器实现频率锁定,同时利用高频过采样实现数字锁相,对相位误差一步调整到位而不需连续多次调整... 在经典DPLL(数字锁相环)的基础上,提出了一种在中频过采样背景条件下利用过采样值进行相位捕捉和跟踪的新型数字锁相环。该方法利用两级鉴频器实现频率锁定,同时利用高频过采样实现数字锁相,对相位误差一步调整到位而不需连续多次调整。最后讨论了波形失真和随机抖动的影响;利用相对阈值法使性能得到很大改善。该方法解决了锁定精度和锁定时间不能同时兼顾以及抗干扰能力差等若干问题。 展开更多
关键词 数字锁相环 数字鉴相器 环路滤波器
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小波变换在感应加热电源锁相环中的应用研究 被引量:2
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作者 刘庆丰 王华民 冷朝霞 《电力电子技术》 CSCD 北大核心 2005年第5期73-74,111,共3页
为了解决感应加热电源中频率的正确跟踪问题,在锁相环中引入了小波变换技术,利用小波提取负载电压的基波信号以确定锁相频率。文中对小波函数与信号分解尺度的选择进行了分析。实验结果表明,小波变换技术的运用将有利于感应加热电源安... 为了解决感应加热电源中频率的正确跟踪问题,在锁相环中引入了小波变换技术,利用小波提取负载电压的基波信号以确定锁相频率。文中对小波函数与信号分解尺度的选择进行了分析。实验结果表明,小波变换技术的运用将有利于感应加热电源安全、高效的运行。 展开更多
关键词 感应加热 电源/小波变换 信号分解 数字锁相环
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基于现场可编程逻辑门阵列的超声波管道测厚 被引量:2
7
作者 陈忠元 陈娟 邵芬红 《北京化工大学学报(自然科学版)》 CAS CSCD 北大核心 2012年第4期106-110,共5页
根据超声波基本原理以及现场可编程逻辑门阵列(FPGA)技术设计了超声波测厚仪及超声波轮式探头,并且实现了基于FPGA的信号处理的软件编程。对管径φ139.7mm,标称壁厚h 7.72mm的标准样管的测量实验结果表明:本文所设计的系统可靠性好,抗... 根据超声波基本原理以及现场可编程逻辑门阵列(FPGA)技术设计了超声波测厚仪及超声波轮式探头,并且实现了基于FPGA的信号处理的软件编程。对管径φ139.7mm,标称壁厚h 7.72mm的标准样管的测量实验结果表明:本文所设计的系统可靠性好,抗干扰能力强,测量精度高,测量误差小于0.1 mm。 展开更多
关键词 超声波轮式探头 现场可编程逻辑门阵列 超声波测厚 数字锁相环技术
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一种高性能数字锁相环的研究与设计 被引量:2
8
作者 赵明臣 胡娜娜 《信息通信》 2020年第5期115-117,共3页
锁相环在通信导航领域发挥着至关重要的作用,而由于数字锁相环相比传统模拟锁相环具有设计容易,性能稳定,更好兼容其它数字系统的优势,正获得越来越广泛的关注与研究。文章采用类似双线性变换的方法提出了一种高性能的数字锁相环设计方... 锁相环在通信导航领域发挥着至关重要的作用,而由于数字锁相环相比传统模拟锁相环具有设计容易,性能稳定,更好兼容其它数字系统的优势,正获得越来越广泛的关注与研究。文章采用类似双线性变换的方法提出了一种高性能的数字锁相环设计方案。针对此方案结合各模块的理论模型详细推导了该锁相环的Z域传递函数,并对锁相环的动态跟踪性能和噪声抑制性能进行了重点的仿真分析。仿真结果表明本方案的数字锁相环可以实现高的动态跟踪能力,也能获得良好的噪声抑制水平,可以应用于工程实践。 展开更多
关键词 数字锁相环 动态特性 噪声抑制 等效噪声带宽
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A Digital Phase Locked Loop Speed Control of Three Phase Induction Motor Drive: Performances Analysis
9
作者 Ben Hamed Mouna Sbita Lassaad 《Energy and Power Engineering》 2011年第1期61-68,共8页
This paper deals with performance analysis and implementation of a three phase inverter fed induction motor (IM) drive system. The closed loop control scheme of the drive utilizes the Digital Phase Locked Loop (DPLL).... This paper deals with performance analysis and implementation of a three phase inverter fed induction motor (IM) drive system. The closed loop control scheme of the drive utilizes the Digital Phase Locked Loop (DPLL). The DPLL is safely implemented all around the well known integrated circuit DPLL 4046. An ex-perimental verification is carried out on one kw scalar controlled IM system drives for a wide range of speeds and loads appliance. This presents a simple and high performance solution for industrial applications. 展开更多
关键词 digital phase locked loop (dpll) INDUCTION Motor SCALAR Strategy Speed DRIVES and Load APPLIANCE
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应用于CDR电路的DPLL设计与实现 被引量:1
10
作者 余发强 徐东明 张云军 《科技信息》 2010年第01X期74-75,共2页
数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用,利用DPLL可以从串行位流数据中恢复出接收位同步时钟。时钟数据恢复(CDR)电路是同步光纤系统中的核心部件,性能优越的锁相环电路对CDR电路的实现有着极其... 数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用,利用DPLL可以从串行位流数据中恢复出接收位同步时钟。时钟数据恢复(CDR)电路是同步光纤系统中的核心部件,性能优越的锁相环电路对CDR电路的实现有着极其关键的作用。本文介绍了一种全数字化CDR电路的设计。仿真和实验测试结果表明,该CDR电路可以对相位变化快速同步,尤其对突发数据的时钟恢复,相位抖动的消除有效。 展开更多
关键词 数字锁相环 时钟数据恢复 同步 FPGA
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采用数字锁相的三相四线制有源电力滤波器的设计
11
作者 胡建兵 谢运祥 《低压电器》 2014年第8期48-52,共5页
针对有源电力滤波器(APF)软件锁相程序复杂,同时空间矢量计算程序繁琐、计算量大,介绍了以TMS320C6747为主控芯片、PI控制的35 kVA三相四线制APF。在控制算法中,对数字锁相以及SVPWM控制模块进行了简化处理。给出了系统组成框图以及硬... 针对有源电力滤波器(APF)软件锁相程序复杂,同时空间矢量计算程序繁琐、计算量大,介绍了以TMS320C6747为主控芯片、PI控制的35 kVA三相四线制APF。在控制算法中,对数字锁相以及SVPWM控制模块进行了简化处理。给出了系统组成框图以及硬件参数,建立了系统数学模型,分析了电流解耦控制策略。试验结果表明,算法简化了程序、节省了处理器计算时间,且不会影响装置的谐波补偿效果。试验结果验证了控制算法的正确性。 展开更多
关键词 有源电力滤波器 数字锁相 PI控制 三维空间矢量脉宽调制
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一种大频偏和低信噪比条件下的全数字锁相环设计 被引量:18
12
作者 帅涛 刘会杰 +1 位作者 梁旭文 杨根庆 《电子与信息学报》 EI CSCD 北大核心 2005年第8期1208-1212,共5页
全数字锁相环设计是相干解调全数字接收机载波同步和位同步的关键技术,而大频偏和低信噪比分别从两个方面增加了环路设计的难度。该文在此背景下,以捕获时间和跟踪性能为指标,从模拟环路分析出发,给出一种适用于大频偏和低信噪比条件的... 全数字锁相环设计是相干解调全数字接收机载波同步和位同步的关键技术,而大频偏和低信噪比分别从两个方面增加了环路设计的难度。该文在此背景下,以捕获时间和跟踪性能为指标,从模拟环路分析出发,给出一种适用于大频偏和低信噪比条件的全数字锁相环设计。 展开更多
关键词 数字锁相环 多普勒频偏 低信噪比 同步
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数字锁相环的参数设计及其应用 被引量:10
13
作者 卢屹 张新军 +2 位作者 张嘉俊 罗汉文 宋文涛 《通信技术》 2001年第9期12-14,共3页
数字锁相环路(DPLL)是数字相干解调技术的核心。根据锁相环理论,分析了在最小等效噪声带宽、最小相位均方误差以及最短锁定时间三种意义上的参数优化设计方案,并给出了简明的、具有一定工程指导意义的结果。该结果在应用了Intel公司解... 数字锁相环路(DPLL)是数字相干解调技术的核心。根据锁相环理论,分析了在最小等效噪声带宽、最小相位均方误差以及最短锁定时间三种意义上的参数优化设计方案,并给出了简明的、具有一定工程指导意义的结果。该结果在应用了Intel公司解调芯片STEL-2105的系统中获得了具体应用。 展开更多
关键词 数字锁相环 等效噪声带宽 参数设计
原文传递
高性能同步相量测量装置守时钟研制 被引量:10
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作者 钟山 付家伟 王晓茹 《电力系统自动化》 EI CSCD 北大核心 2006年第1期68-72,97,共6页
同步相量测量装置(PMU)可靠工作的关键是作为同步采样脉冲源的全球定位系统(GPS) 的秒脉冲的可靠性。针对由于气候、故障及其他因素可能造成秒脉冲失效的情况,采用数字锁相环 技术,利用复杂可编程逻辑器件(CPLD)及高精度晶振,研制了一... 同步相量测量装置(PMU)可靠工作的关键是作为同步采样脉冲源的全球定位系统(GPS) 的秒脉冲的可靠性。针对由于气候、故障及其他因素可能造成秒脉冲失效的情况,采用数字锁相环 技术,利用复杂可编程逻辑器件(CPLD)及高精度晶振,研制了一种高性能的PMU守时钟。GPS 信号正常时,守时钟跟踪输入的秒脉冲;秒脉冲失效时,守时钟则提供一定误差范围内与秒脉冲同 步的替代信号。文中分析了其性能,通过仿真和实验进行了验证。 展开更多
关键词 同步相量测量装置 全球定位系统 秒脉冲 复杂可编程逻辑器件 数字锁相环 守时钟
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基于FPGA的高阶全数字锁相环的设计与实现 被引量:9
15
作者 单长虹 王彦 +1 位作者 陈文光 陈忠泽 《电路与系统学报》 CSCD 北大核心 2005年第3期76-79,共4页
提出了一种实现高阶全数字锁相环的新方法。该锁相环以数字比例积分控制取代了传统的一些数字环路滤波控制方法,具有电路结构简单、控制灵活、跟踪精度高、环路性能好和易于集成的特点。文中介绍了该高阶全数字锁相环的系统结构和工作原... 提出了一种实现高阶全数字锁相环的新方法。该锁相环以数字比例积分控制取代了传统的一些数字环路滤波控制方法,具有电路结构简单、控制灵活、跟踪精度高、环路性能好和易于集成的特点。文中介绍了该高阶全数字锁相环的系统结构和工作原理,对其性能进行了理论分析和计算机仿真。应用EDA技术设计了该系统,并用FPGA实现了其硬件电路。仿真和硬件测试结果证实了该设计的正确性。 展开更多
关键词 全数字锁相环 比例积分 EDA 计算机仿真
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全数字化组合式三相逆变器的锁相控制策略 被引量:6
16
作者 刘明先 裴雪军 +1 位作者 侯婷 康勇 《电气传动》 北大核心 2007年第10期39-42,共4页
针对逆变电源的并联冗余系统,分析了逆变电源同步锁相的基本原理,并对其进行了数学建模,分析了数字锁相环的稳定性以及稳态误差;锁相环中对载波周期进行了补偿,提高了锁相精度;最后以TMS320LF2407A为主控制器,数字同步锁相技术在一台10 ... 针对逆变电源的并联冗余系统,分析了逆变电源同步锁相的基本原理,并对其进行了数学建模,分析了数字锁相环的稳定性以及稳态误差;锁相环中对载波周期进行了补偿,提高了锁相精度;最后以TMS320LF2407A为主控制器,数字同步锁相技术在一台10 kV.A的组合式三相逆变器样机上得到了验证。试验结果表明该数字锁相环实现了逆变器输出电压与同步信号的同步。 展开更多
关键词 逆变器 数字锁相环 数学模型 数字信号处理器
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扩频通信同步系统中锁相环的设计 被引量:7
17
作者 杨颖 陈培 +1 位作者 王云 陈杰 《哈尔滨工程大学学报》 EI CAS CSCD 北大核心 2010年第2期243-248,共6页
针对扩频通信系统的载波同步,提出一套完善的数字锁相环设计方案.该方案利用新颖的可控根法完成1~3阶模拟锁相环(APLL)环路参数设计,并实现从模拟域到数字域的转换,得到的数字锁相环(DPLL)的环路参数由单边环路噪声带宽BL和采... 针对扩频通信系统的载波同步,提出一套完善的数字锁相环设计方案.该方案利用新颖的可控根法完成1~3阶模拟锁相环(APLL)环路参数设计,并实现从模拟域到数字域的转换,得到的数字锁相环(DPLL)的环路参数由单边环路噪声带宽BL和采样间隔丁确定.分别对各阶数字锁相环的稳定约束、各种输入条件下的相位误差瞬态响应、稳态相位误差以及存在噪声时环路的跟踪性能进行理论分析,从而得到BL与T的选取原则.实验结果证明了分析的正确性和设计的有效性. 展开更多
关键词 载波同步 数字锁相环 扩频通信系统
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水声信道均衡算法比较研究 被引量:6
18
作者 裴晓黎 宁小玲 +1 位作者 刘忠 张建强 《计算机工程与应用》 CSCD 2014年第1期111-115,共5页
简述了自适应均衡算法和盲均衡算法在水声通信中的应用现状,以及典型的几种均衡算法。分别采用稀疏多径信道和混合相位信道对几种典型的自适应算法和盲均衡算法的均方误差(MSE)性能进行了仿真比较,结果显示,判决反馈均衡器(DFE)结构的... 简述了自适应均衡算法和盲均衡算法在水声通信中的应用现状,以及典型的几种均衡算法。分别采用稀疏多径信道和混合相位信道对几种典型的自适应算法和盲均衡算法的均方误差(MSE)性能进行了仿真比较,结果显示,判决反馈均衡器(DFE)结构的算法在以上复杂水声环境中均衡效果良好;采用稀疏多径相位旋转复信道对典型的自适应、盲均衡算法进行了仿真比较,结果表明,在相同的条件下,自适应算法受相位的影响较小,收敛速度快于盲均衡算法。消声水池实验表明了带二阶数字锁相环(DPLL)和DFE结构的均衡算法均具有较好的载波恢复性能,实现了对相位偏差的跟踪,提高了克服多径效应和多普勒频移补偿的能力。 展开更多
关键词 水声信道 自适应均衡 盲均衡 判决反馈 数字锁相环 digital phase-locked loop(dpll)
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内嵌数字锁相环的自适应空时联合均衡器在水下高速数字通信中的应用研究 被引量:5
19
作者 刘云涛 杨莘元 《哈尔滨工程大学学报》 EI CAS CSCD 北大核心 2005年第5期658-662,共5页
为了克服水下信道严重的时变多途干扰和衰落对水下通信的影响,提高水下通信的作用距离和可靠性,在水下高速数字通信中对内嵌数字锁相环(digital phase-locked loop,DPLL)的自适应空时DFE(判决反馈均衡器)进行了研究和分析,给出了这种自... 为了克服水下信道严重的时变多途干扰和衰落对水下通信的影响,提高水下通信的作用距离和可靠性,在水下高速数字通信中对内嵌数字锁相环(digital phase-locked loop,DPLL)的自适应空时DFE(判决反馈均衡器)进行了研究和分析,给出了这种自适应空时判决反馈均衡器中各种算法和参数条件下的仿真结果.并给出了采用这种自适应空时判决反馈均衡器的水下通信系统的湖水试验结果,结果表明这种均衡器是可行和有效的. 展开更多
关键词 水下通信 空时DFE 自适应均衡 dpll
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数字锁相环的相位噪声分析 被引量:5
20
作者 张占荣 王云飞 +1 位作者 屈美霞 赵丽 《电气传动》 2021年第11期15-19,共5页
随着信息化社会的发展,数字锁相环越发受研发人员的重视。而相位噪声是衡量数字锁相环性能的关键技术,更是研究的重点。介绍数字锁相环的组成结构和工作原理,建立环路各个模块的相位噪声模型,从闪烁噪声和白噪声的特性入手,定性分析相... 随着信息化社会的发展,数字锁相环越发受研发人员的重视。而相位噪声是衡量数字锁相环性能的关键技术,更是研究的重点。介绍数字锁相环的组成结构和工作原理,建立环路各个模块的相位噪声模型,从闪烁噪声和白噪声的特性入手,定性分析相位噪声的影响因素,并针对电荷泵增益和环路滤波器阻抗对锁相环电路相位噪声的影响进行了仿真,进一步验证了分析结果,为设计高性能的数字锁相环提供理论基础。 展开更多
关键词 数字锁相环 相位噪声 振荡器 电荷泵 环路滤波器
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