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DSPs实时视频处理中的Cache优化算法研究
被引量：
2
1
作者
唐文佳
朱光喜
+1 位作者
王曜
刘瑜
《小型微型计算机系统》
CSCD
北大核心
2005年第4期680-683,共4页
在采用并行超长指令字结构的DSP芯片中,CPU处理速度与片外数据存取速度不匹配的问题,导致了CPU处理延时,限制了DSP系统性能的提升.针对这一问题,根据Cache的结构提出一种适宜于在DSPCPU上进行视频数据处理的数据排列新算法,并且将其成...
在采用并行超长指令字结构的DSP芯片中,CPU处理速度与片外数据存取速度不匹配的问题,导致了CPU处理延时,限制了DSP系统性能的提升.针对这一问题,根据Cache的结构提出一种适宜于在DSPCPU上进行视频数据处理的数据排列新算法,并且将其成功地应用到基于TrimediaPNX1301的MPEG4程序优化工作中.系统编码结果表明,该方法有效地减少了Cachemiss及片外数据存取的时间开销,在同等条件下,采用本算法后系统编码性能提高2帧/秒(CIF格式)左右.
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关键词
CACHE优化
数据排列算法
MPEG-4视频编码器
DSPs优化
下载PDF
职称材料
题名
DSPs实时视频处理中的Cache优化算法研究
被引量：
2
1
作者
唐文佳
朱光喜
王曜
刘瑜
机构
华中科技大学电子与信息工程系宽带与多媒体研究中心
出处
《小型微型计算机系统》
CSCD
北大核心
2005年第4期680-683,共4页
基金
国家"八六三"项目(2002AA119010)资助.
文摘
在采用并行超长指令字结构的DSP芯片中,CPU处理速度与片外数据存取速度不匹配的问题,导致了CPU处理延时,限制了DSP系统性能的提升.针对这一问题,根据Cache的结构提出一种适宜于在DSPCPU上进行视频数据处理的数据排列新算法,并且将其成功地应用到基于TrimediaPNX1301的MPEG4程序优化工作中.系统编码结果表明,该方法有效地减少了Cachemiss及片外数据存取的时间开销,在同等条件下,采用本算法后系统编码性能提高2帧/秒(CIF格式)左右.
关键词
CACHE优化
数据排列算法
MPEG-4视频编码器
DSPs优化
Keywords
Cache
optimization
data
-
layout
algorithm
MPEG-4
video
encoder
optimization
based
on
DSPs
分类号
TN911 [电子电信—通信与信息系统]
下载PDF
职称材料
题名
作者
出处
发文年
被引量
操作
1
DSPs实时视频处理中的Cache优化算法研究
唐文佳
朱光喜
王曜
刘瑜
《小型微型计算机系统》
CSCD
北大核心
2005
2
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职称材料
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参考文献
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