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基于FPGA的高速数据采集、缓存与处理系统 被引量:18
1
作者 徐祥 蒋哲 王威廉 《电子测量技术》 2013年第4期68-71,共4页
介绍了一种基于FPGA的高速实时数据采集、缓存与处理系统,该系统采用12bit A/D(AD9224),使用20MSPS采样率进行数据采集,数据采集频率为1M,将采集到的数据送入FPGA进行缓存,并做1 024点的FFT变换。该系统实现了对1M正弦信号的采样、缓存... 介绍了一种基于FPGA的高速实时数据采集、缓存与处理系统,该系统采用12bit A/D(AD9224),使用20MSPS采样率进行数据采集,数据采集频率为1M,将采集到的数据送入FPGA进行缓存,并做1 024点的FFT变换。该系统实现了对1M正弦信号的采样、缓存及FFT变换,通过Signaltap II Logic Analyzer和MATLAB验证了系统结果的正确性。该系统的设计具有很好的实时性、比较高的精度等优点,可以满足高速信号的采集和处理的需要,为从事高速信号采集和处理的相关人员提供了良好的方法和手段。 展开更多
关键词 FPGA AD9224 FFT 缓存 实时性
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Simultaneous Minimization of Capacity and Conflict Misses
2
作者 李致远 《Journal of Computer Science & Technology》 SCIE EI CSCD 2007年第4期497-504,共8页
Loop tiling (or loop blocking) is a well-known loop transformation to improve temporal locality in nested loops which perform matrix computations. When targeting caches that have low associativities, one of the key ... Loop tiling (or loop blocking) is a well-known loop transformation to improve temporal locality in nested loops which perform matrix computations. When targeting caches that have low associativities, one of the key challenges for loop tiling is to simultaneously minimize capacity misses and conflict misses. This paper analyzes the effect of the tile size and the array-dimension size on capacity misses and conflict misses. The analysis supports the approach of combining tile-size selection (to minimize capacity misses) with array padding (to minimize conflict misses). 展开更多
关键词 caches optimizing compilers loop transformation array padding
原文传递
LoColms: an innovative approach of enhancing traditional classroom form of education by promoting web-based distance learning in the poorer countries
3
作者 NGARAMBEDonart 潘云鹤 陈德人 《Journal of Zhejiang University Science》 EI CSCD 2003年第6期630-636,共7页
There have been numerous attempts recently to promote technology based education (Shrestha, 1997) in the poorer third world countries, but so far all these have not provided a sustainable solution as they are either c... There have been numerous attempts recently to promote technology based education (Shrestha, 1997) in the poorer third world countries, but so far all these have not provided a sustainable solution as they are either centered and controlled from abroad and relying solely on foreign donors for their sustenance or they are not web-based, which make distribution problematic, and some are not affordable by most of the local population in these places. In this paper we discuss an application, the Local College Learning Management System (LoColms) , which we are developing, that is both sustainable and economical to suit the situation inthese countries. The application is a web-based system, and aims at improving the traditional form of education by empowering the local universities. Its economicability comes from the fact that it is supported by traditional communication technology, the public switching telephone network system, PSTN, which eliminates the need for packet switched or dedicated private virtual networks (PVN) usually required in similar situations. At a later stage, we shall incorporate ontology and paging tools to improve resource sharability and storage optimization in the Proxy Caches (ProCa) and LoColms servers. The system is based on the client/server paradigm and its infrastructure consists of the PSTN, ProCa, with the learning centers accessing the universities by means of point-to-point protocol (PPP) . 展开更多
关键词 LoColms Web-based distance learning Ontology PAGING PSTN Proxy caches PPP
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Design and Implementation of Not So Cooperative Caching System 被引量:1
4
作者 HU Xiaoyan GONG Jian +2 位作者 CHENG Guang ZHANG Weiwei Ahmad Jakalan 《China Communications》 SCIE CSCD 2015年第7期31-46,共16页
Not So Cooperative Caching(NSCC) considers a network comprised of selfish nodes; each is with caching capability and an objective of reducing its own access cost by fetching data from its local cache or from neighbori... Not So Cooperative Caching(NSCC) considers a network comprised of selfish nodes; each is with caching capability and an objective of reducing its own access cost by fetching data from its local cache or from neighboring caches. These nodes would cooperate in caching and share cached content if and only if they each benefit. The challenges are to determine what objects to cache at each node and to implement the system in the context of Information Centric Networking(ICN). This work includes both a solution for the NSCC problem and a design and implementation of an NSCC system in Named Data Networking(NDN), a large effort that exemplifies ICN. Our design applies NDN synchronization protocol to facilitate the information exchange among nodes, adopts group key encryption to control data access within the NSCC group, and offers an error checker to detect error events in the system. Our approach is validated by deploying the system we developed on Planet Lab. 展开更多
关键词 named data networking content caching selfish caches SYNCHRONIZATION group rekeying error checker game theory
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成都东御街出土汉碑续考——碑石的埋藏层位与“党锢”
5
作者 张勋燎 《南方民族考古》 2014年第1期75-98,共24页
本文在《成都东御街出土汉碑为汉代文翁石室学堂遗存考》一文基础上,就学界关于部分碑文的解读提出不同看法,对李君碑碑主李膺的年龄作了补充考说。重点结合李膺在'党锢'事件中的角色、经历,对两块碑石在地下的特殊层位现象作... 本文在《成都东御街出土汉碑为汉代文翁石室学堂遗存考》一文基础上,就学界关于部分碑文的解读提出不同看法,对李君碑碑主李膺的年龄作了补充考说。重点结合李膺在'党锢'事件中的角色、经历,对两块碑石在地下的特殊层位现象作出诠释,判定属于保护性质的人工窖藏而非自然倒塌后被埋,入土年代不出东汉桓帝延熹九年至灵帝建宁二年(166—169年)的范围。 展开更多
关键词 成都汉碑 窖藏 李膺 党锢
原文传递
基于CPLD的多路全并行连续数据采集技术研究 被引量:18
6
作者 袁亮 古天祥 《电子测量与仪器学报》 CSCD 2006年第1期56-59,共4页
本文介绍了一种多路全并行连续数据采集技术,该技术利用复杂可编程逻辑阵列在时序设计中的灵活性实现多路同步采样数据在单采样周期内的分时存储,并采用硬双缓冲技术实现连续交替存储,使高速数据采集和数据传输同时进行。与通常的分立... 本文介绍了一种多路全并行连续数据采集技术,该技术利用复杂可编程逻辑阵列在时序设计中的灵活性实现多路同步采样数据在单采样周期内的分时存储,并采用硬双缓冲技术实现连续交替存储,使高速数据采集和数据传输同时进行。与通常的分立式设计比较而言,该设计减少了实现的复杂程度并具有更好的稳定性。 展开更多
关键词 采样周期 连续数据采集 硬双缓冲 实时采集
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一种基于源端数据重删的数据备份和恢复系统设计与实现 被引量:14
7
作者 王兴虎 何安元 《南京师大学报(自然科学版)》 CAS CSCD 北大核心 2020年第2期131-139,共9页
针对当前源端数据重删技术中,数据重删效率低、计算指纹耗时长以及频繁操作数据库耗时的问题,设计并实现了一种采用基于源端数据重删技术的数据备份与恢复系统.系统通过在客户端预先将数据流进行分段并采用预处理环形队列进行存储,基于... 针对当前源端数据重删技术中,数据重删效率低、计算指纹耗时长以及频繁操作数据库耗时的问题,设计并实现了一种采用基于源端数据重删技术的数据备份与恢复系统.系统通过在客户端预先将数据流进行分段并采用预处理环形队列进行存储,基于可变分块对数据段进行分块,整个处理过程并发执行,因此该预处理并发计算模块有效缩短了计算时间,而服务端通过用容器存放临近的数据块与索引信息,设计以容器为单位的多级缓存,明显提高缓存命中率.此外,通过使用布隆过滤器与多级缓存减少了数据库的操作频率.仿真实验表明该系统能有效提高数据备份与恢复效率. 展开更多
关键词 源端数据重删 备份与恢复效率 预处理并发计算 多级缓存 数据备份与恢复系统
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凉水保护区松鼠冬季重取食物的贮藏点与越冬生存策略 被引量:9
8
作者 粟海军 马建章 +1 位作者 邹红菲 韦启浪 《兽类学报》 CAS CSCD 北大核心 2006年第3期262-266,共5页
为了解松鼠贮食行为中的重取食物行为特征,以及在冬季不同生存环境条件下,重取贮藏的红松种子的状况,于2004年初冬(11月中旬),仲冬(2005年1月下旬)和晚冬(3月下旬)采用随机抽样法对凉水自然保护区内雪地上的松鼠重取食物后遗留的贮藏点... 为了解松鼠贮食行为中的重取食物行为特征,以及在冬季不同生存环境条件下,重取贮藏的红松种子的状况,于2004年初冬(11月中旬),仲冬(2005年1月下旬)和晚冬(3月下旬)采用随机抽样法对凉水自然保护区内雪地上的松鼠重取食物后遗留的贮藏点(称为重取贮点)进行了调查和分析。结果表明1)冬季不同时期松鼠的重取贮点强度存在明显差异,初冬最大,晚冬次之,仲冬最小,3个时期的样本数据频率分布检验表明其总体皆服从指数分布;2)当场取食的贮藏点占到83%,17%的贮藏点未发现籽壳遗留。受松籽低产量及人为过量收获的影响,单个贮藏点贮藏1粒和2粒种子的占92.9%;3)受气温和雪被厚度因素的影响,3个时期重取贮藏点的口径与深度存在显著差异,一定深度的雪被可能有助于松鼠的重取,但过深的雪被也许会使松鼠无法重取。本研究表明,本地区松鼠在冬季不同时期重取红松种子的强度分配符合将饥饿风险降至最小的觅食经济学原则;松鼠重取行为的优化在贮藏点的被取食状况、口径与深度等特征上得到体现。 展开更多
关键词 贮食 重取 重取贮点 松鼠 凉水自然保护区
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片上多核处理器共享资源分配与调度策略研究综述 被引量:9
9
作者 王磊 刘道福 +2 位作者 陈云霁 陈天石 李玲 《计算机研究与发展》 EI CSCD 北大核心 2013年第10期2212-2227,共16页
对于片上多核处理器,如何在多线程间公平有效地分配调度有限的共享资源是一个很重要的问题.随着处理器核规模的增长,多线程对于系统中有限的共享资源的争夺将愈发激烈,由此导致的对于系统性能的影响也将更加显著.为了缓解乃至解决这一问... 对于片上多核处理器,如何在多线程间公平有效地分配调度有限的共享资源是一个很重要的问题.随着处理器核规模的增长,多线程对于系统中有限的共享资源的争夺将愈发激烈,由此导致的对于系统性能的影响也将更加显著.为了缓解乃至解决这一问题,除了增加可用共享资源外,一个能够公平有效地在多线程间分配共享资源的调度算法也至关重要.在各类共享资源中,对于系统性能有着最大影响的是共享缓存和动态随机存储器(dynamic random-access memory,DRAM)系统.对于共享缓存,可以通过缓存分区来降低由于线程间的争夺所带来的影响;对于DRAM系统,可以采取适当的调度算法来调节各个线程发出的访存请求的服务优先级,从而改善系统性能.首先分别以系统吞吐量和公平性为优化目标介绍了一系列对共享缓存的分区调度算法,并针对缓存分区粒度过大的问题给出了相关解决方案.然后从利用线程的访存行为特征和借鉴网络路由算法等多个角度介绍了DRAM的调度算法.研究了从全局出发的联合调度算法,以解决针对不同共享资源的调度算法间相互矛盾的问题.最后从不同角度对于今后的研究进行了展望. 展开更多
关键词 片上多核处理器 多线程 共享缓存 缓存分区 访存调度
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多核计算机上的快速傅里叶变换并行算法 被引量:8
10
作者 王刚强 钟诚 柯琦 《计算机工程》 CAS CSCD 北大核心 2011年第16期57-59,共3页
针对现有多核结构上快速傅里叶变换(FFT)并行算法没有利用多级缓存和线程级并行等多核特性问题,通过运用多核多级存储特性合理划分数据,采取子序列FFT计算和多线程并行逐对计算FFT相结合的方法,给出一个N点、一维、有序和基数为2的多核... 针对现有多核结构上快速傅里叶变换(FFT)并行算法没有利用多级缓存和线程级并行等多核特性问题,通过运用多核多级存储特性合理划分数据,采取子序列FFT计算和多线程并行逐对计算FFT相结合的方法,给出一个N点、一维、有序和基数为2的多核多线程并行计算FFT非递归算法。理论分析和实验结果表明,该算法实用、高效,能获得较好的加速比和可扩展性。 展开更多
关键词 快速傅里叶变换 多核计算机 线程级并行 多级缓存 非递归
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异构双核的高分辨率折反射全景高速处理系统 被引量:5
11
作者 陈立栋 张茂军 +2 位作者 王炜 包卫东 金晗婧 《电子与信息学报》 EI CSCD 北大核心 2009年第4期822-826,共5页
为了实现对高分辨率折反射全景的快速处理,采用DSP+FPGA异构双核结构、多级乒乓缓存的数据通信机制,基于查找表技术和分块预取策略的全景图像展开算法等,开发了一个可对300万像素折反射全景进行帧速率为12fps的采集、展开并输出的嵌入... 为了实现对高分辨率折反射全景的快速处理,采用DSP+FPGA异构双核结构、多级乒乓缓存的数据通信机制,基于查找表技术和分块预取策略的全景图像展开算法等,开发了一个可对300万像素折反射全景进行帧速率为12fps的采集、展开并输出的嵌入式系统。系统动态可重构、易扩展、计算效率高,可应用于全景视频监控、机器人视觉等领域。 展开更多
关键词 图像处理 异构双核 折反射全景 多级乒乓缓存 全景图像展开 分块预取
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火炮发射高过载信号存储测试系统设计 被引量:6
12
作者 周瑞卿 贾云飞 +1 位作者 潘孝斌 袁景丽 《测控技术》 CSCD 2017年第4期43-47,共5页
针对某高过载弹体无损回收试验系统,研制了一套火炮发射高过载存储测试装置。该装置以STM32为控制核心,实现信号调理、数据存储、串口通信等功能。软件设计上采用一次外触发+多次内触发的方式,有效规避了测试时误触发的现象。该装置将... 针对某高过载弹体无损回收试验系统,研制了一套火炮发射高过载存储测试装置。该装置以STM32为控制核心,实现信号调理、数据存储、串口通信等功能。软件设计上采用一次外触发+多次内触发的方式,有效规避了测试时误触发的现象。该装置将加速度传感器与存储测试电路分离安装,方便传感器的拆卸,可安装于发射弹体的尾部,能够检测并记录弹体发射过程中的加速度数据。试验后回收装置,利用上位机读取检测到的数据并显示波形,可以为之后弹体无损回收的理论分析、参数设置提供重要的实验依据。 展开更多
关键词 存储测试 膛内高过载 IEPE加速度传感器 多次内触发 双缓存
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基于Zynq的SDI视频图像分割系统 被引量:3
13
作者 王炜琛 涂海洋 +1 位作者 王伟明 赵晓博 《计算机工程与科学》 CSCD 北大核心 2021年第10期1796-1802,共7页
为弥补传统视频图像分割器抗干扰能力弱、帧率低、设计复杂等缺点,选取XILINX Zynq XC7Z035 FPGA异构平台,并与SDI技术相融合,采用高清数字串行解码芯片TW6874对4路数字视频图像进行同步采集,输出BT.1120数据至FPGA,以实现4路视频分开... 为弥补传统视频图像分割器抗干扰能力弱、帧率低、设计复杂等缺点,选取XILINX Zynq XC7Z035 FPGA异构平台,并与SDI技术相融合,采用高清数字串行解码芯片TW6874对4路数字视频图像进行同步采集,输出BT.1120数据至FPGA,以实现4路视频分开显示。为满足视频图像的分辨率和帧率要求,首先对视频图像数据进行像素抽样,其次利用AXI4-Stream Data FIFO进行行输入缓存,处理数据灵活,便于拓展,为进一步集成算法提供了基础。AXI4-Stream Data FIFO每行960个数据产生s_axi_s2mm_tlast信号与AXI DMA进行握手,将数据缓存至DDR3 SDRAM中,缓存540行之后进行下一个缓冲区地址的切换,AXI DMA每路视频图像均有3个缓冲区,从而完成三缓存设计,保证视频图像无撕裂现象。最后将缓存数据输出至SMPTE SDI IP核进行显示。实验结果表明:该系统实现了4路SDI视频图像分割,系统资源占用少,且视频图像帧率高,层次明显,无撕裂、无失真现象。 展开更多
关键词 Zynq SDI BT.1120 AXI DMA 行缓存 DDR3 SDRAM 三缓存
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数字注入式红外实时仿真技术研究 被引量:2
14
作者 于洋 高思莉 汤心溢 《半导体光电》 EI CAS CSCD 北大核心 2008年第2期272-275,共4页
介绍了新研制的数字注入式红外成像仿真系统中采用的一些实时仿真技术,主要包括:通过多线程技术实现监听、仿真计算、结果输出等多任务的实时调度;通过光纤反射内存网实现实时通讯;通过乒乓缓存、DirectDraw实现红外图像的实时平滑显示... 介绍了新研制的数字注入式红外成像仿真系统中采用的一些实时仿真技术,主要包括:通过多线程技术实现监听、仿真计算、结果输出等多任务的实时调度;通过光纤反射内存网实现实时通讯;通过乒乓缓存、DirectDraw实现红外图像的实时平滑显示;通过主控猝发DMA传输提高仿真结果输出速度。测试结果显示,上述方法能有效提高仿真实时性。 展开更多
关键词 红外实时仿真 多线程 反射内存 乒乓缓存 DMA
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CPU/GPU系统负载均衡的可分负载调度 被引量:2
15
作者 彭江泉 钟诚 《计算机工程与设计》 CSCD 北大核心 2013年第11期3916-3923,共8页
针对具有多个片上多核处理器CMP和多个GPU的异构系统,综合考虑多核CPU和GPU的不同计算能力、各级缓存不同容量、CPU和GPU之间通信代价以及GPU内部结构等因素,采取计算与通信重叠、对任务自动划分、GPU端线程块大小和维度自动设置、多个... 针对具有多个片上多核处理器CMP和多个GPU的异构系统,综合考虑多核CPU和GPU的不同计算能力、各级缓存不同容量、CPU和GPU之间通信代价以及GPU内部结构等因素,采取计算与通信重叠、对任务自动划分、GPU端线程块大小和维度自动设置、多个异步流同时传输的方法,通过切换线程块执行以隐藏访存开销,提出一种均衡CPU和GPU负载、高效的可分负载多轮调度算法。采用计算密集型任务Mandelbrot进行实验测试,测试结果表明,与已有算法相比,该算法的调度性能有明显提升。 展开更多
关键词 CPU GPU异构系统 可分负载 调度算法 协同计算 负载均衡 多级缓存
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网页快照适用“合理使用”的问题研究 被引量:1
16
作者 张薇子 《南京理工大学学报(社会科学版)》 2018年第6期22-25,共4页
网页快照涉及搜索引擎未许可复制和传播源于其他网站中的作品。在我国立法没有将网页快照列入"限制与例外"的情况下,法院不应一概认定其侵权,而应借鉴开放式的"合理使用"标准,如果网页快照同时满足以下三个条件:构... 网页快照涉及搜索引擎未许可复制和传播源于其他网站中的作品。在我国立法没有将网页快照列入"限制与例外"的情况下,法院不应一概认定其侵权,而应借鉴开放式的"合理使用"标准,如果网页快照同时满足以下三个条件:构成对原作品的转换性使用,没有替代原作品的市场,且在更新方面没有过于滞后,对于该行为可以适用合理使用,认定其合法性。 展开更多
关键词 网页快照 合理使用 转化性使用
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“高分二号”卫星遥感相机图像采集与功能验证系统设计 被引量:1
17
作者 黄伟 姜海滨 +2 位作者 于双江 林悦 陈原 《航天返回与遥感》 北大核心 2015年第4期41-47,共7页
"高分二号"卫星遥感相机是国家高分专项重点项目,其视频电子学设备采用了Gbit高速串行数传接口,同时应用了图像预处理算法,传统的快视设备无法满足其测试要求。文章设计了一种高速图像采集与算法验证系统,以Virtex-5现场可编... "高分二号"卫星遥感相机是国家高分专项重点项目,其视频电子学设备采用了Gbit高速串行数传接口,同时应用了图像预处理算法,传统的快视设备无法满足其测试要求。文章设计了一种高速图像采集与算法验证系统,以Virtex-5现场可编程门阵列为处理核心、Gbit串行/解串芯片为图像输入接口,集成JPEG2000协议芯片、DDR2缓存以及Camera Link图像显示接口。介绍了硬件实现的关键技术,并描述了系统对相机成像功能、高速数传以及图像压缩的验证。该验证系统保障了相机研制,为图像采集和处理提供了参考。 展开更多
关键词 图像采集 串行接口 高速缓存 图像压缩 “高分二号”卫星 航天遥感
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网页快照著作权侵权问题研究
18
作者 杨异 王亚 《齐齐哈尔大学学报(哲学社会科学版)》 2014年第5期59-61,共3页
本文从分析搜索引擎服务商在未经网页著作权人的许可利用网页快照,对网页进行复制、存储、允许网络用户对该复制的快照进行访问的相关行为的定性入手,考察其行为是否构成网页著作权侵权,传统的著作权抗辩事由是否可以继续运用,以及提出... 本文从分析搜索引擎服务商在未经网页著作权人的许可利用网页快照,对网页进行复制、存储、允许网络用户对该复制的快照进行访问的相关行为的定性入手,考察其行为是否构成网页著作权侵权,传统的著作权抗辩事由是否可以继续运用,以及提出网页快照是否侵权不应一概而论,而应借鉴灵活开放的"合理使用"标准确立其存在的合法性的观点。 展开更多
关键词 网页快照 著作权侵权 合理使用 避风港规则
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跨网传输的实时试验指挥显示系统设计
19
作者 王华 张德华 +2 位作者 伍辉华 周勇 施斌 《现代防御技术》 北大核心 2016年第3期78-83,共6页
根据测控任务的特点,设计了一种基于跨网传输的B/S模式的试验信息实时指挥显示系统,详细阐述了基于跨网数据传输的串口通信方法,解决了不同局域网之间数据通信的安全性和可靠性,通过Ajax技术和服务器端两级数据缓存技术应用,减少数据流... 根据测控任务的特点,设计了一种基于跨网传输的B/S模式的试验信息实时指挥显示系统,详细阐述了基于跨网数据传输的串口通信方法,解决了不同局域网之间数据通信的安全性和可靠性,通过Ajax技术和服务器端两级数据缓存技术应用,减少数据流量和服务器负荷,解决了试验任务信息的高实时性、无屏闪、局部刷新的浏览器页面的数据、曲线实时显示等关键技术,并对提出的架构和方法进行了系统验证。 展开更多
关键词 实时显示 串口通信 AJAX技术 数据缓存 B/S模式 无屏闪
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顺序PROLOG机存储组织研究
20
作者 李良良 《国防科技大学学报》 EI CAS CSCD 北大核心 1989年第4期11-18,共8页
YH-SIM是一种正在研制中的顺序PROLOG机。本文介绍该机存储组织的设计考虑。根据PROLOG过程执行的具体特点,文中提出了一种多专用Cache的存储子系统结构,旨在支持深度优先加回溯的顺序PROLOG求解机制。即按照不同的访问方式,设立常规Ca... YH-SIM是一种正在研制中的顺序PROLOG机。本文介绍该机存储组织的设计考虑。根据PROLOG过程执行的具体特点,文中提出了一种多专用Cache的存储子系统结构,旨在支持深度优先加回溯的顺序PROLOG求解机制。即按照不同的访问方式,设立常规Cache和栈式Cache,分别支持存储空间中的随机访问区域和栈式访问区域。作为一个典型的子部分,文中详细讨论了选择点Cache的控制和调度策略。 展开更多
关键词 PROLOG机 存储组织 多重cachE
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