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高速并行数字调制信号的产生与实现
1
作者
李浩
王厚军
+2 位作者
肖磊
王志刚
李涛
《仪器仪表学报》
EI
CAS
CSCD
北大核心
2023年第2期110-118,共9页
数字调制技术是高速通信传输系统的关键技术之一。本文提出了一种全并行的高速数字调制信号产生架构,该架构可以在现场可编程门阵列(FPGA)硬件平台中通过算法级的流水线实现。通过理论分析与推导,并行频域成型滤波器中的DFT/IDFT可以由...
数字调制技术是高速通信传输系统的关键技术之一。本文提出了一种全并行的高速数字调制信号产生架构,该架构可以在现场可编程门阵列(FPGA)硬件平台中通过算法级的流水线实现。通过理论分析与推导,并行频域成型滤波器中的DFT/IDFT可以由低复杂度的两个基-8 FFT算法级联构成,进一步给出了具体的FPGA架构和实现方法。另外,为了进一步降低硬件资源,本文分析并设计了一种适用于并行实现的免混频数字正交上变频架构。仿真实验对高速并行数字调制架构中的并行频域成型滤波器在时域和频域分别进行了算法验证,FPGA硬件实现结果验证了高速并行数字调制信号产生的频谱性能。
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关键词
数字调制
成型滤波
基-
8
fft
FPGA实现
数字正交上变频
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职称材料
题名
高速并行数字调制信号的产生与实现
1
作者
李浩
王厚军
肖磊
王志刚
李涛
机构
电子科技大学自动化工程学院
中国电子科技集团公司航空电子信息系统技术重点实验室
山西省检验检测中心(山西省标准计量技术研究院)
出处
《仪器仪表学报》
EI
CAS
CSCD
北大核心
2023年第2期110-118,共9页
基金
中国博士后面上基金(2021M700707)
四川省自然科学基金(2022NSFSC0905)项目资助
文摘
数字调制技术是高速通信传输系统的关键技术之一。本文提出了一种全并行的高速数字调制信号产生架构,该架构可以在现场可编程门阵列(FPGA)硬件平台中通过算法级的流水线实现。通过理论分析与推导,并行频域成型滤波器中的DFT/IDFT可以由低复杂度的两个基-8 FFT算法级联构成,进一步给出了具体的FPGA架构和实现方法。另外,为了进一步降低硬件资源,本文分析并设计了一种适用于并行实现的免混频数字正交上变频架构。仿真实验对高速并行数字调制架构中的并行频域成型滤波器在时域和频域分别进行了算法验证,FPGA硬件实现结果验证了高速并行数字调制信号产生的频谱性能。
关键词
数字调制
成型滤波
基-
8
fft
FPGA实现
数字正交上变频
Keywords
digital
modulation
forming
filter
based
-
8
fft
FPGA
implementation
digital
orthogonal
up-conversion
分类号
TH85 [机械工程—仪器科学与技术]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
高速并行数字调制信号的产生与实现
李浩
王厚军
肖磊
王志刚
李涛
《仪器仪表学报》
EI
CAS
CSCD
北大核心
2023
0
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职称材料
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