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基于深亚微米工艺长互连线延迟优化的设计方法研究 被引量:1
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作者 李仁发 徐实 +3 位作者 赵振宇 王耀 刘畅 胡逸騉 《湖南大学学报(自然科学版)》 EI CAS CSCD 北大核心 2015年第4期85-92,共8页
随着SoC方法学的使用,集成电路越来越复杂,设计规模越来越大,连线延时已经成为影响时序收敛的关健因素之一.本文提出了一种基于物理设计的长线互连优化方法,即优化关键单元的布局,并选取、增、减repeater来优化时序.本方法根据单元间的... 随着SoC方法学的使用,集成电路越来越复杂,设计规模越来越大,连线延时已经成为影响时序收敛的关健因素之一.本文提出了一种基于物理设计的长线互连优化方法,即优化关键单元的布局,并选取、增、减repeater来优化时序.本方法根据单元间的位置测定单元间距,指导设计中需要插入的repeater位置及数量.长互连延迟的优化效果与所使用的单元、插入单元的间距、选用的线宽等影响因素有密切关系.28nm工艺下,在间距200μm^250μm时插入8倍驱动(×8)规格的反相器(缓冲器)时效果最好.其次,将互连线上的缓冲器换成反相器,互连延迟能降低10%.第三,使用更宽的走线能使长互连线延时再降低20~30ps. 展开更多
关键词 物理设计 预布局 长线优化 EDA 优化时序
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基于拟人策略的带有预放置模块的布局算法 被引量:1
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作者 刘景发 黄文奇 《计算机工程》 EI CAS CSCD 北大核心 2006年第19期26-28,共3页
在超大规模集成电路设计中,一些特别重要的模块,像RAM、ROM和CPU等经常被优先放置,而其它模块则被两两互不重叠地放置在芯片的剩余区域。此类问题能被形式化为带有预放置模块的布局问题,关于此问题的求解方法多为随机优化方法。该文基... 在超大规模集成电路设计中,一些特别重要的模块,像RAM、ROM和CPU等经常被优先放置,而其它模块则被两两互不重叠地放置在芯片的剩余区域。此类问题能被形式化为带有预放置模块的布局问题,关于此问题的求解方法多为随机优化方法。该文基于拟人的思想,提出了占角和最大穴度优先的放置策略,为该问题的快速求解提供了一种高效的启发式确定性算法。算法的高效性通过应用于标准电路MCNC得到了验证。 展开更多
关键词 预放置 拟人策略 占角动作 穴度 布局算法
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试论结构助词“的”和“之”的前置——兼论现代汉语的骈合结构 被引量:12
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作者 张谊生 《汉语学习》 2000年第5期1-7,共7页
本文首先描写两种“的 /之”前置的情况 ,然后从深层和表层、形式和表达、对前置的成因和效用进行分析 ,最后从结构关系的角度探讨与前置有关的骈合结构 。
关键词 前置 隐含 表达功用 骈合结构
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御临河大桥拱箱预制施工技术 被引量:1
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作者 魏安清 《国防交通工程与技术》 2004年第2期42-45,共4页
主要介绍御临河大桥拱桥箱梁预制台座的设计与施工以及拱箱预制的关键技术。实践证明,台座设计合理,拱段预制中几个关键问题处理可行,可为类似工程提供有益的借鉴。
关键词 御临河大桥 钢筋混凝土箱型肋拱桥 台座 箱梁 现场预制 桥梁施工
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