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一款多核处理器FPGA验证平台的设计与实现 被引量:11
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作者 朱英 陈诚 +1 位作者 许晓红 李彦哲 《计算机研究与发展》 EI CSCD 北大核心 2014年第6期1295-1303,共9页
高性能处理器设计日趋复杂,为了缩短验证周期,降低研制风险通常需要在流片之前进行基于现场可编程门阵列(field programmable gate-array,FPGA)原型验证平台的软硬件协同验证.随着处理器多核化的发展,FPGA原型验证平台的实现变得越来越... 高性能处理器设计日趋复杂,为了缩短验证周期,降低研制风险通常需要在流片之前进行基于现场可编程门阵列(field programmable gate-array,FPGA)原型验证平台的软硬件协同验证.随着处理器多核化的发展,FPGA原型验证平台的实现变得越来越具有挑战性.介绍了一款高性能多核微处理器FPGA验证平台的设计与实现方法,详细阐述了该FPGA验证平台采用的母板/子板总体架构、分片策略、时分复用实现技术及I/O接口实现方法.该平台具有良好的可扩展性,能够方便灵活地实现目标芯片在各种规模和配置下的FPGA验证,用于在流片前对目标芯片进行功能正确性验证和性能评估.经过该FPGA平台验证的目标芯片,首次流片返回的芯片能成功运行操作系统和各种应用程序,实现了一次流片成功的目标.最后对该FPGA验证平台的应用前景进行了分析总结. 展开更多
关键词 fpga原型验证 fpga分片 时分复用传输 延迟调节 性能评测
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FPGA课程创新型实验教学体系的实践 被引量:9
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作者 王墨林 戚昊琛 +1 位作者 鲁迎春 刘士兴 《实验科学与技术》 2018年第4期134-139,147,共7页
具有创新能力的实验教学体系对于培养高素质的创新人才具有非常重要的作用。根据电子科学与技术专业创新型教学体系特点,该文以FPGA课程为例,着重介绍FPGA课程创新型实验教学体系研究的背景、实验教学体系的实践以及实验教学体系的评价... 具有创新能力的实验教学体系对于培养高素质的创新人才具有非常重要的作用。根据电子科学与技术专业创新型教学体系特点,该文以FPGA课程为例,着重介绍FPGA课程创新型实验教学体系研究的背景、实验教学体系的实践以及实验教学体系的评价方式。实践表明,创新型实验教学体系能够进一步增强学生参与科研与创新活动的兴趣,在广度与深度上拓展学生的知识应用能力与工程实验能力。 展开更多
关键词 fpga课程 创新型 实验教学体系 评价方式
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海底管道缺陷漏磁检测器数据采集系统研发 被引量:9
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作者 刘群 黄松岭 +1 位作者 赵伟 陈俊杰 《中国测试》 CAS 北大核心 2015年第1期89-92,共4页
针对海底管道内可利用空间小、运行工况恶劣的实际情况,研发一款海底管道缺陷漏磁检测器数据采集系统。该系统选用ARM实现对各功能单元的控制,并以FPGA结合A/D采样芯片进行多路漏磁检测信号的并行采集;通过对各功能单元的一体化和集成设... 针对海底管道内可利用空间小、运行工况恶劣的实际情况,研发一款海底管道缺陷漏磁检测器数据采集系统。该系统选用ARM实现对各功能单元的控制,并以FPGA结合A/D采样芯片进行多路漏磁检测信号的并行采集;通过对各功能单元的一体化和集成设计,在确保能准确有效采集和存储缺陷漏磁信号数据的前提下,实现系统结构的整合及简化。牵拉试验和检测工程应用结果表明:该数据采集系统运行稳定,采集、处理缺陷漏磁检测数据质量高,达到设计要求,完全满足海底油气管道缺陷漏磁检测工程应用的技术要求。 展开更多
关键词 无损评估 漏磁检测 海底管道 fpga 数据采集
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实现软硬件解耦合的类脑计算硬件设计方法 被引量:3
4
作者 渠鹏 陈嘉杰 +1 位作者 张悠慧 郑纬民 《计算机研究与发展》 EI CSCD 北大核心 2021年第6期1146-1154,共9页
类脑计算是一个涉及到多领域、多学科的新兴领域,对计算神经科学、人工智能和新型体系结构设计都具有重要的支持和启发意义.但是类脑计算系统领域发展所面临的重要问题之一是软硬件紧耦合.近期的一项研究提出了神经形态完备性的概念,为... 类脑计算是一个涉及到多领域、多学科的新兴领域,对计算神经科学、人工智能和新型体系结构设计都具有重要的支持和启发意义.但是类脑计算系统领域发展所面临的重要问题之一是软硬件紧耦合.近期的一项研究提出了神经形态完备性的概念,为实现类脑计算系统领域的软硬件解耦合提供了理论支持,并作为样例研究提出了对应的系统层次结构设计.作为这一工作的后续,首先对神经形态完备性和类脑计算层次结构中部分关键的概念进行了阐述与讨论,之后进一步提出了在这一概念和体系结构设计下,实现支持软硬件解耦合的类脑计算硬件设计方法的构想,即由执行原语集合设计以及硬件实现方法设计组成的迭代调整的设计流程.最后,展示了正在进行的基于FPGA的相应评估平台工作.这一硬件设计方法有助于实现神经形态完备的高效原语集合和芯片设计,从而有利于实现类脑计算系统领域的软硬件解耦合. 展开更多
关键词 类脑计算 完备性 软硬件解耦合 fpga 性能评估
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FPGA结构设计方法及EDA工具 被引量:3
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作者 张峰 李艳 +2 位作者 陈亮 李明 于芳 《微电子学与计算机》 CSCD 北大核心 2013年第5期14-18,22,共6页
针对当前FPGA结构设计方法灵活度低、容易出错、自动化程度不够高的现状,提出一种FPGA结构设计方法.根据这种方法实现了EDA工具VA.VA使用GUI编辑结构描述文件,具有使用结构描述文件自动生成FP-GA详细结构的功能,并通过在GUI中局部调整F... 针对当前FPGA结构设计方法灵活度低、容易出错、自动化程度不够高的现状,提出一种FPGA结构设计方法.根据这种方法实现了EDA工具VA.VA使用GUI编辑结构描述文件,具有使用结构描述文件自动生成FP-GA详细结构的功能,并通过在GUI中局部调整FPGA结构来实现设计异质型布线结构的功能.VA将FPGA结构设计和结构评估功能集成在一起,提供了全自动的评估流程.借助VA,成功设计出一款自主研发的FPGA芯片VS1000,设计过程和结果证明了VA的高效性和正确性. 展开更多
关键词 现场可编程门阵列 结构 用户图形界面 设计 评估
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星载SRAM型FPGA可靠性快速评估技术 被引量:1
6
作者 赵磊 王祖林 +1 位作者 周丽娜 杨蓝 《北京航空航天大学学报》 EI CAS CSCD 北大核心 2013年第7期863-868,共6页
空间辐射环境严重影响星载SRAM(Static Random Access Memory)型FPGA(Field Programmable Gate Array)的可靠性,提出了星载SRAM型FPGA可靠性快速验证评估方法.在传统故障注入验证的基础上,引入可靠性预评估技术,在逻辑门级分析单粒子翻... 空间辐射环境严重影响星载SRAM(Static Random Access Memory)型FPGA(Field Programmable Gate Array)的可靠性,提出了星载SRAM型FPGA可靠性快速验证评估方法.在传统故障注入验证的基础上,引入可靠性预评估技术,在逻辑门级分析单粒子翻转对FPGA配置信息位的影响,同时对TMR(Triple Modular Redundancy)冗余方式进行单粒子翻转关键位置评估.然后构成不同敏感级别的故障序列,最后根据应用需求选择不同故障序列进行故障注入从而有效快速评估系统可靠性.该方法与逐位翻转相比,能够在保证故障覆盖率的同时,有效地减少实验时间,提高实验效率. 展开更多
关键词 星载fpga 故障注入 单粒子翻转 可靠性评估
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基于DWT的加速图像压缩算法研究进展 被引量:1
7
作者 王玲 杨晓 《现代计算机》 2018年第4期40-43,共4页
现代医学技术快速发展的趋势下,医学图像在临床医学诊断和治疗中发挥的作用越来越显著。传统软件实现图像压缩已无法满足智慧医疗的发展要求,结合FPGA从工程的角度实现高效医学图像压缩逐渐成为国内外研究热点。通过对小波变换和硬件发... 现代医学技术快速发展的趋势下,医学图像在临床医学诊断和治疗中发挥的作用越来越显著。传统软件实现图像压缩已无法满足智慧医疗的发展要求,结合FPGA从工程的角度实现高效医学图像压缩逐渐成为国内外研究热点。通过对小波变换和硬件发展进行归纳,总结小波变换在FPGA上的实现方案,对医学图像压缩的发展趋势提供实践意义。 展开更多
关键词 小波变换 fpga 医学图像
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自适应滤波器在机载武器测试系统中的应用
8
作者 范惠林 侯满义 +1 位作者 薛珊 徐洪吉 《应用光学》 CAS CSCD 北大核心 2009年第5期772-776,共5页
针对飞机机载武器设备特点和测试维修要求,在分析了自适应滤波器的结构、最优评估等特性基础上,根据现场可编程门阵列(FPGA)的设计过程,构建了基于最小均方误差(LM S)算法的横向自适应滤波器。仿真结果和使用表明:设计实现的自适应滤波... 针对飞机机载武器设备特点和测试维修要求,在分析了自适应滤波器的结构、最优评估等特性基础上,根据现场可编程门阵列(FPGA)的设计过程,构建了基于最小均方误差(LM S)算法的横向自适应滤波器。仿真结果和使用表明:设计实现的自适应滤波器,在FPGA中开辟512 kB的随机存储器(RAM)存储空间,能够实现权值系数向量的自动调节,且适应信号变化的特性,滤波后的信号测试误差不大于5%,且LM S算法在0.1 m s内可收敛到最优,满足数据处理的实时性和机载武器系统测试的要求。 展开更多
关键词 自适应滤波器 最优评估 自适应算法 fpga 武器系统测试
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Comparative Performance Evaluation of Large FPGAs with CNFET-and CMOS-based Switches in Nanoscale
9
作者 Mohammad Hossein Moaiyeri Ali Jahanian Keivan Navi 《Nano-Micro Letters》 SCIE EI CAS 2011年第3期178-188,共11页
Routing resources are the major bottlenecks in improving the performance and power consumption of the current FPGAs. Recently reported researches have shown that carbon nanotube field effect transistors(CNFETs) have c... Routing resources are the major bottlenecks in improving the performance and power consumption of the current FPGAs. Recently reported researches have shown that carbon nanotube field effect transistors(CNFETs) have considerable potentials for improving the delay and power consumption of the modern FPGAs. In this paper, hybrid CNFET-CMOS architecture is presented for FPGAs and then this architecture is evaluated to be used in modern FPGAs. In addition, we have designed and parameterized the CNFET-based FPGA switches and calibrated them for being utilized in FPGAs at 45 nm, 22 nm and 16 nm technology nodes.Simulation results show that the CNFET-based FPGA switches improve the current FPGAs in terms of performance, power consumption and immunity to process and temperature variations. Simulation results and analyses also demonstrate that the performance of the FPGAs is improved about 30%, on average and the average and leakage power consumptions are reduced more than 6% and 98% respectively when the CNFET switches are used instead of MOSFET FPGA switches. Moreover, this technique leads to more than 20.31%smaller area. It is worth mentioning that the advantages of CNFET-based FPGAs are more considerable when the size of FPGAs grows and also when the technology node becomes smaller. 展开更多
关键词 Carbon nanotube field effect transistor(CNFET) fpga switches Performance evaluation Power consumption Process variation
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FPGA评估系统
10
作者 陈苑锋 唐璞山 +1 位作者 来金梅 童家榕 《复旦学报(自然科学版)》 CAS CSCD 北大核心 2006年第4期523-528,共6页
介绍了自主开发的FPGA结构评估系统.该系统采用与结构无关的算法,对各种工业及学术上的FPGA结构进行抽象建模,并给出功耗、面积及时延的评估报告.采用该系统,能够对现有的FPGA结构进行分析,最终提出结构的改进方向.
关键词 现场可编程门阵列器件评估 结构评估 通用现场可编程门阵列软件
原文传递
片上eDRAM性能评价函数簇研究
11
作者 易立华 邹雪城 刘振林 《微计算机信息》 北大核心 2008年第5期97-98,2,共3页
本论文针对基于eDRAM的SOC中存储系统的性能评估问题、设计问题和可复用的eDRAM的集成技术问题进行研究,提出了一种定量的存储系统性能评估的建模方法。建立基于eDRAM存储系统评价函数簇模型,包括L(访问延迟)函数,P(功耗)函数,A(面积)... 本论文针对基于eDRAM的SOC中存储系统的性能评估问题、设计问题和可复用的eDRAM的集成技术问题进行研究,提出了一种定量的存储系统性能评估的建模方法。建立基于eDRAM存储系统评价函数簇模型,包括L(访问延迟)函数,P(功耗)函数,A(面积)函数和Y(良率)函数。利用此模型在已知系统性能要求的情况下,可以求出满足系统性能要求的最佳的参数值,或是多种满足条件的备选方案,为在SOC中使用eDRAM时优化存储器配置和存储系统设计提供理论依据。 展开更多
关键词 嵌入式DRAM 评价 fpga 函数簇
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可配置片上网络性能评估平台
12
作者 赵超平 王亚刚 +1 位作者 杜慧敏 赵萍 《现代电子技术》 2012年第8期160-164,共5页
为了弥补目前单纯采用软件或者硬件构建NoC验证平台的一些缺陷,采用软硬件结合的设计方法实现了NoC的FPGA验证与性能评估平台。利用该平台在Xilinx Virtex 6FPGA上对基于虚通道路由器的片上网络进行了验证。实验证明该验证平台功能完善... 为了弥补目前单纯采用软件或者硬件构建NoC验证平台的一些缺陷,采用软硬件结合的设计方法实现了NoC的FPGA验证与性能评估平台。利用该平台在Xilinx Virtex 6FPGA上对基于虚通道路由器的片上网络进行了验证。实验证明该验证平台功能完善,占用硬件资源少,综合时钟频率高,评估NoC系统的效率非常高。 展开更多
关键词 片上网络 验证平台 性能评估 fpga
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基于FPGA的红外镜头自动聚焦技术研究与实现
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作者 孙少伟 杨粤涛 +2 位作者 杨炳伟 万安军 钟海林 《红外技术》 CSCD 北大核心 2021年第5期464-472,共9页
自动聚焦技术在红外热像仪监控领域有着非常重要的作用。目前业内红外自动聚焦技术存在聚焦成功率低、架构复杂、聚焦速度慢等状况,为此提出了一种基于FPGA的红外镜头自动聚焦技术,采用单FPGA实现了红外图像处理显示和自动聚焦的功能。... 自动聚焦技术在红外热像仪监控领域有着非常重要的作用。目前业内红外自动聚焦技术存在聚焦成功率低、架构复杂、聚焦速度慢等状况,为此提出了一种基于FPGA的红外镜头自动聚焦技术,采用单FPGA实现了红外图像处理显示和自动聚焦的功能。鉴于红外图像普遍存在竖条纹噪声和随机噪声等特点,本文在实现聚焦过程中对红外清晰度评价算法和爬山算法做了改进和优化。实验结果表明本文提出的算法和实现方式能够很好地实现红外镜头的自动聚焦,同时具备集成度高、聚焦速度快、成功率高等特点,有比较广泛的应用前景。 展开更多
关键词 红外 自动聚焦 fpga 清晰度评价 爬山算法
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一种可重构算子阵列结构的功耗评估方法
14
作者 雍珊珊 王新安 +1 位作者 谢峥 曹颖 《微电子学》 CAS CSCD 北大核心 2015年第2期153-156,163,共5页
介绍了一种面向新型FPGA结构—可重构算子阵列的功耗评估方法。分析了可重构算子阵列结构的功耗构成,同现有的功耗评估方法进行对比,提出基于最大功耗的评估策略。可重构算子和互连单元采用自动测试矢量生成(ATPG)方法计算最大功耗,互... 介绍了一种面向新型FPGA结构—可重构算子阵列的功耗评估方法。分析了可重构算子阵列结构的功耗构成,同现有的功耗评估方法进行对比,提出基于最大功耗的评估策略。可重构算子和互连单元采用自动测试矢量生成(ATPG)方法计算最大功耗,互连线段的功耗则通过RC等效模型得到。将所有被使用的资源功耗相加,得到该设计所对应的最大功耗值,作为结构探索和在实际应用中阵列规模选取、布局布线优化的指导。 展开更多
关键词 功耗评估 可重构算子阵列 自动测试矢量生成 fpga
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FPGA功率估计
15
作者 曾浩 刘玲 《电子测量技术》 2005年第3期4-5,共2页
文章介绍FPGA的功率估计方法,同时分析功率估计对于电路的电源设计和PCB计的影响,提出减少功率消耗的方法。
关键词 功率估计 fpga 电源设计 同时分析 功率消耗
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高性能网包分类理论与算法综述 被引量:26
16
作者 亓亚烜 李军 《计算机学报》 EI CSCD 北大核心 2013年第2期408-421,共14页
随着IP网络架构的不断演进以及网络业务和安全需求的不断增长,高性能网包分类在下一代交换机、路由器、防火墙等网络基础设备中有着越来越广的应用.网包分类算法作为高性能网包分类的核心技术,具有重要的研究价值和实践意义.文中从理论... 随着IP网络架构的不断演进以及网络业务和安全需求的不断增长,高性能网包分类在下一代交换机、路由器、防火墙等网络基础设备中有着越来越广的应用.网包分类算法作为高性能网包分类的核心技术,具有重要的研究价值和实践意义.文中从理论分析和算法设计两方面介绍了高性能网包分类的最新研究成果.在理论分析层面,依据计算几何理论对网包分类问题的数学解法及复杂度进行了归纳,总结了网包分类算法的理论依据及性能评价方法.在算法设计层面,对具有影响力的网包分类算法按照不同的研究方向进行了归类和介绍,并结合自身研究成果对不同类别的算法设计思路行了深入分析.作者在多核网络处理器平台以及FPGA平台上实现了几类具有代表性的网包分类算法,并通过真实的网络流量测试比较了不同类型算法在不同系统平台上的实际性能.最后,作者总结并展望了高性能网包分类的下一步发展方向. 展开更多
关键词 网包分类 计算几何 算法 评测 多核 fpga
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基于FPGA的3.125Gbits串行通道设计实验 被引量:5
17
作者 邓焰 戎蒙恬 《电子工程师》 2004年第11期16-18,共3页
本设计实验是为了验证如何用现场可编程门阵列 (FPGA)实现 3.12 5Gbit s的串行通道设计。设计中使用了Xilinx公司的Aurora链路层协议 ,以及Virtex ⅡPro器件中内置的 3.12 5Gbit s高速串行收发器。文中描述该设计所涉及的主要实现方法 ... 本设计实验是为了验证如何用现场可编程门阵列 (FPGA)实现 3.12 5Gbit s的串行通道设计。设计中使用了Xilinx公司的Aurora链路层协议 ,以及Virtex ⅡPro器件中内置的 3.12 5Gbit s高速串行收发器。文中描述该设计所涉及的主要实现方法 ,包括Aurora协议接口设计、特殊的片上时钟电路设计、片上存储器设计以及芯片引脚和布局设计等。 展开更多
关键词 fpga MGT AURORA 串行通道 Virtex-Ⅱ Pro评估板
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一种基于FPGA的图像清晰度算法研究
18
作者 段哲一 李天冉 +2 位作者 李守业 杨志荣 胡茂海 《集成电路与嵌入式系统》 2024年第4期51-56,共6页
为了能够对视频图像进行实时清晰度评价,基于Xilinx A-7型号FPGA芯片设计且实现了一种新的图像清晰度算法。首先,采用状态机设计OTSU算法计算图像的自适应阈值以分离边缘,然后应用并行处理和流水线实现改进的4方向Tenengrad梯度函数计... 为了能够对视频图像进行实时清晰度评价,基于Xilinx A-7型号FPGA芯片设计且实现了一种新的图像清晰度算法。首先,采用状态机设计OTSU算法计算图像的自适应阈值以分离边缘,然后应用并行处理和流水线实现改进的4方向Tenengrad梯度函数计算清晰度。实验结果表明,该设计可以在约66 ms内对640×480@30 fps格式视频图像清晰度进行评价,具有一定的灵敏度。 展开更多
关键词 实时图像清晰度评价 fpga OTSU xc7A35TFTG256
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基于SoC-FPGA的RISC-V处理器软硬件系统级平台 被引量:2
19
作者 齐乐 常轶松 +4 位作者 陈欲晓 张旭 陈明宇 包云岗 张科 《计算机研究与发展》 EI CSCD 北大核心 2023年第6期1204-1215,共12页
构建软硬件系统级原型平台是处理器设计硅前测试中必不可少的环节.为适应基于开放指令集RISC-V的开源处理器设计需求,简化现有基于FPGA的处理器系统级原型平台构建方法,提出了一套基于SoC-FPGA的处理器敏捷软硬件原型平台,以实现目标软... 构建软硬件系统级原型平台是处理器设计硅前测试中必不可少的环节.为适应基于开放指令集RISC-V的开源处理器设计需求,简化现有基于FPGA的处理器系统级原型平台构建方法,提出了一套基于SoC-FPGA的处理器敏捷软硬件原型平台,以实现目标软硬件设计的快速部署与系统级原型高效评测.针对上述目标,发掘紧耦合SoC-FPGA器件的潜力,构建了一套RISC-V软核与ARM硬核(SoC侧)之间的信息交互机制.通过共享内存和虚拟核间中断等方法,可使目标RISC-V处理器灵活使用平台丰富的I/O外设资源,并充分利用硬核ARM处理器算力协同运行复杂软件系统.此外,为提升软硬件系统级平台的敏捷性,构建了灵活可配置的云上自动化开发框架.通过对平台上目标RISC-V软核处理器各方面的分析评估,验证了该平台可有效缩短系统级测试的迭代周期,提升RISC-V处理器软硬件原型评测效率. 展开更多
关键词 硅前系统级平台 软硬件全系统评估 RISC-V指令集处理器 SoC-fpga
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FPGA实际可用性评估与发展趋势分析 被引量:6
20
作者 俞吉波 孔雪 +2 位作者 郑哲 祝永新 付宇卓 《计算机工程》 CAS CSCD 北大核心 2011年第13期282-284,共3页
根据现场可编程门阵列(FPGA)的发展现状,对FPGA器件的实际可用性进行评估,从可重构逻辑的利用、CPU软核/硬核的选择、内部块缓存的利用、输入/输出资源的利用、数字信号处理器固核的利用及时钟频率的可用范围进行研究,并给出FPGA的发展... 根据现场可编程门阵列(FPGA)的发展现状,对FPGA器件的实际可用性进行评估,从可重构逻辑的利用、CPU软核/硬核的选择、内部块缓存的利用、输入/输出资源的利用、数字信号处理器固核的利用及时钟频率的可用范围进行研究,并给出FPGA的发展趋势。理论分析证明,Slice的利用率不宜高于85%,应选择有良好工具支持的软硬核厂商,并且所有的I/O信号须经过寄存器处理。 展开更多
关键词 现场可编程门阵列 可用性评估 可重构逻辑 CPU软核 硬核 DSP固核
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