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支持多从机全双工通信的IP核互联模型
被引量：
2
1
作者
石敏
莫锦辉
易清明
《航天控制》
CSCD
北大核心
2018年第4期82-88,共7页
针对CPU、SPI与UART之间数据传输效率低和CPU指令执行效率低的问题,提出一种支持数据并行处理的IP核互联模型。通过设计AXI4主机转接口和扩展3条ARMv4自定义指令实现CPU与AXI4总线的互联;并设计AXI4从机转接口,克服APB转换桥的不足,使A...
针对CPU、SPI与UART之间数据传输效率低和CPU指令执行效率低的问题,提出一种支持数据并行处理的IP核互联模型。通过设计AXI4主机转接口和扩展3条ARMv4自定义指令实现CPU与AXI4总线的互联;并设计AXI4从机转接口,克服APB转换桥的不足,使AXI4总线可与多个从机同时进行支持流水线操作的全双工通信。整个设计采用Verilog进行结构级描述并通过了Modelsim仿真。实验结果表明,本文设计的模型与目前市面上的AXI4互联模型相比,具有很高的带宽和数据传输效率;CPU执行所有测试指令只需要36个时钟周期,在数据传输完毕之前有156个空闲时钟周期,从而具有很高的指令执行效率。
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关键词
传输效率
执行效率
互联模型
axi
4
协议
ARMv
4
指令
转换接口
全双工
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职称材料
题名
支持多从机全双工通信的IP核互联模型
被引量：
2
1
作者
石敏
莫锦辉
易清明
机构
暨南大学信息科学与技术学院
出处
《航天控制》
CSCD
北大核心
2018年第4期82-88,共7页
基金
广州市科技计划项目(201604016085)
广东省科技计划项目(2015B090910001)
暨南大学科技重点平台建设专项GPS/北斗多模卫星导航关键技术研究及应用
文摘
针对CPU、SPI与UART之间数据传输效率低和CPU指令执行效率低的问题,提出一种支持数据并行处理的IP核互联模型。通过设计AXI4主机转接口和扩展3条ARMv4自定义指令实现CPU与AXI4总线的互联;并设计AXI4从机转接口,克服APB转换桥的不足,使AXI4总线可与多个从机同时进行支持流水线操作的全双工通信。整个设计采用Verilog进行结构级描述并通过了Modelsim仿真。实验结果表明,本文设计的模型与目前市面上的AXI4互联模型相比,具有很高的带宽和数据传输效率;CPU执行所有测试指令只需要36个时钟周期,在数据传输完毕之前有156个空闲时钟周期,从而具有很高的指令执行效率。
关键词
传输效率
执行效率
互联模型
axi
4
协议
ARMv
4
指令
转换接口
全双工
Keywords
Transfer efficiency
Execution efficiency
Interconnection model
axi
4
protocol
ARMv
4
instruction
Conversion interface
Full duplex
分类号
TP336 [自动化与计算机技术—计算机系统结构]
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题名
作者
出处
发文年
被引量
操作
1
支持多从机全双工通信的IP核互联模型
石敏
莫锦辉
易清明
《航天控制》
CSCD
北大核心
2018
2
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