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一种8 Gsps模数转换器中的8B10B编码电路设计
被引量：
6
1
作者
张博
陶晓旭
刘宇
《西安邮电大学学报》
2019年第5期47-52,共6页
根据JESD204B协议,设计了一种应用于8 Gsps 12 bit模数转换器(analog-to-digital,ADC)接口电路中的8B10B编码器。该编码器采用双字节并行实现方案将系统时钟由500 MHz降低至250 MHz,通过添加1 bit均衡指示位,使得极性信息先于编码结果产...
根据JESD204B协议,设计了一种应用于8 Gsps 12 bit模数转换器(analog-to-digital,ADC)接口电路中的8B10B编码器。该编码器采用双字节并行实现方案将系统时钟由500 MHz降低至250 MHz,通过添加1 bit均衡指示位,使得极性信息先于编码结果产生,减少了极性计算与传递引起的延迟;使用负极性编码,减小对查找表资源的使用。实验结果表明,该编码器能够支持12.9 Gbps的最大通道传输速率,相比级联型编码器和单字节编码器数据传输速率更高。所设计的编码器能够满足8 Gsps 12 bit模数转换器的应用需求。
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关键词
JESD204B协议
8
gsps
模数转换器
8
B10B编码器
并行字节
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职称材料
题名
一种8 Gsps模数转换器中的8B10B编码电路设计
被引量：
6
1
作者
张博
陶晓旭
刘宇
机构
西安邮电大学电子工程学院
出处
《西安邮电大学学报》
2019年第5期47-52,共6页
基金
陕西省技术创新引导专项基金资助项目(2017ZKC02-56)
西安市集成电路重大专项项目(201809174CY3JC)
文摘
根据JESD204B协议,设计了一种应用于8 Gsps 12 bit模数转换器(analog-to-digital,ADC)接口电路中的8B10B编码器。该编码器采用双字节并行实现方案将系统时钟由500 MHz降低至250 MHz,通过添加1 bit均衡指示位,使得极性信息先于编码结果产生,减少了极性计算与传递引起的延迟;使用负极性编码,减小对查找表资源的使用。实验结果表明,该编码器能够支持12.9 Gbps的最大通道传输速率,相比级联型编码器和单字节编码器数据传输速率更高。所设计的编码器能够满足8 Gsps 12 bit模数转换器的应用需求。
关键词
JESD204B协议
8
gsps
模数转换器
8
B10B编码器
并行字节
Keywords
JESD204B
protocol
8
gsps
analog to digital converter
8
B10B
encoder
parallel
byte
分类号
TN762 [电子电信—电路与系统]
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题名
作者
出处
发文年
被引量
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1
一种8 Gsps模数转换器中的8B10B编码电路设计
张博
陶晓旭
刘宇
《西安邮电大学学报》
2019
6
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