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多电源域高速IO的片上模块化ESD防护器件 被引量：2
1
作者 孙康明 李婷 孟丽娅 《河南理工大学学报（自然科学版）》 CAS 北大核心 2019年第3期117-122,共6页
提出一种新颖的片上静电泄放(ESD)防护器件,该器件由N阱/P阱二极管、基于high-K金属栅CMOS工艺形成的二极管、寄生的晶闸管(SCR)和内嵌的电源钳位电路等几部分构成,具有多条ESD通路,能实现对单个IO管脚的PS-Mode、NS-Mode、PD-Mode、ND-... 提出一种新颖的片上静电泄放(ESD)防护器件,该器件由N阱/P阱二极管、基于high-K金属栅CMOS工艺形成的二极管、寄生的晶闸管(SCR)和内嵌的电源钳位电路等几部分构成,具有多条ESD通路,能实现对单个IO管脚的PS-Mode、NS-Mode、PD-Mode、ND-Mode及DSMode共5种ESD应力模式的保护。本文分析了high-K工艺下各种SCR模块的结构和工作机制,通过合理配置这些SCR,该器件的一些关键ESD参数如触发电压、保持电压等能根据具体需要而调整,以满足片上系统(SoC)的多电源域的应用情况,利用传输线脉冲(TLP)、快速TLP和C-V等方式全方位验证了该器件的性能。结果表明,紧凑的结构、较少的互连线、较低的寄生电容、快速的响应能力使设计的器件适合高速IO接口电路的ESD防护。 展开更多
关键词 ESD防护 模块化 单片集成 多电源域 高速io
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一种6.25Gb/s带预加重结构的低压差分发送器
2
作者 陈浩 黄鲁 张步青 《微电子学》 CAS CSCD 北大核心 2016年第1期67-70,共4页
采用SMIC 40nm CMOS工艺,设计了一种带预加重结构的低压差分(LVDS)发送器。低压差分驱动器采用双运放反馈控制电路,可稳定输出信号的摆幅。采用边沿检测电流注入的预加重电路,对输出进行高频预加重,克服了数据高速传输中高频信号的损失... 采用SMIC 40nm CMOS工艺,设计了一种带预加重结构的低压差分(LVDS)发送器。低压差分驱动器采用双运放反馈控制电路,可稳定输出信号的摆幅。采用边沿检测电流注入的预加重电路,对输出进行高频预加重,克服了数据高速传输中高频信号的损失。该发送器的速率为6.25Gb/s,输出差分信号摆幅为300mV,预加重比例为3.5dB,功耗为7.1mW。该低压差分发送器可应用于高速IO物理层电路中。 展开更多
关键词 并串转换 预加重 低压差分发送器 高速io
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基于可扩展性标记语言的校验及修正系统
3
作者 周昊 黄炜果 +4 位作者 刘洋 刘俊勇 沈晓东 田昊 朱鑫 《计算机应用研究》 CSCD 北大核心 2016年第5期1424-1427,共4页
用电信息采集系统建设是一项复杂的系统工程,其中极为重要的一个前提是拥有规范化与标准化的智能用电信息模型,以实现信息在多种系统及平台中进行无缝互动。目前用电信息标准化模型研究方面,由于不同机构不同厂商在对模型标准化理解上... 用电信息采集系统建设是一项复杂的系统工程,其中极为重要的一个前提是拥有规范化与标准化的智能用电信息模型,以实现信息在多种系统及平台中进行无缝互动。目前用电信息标准化模型研究方面,由于不同机构不同厂商在对模型标准化理解上的不同,不同系统中对信息的描述产生了异构,严重阻碍了系统间信息数据无缝交流的能力,违背了用电信息标准化模型的设计初衷。为改变标准化模型应用现状,提出了一种基于可扩展性标记语言校验方式的智能用电信息校验系统,并设计了逻辑算法,以实现对不同模型的转换、信息的校验及信息的智能纠错等深层次功能。实验结果证明,本系统具有良好的数据适应性与工作能力。 展开更多
关键词 用电信息模型 互操作 模型转换 智能纠错 高速io
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基于软件无线电的民用机场航空器噪声监测硬件平台设计 被引量：2
4
作者 魏麟 李忠良 +1 位作者 王冲 刘晔璐 《电子技术（上海）》 2016年第9期83-85,82,共4页
民用航空器噪声是民用机场噪声的主要因素。针对民用机场航空器噪声的特点,提出了一种具体实现民用机场航空器噪声信号监测及处理中心的硬件平台架构。通过使用高速大容量FPGA可编程逻辑器件、Power PC嵌入式处理器、PCI-e和SRIO(Rapid ... 民用航空器噪声是民用机场噪声的主要因素。针对民用机场航空器噪声的特点,提出了一种具体实现民用机场航空器噪声信号监测及处理中心的硬件平台架构。通过使用高速大容量FPGA可编程逻辑器件、Power PC嵌入式处理器、PCI-e和SRIO(Rapid IO)高速IO技术,构建了基于软件无线电技术的硬件平台,实现了监测平台的较高实时处理能力和高度可重构性。 展开更多
关键词 航空器噪声 软件无线电 高速io技术 硬件平台
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28nm工艺基于T＿Coil结构的带ESD防护器件的高速IO设计 被引量：1
5
作者 张博翰 陈建军 +3 位作者 梁斌 罗园 黄俊 朱小娜 《计算机与数字工程》 2019年第11期2661-2666,2807,共7页
高速串行接口芯片是通信领域的核心芯片,也是云计算的核心互联芯片,高速串行接口芯片的IO在实现高速率的同时如何保证其军品ESD指标是关键难点之一。传统的设计方法,在保证ESD防护能力的前提下,高速IO设计往往无法达到预期的带宽。针对... 高速串行接口芯片是通信领域的核心芯片,也是云计算的核心互联芯片,高速串行接口芯片的IO在实现高速率的同时如何保证其军品ESD指标是关键难点之一。传统的设计方法,在保证ESD防护能力的前提下,高速IO设计往往无法达到预期的带宽。针对传统设计方法存在的缺点,采用基于T_Coil结构的带ESD防护器件的高速IO电路结构。然后,完成28nm工艺下基于T_Coil结构的带ESD防护器件的高速IO设计,采用反向二极管技术设计ESD防护器件,使用CadenceVirtuoso软件完成其电路设计和版图设计。最后,基于仿真工具给出了功能性能仿真结果和带寄生参数的仿真结果,并与传统技术进行对比,设计实现了16Gbps的速率。 展开更多
关键词 28nm工艺 高速io设计 ESD T_Coil结构
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RapidIO链的设计方案和应用 被引量：1
6
作者 黄先春 黄登山 骆艳卜 《计算机工程与应用》 CSCD 北大核心 2009年第32期63-64,89,共3页
串行RapidIO支持两种工作方式:Message和DirectIO方式。DirectIO方式使用简单,但是它在连续传输多包的情况下,CPU需要等待LSU寄存器空闲。为了解决该问题,提出了RapidIO链的传输新方案,即用EDMA通道代替CPU配置SRIO的LSU寄存器。实验表... 串行RapidIO支持两种工作方式:Message和DirectIO方式。DirectIO方式使用简单,但是它在连续传输多包的情况下,CPU需要等待LSU寄存器空闲。为了解决该问题,提出了RapidIO链的传输新方案,即用EDMA通道代替CPU配置SRIO的LSU寄存器。实验表明该方案能有效地降低CPU负荷。 展开更多
关键词 高速串行io 口(SRio) 增强型内存直接存取(EDMA) CPU负荷
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