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Viterbi译码器的FPGA实现技术研究 被引量:1
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作者 孙晓岩 付永庆 张文鑫 《应用科技》 CAS 2003年第5期11-13,共3页
提出了一种实现高速并行Viterbi译码器的结构 ,并且将SMDO法[1] 用于幸存路径存储和输出模块部分 .本设计已基于FPGA得以实现 ,获得了译码速度快。
关键词 VITERBI译码 FPGA 译码速度 路径度量存储模块
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一种基于对称性的双向双二进制卷积Turbo码译码结构研究 被引量:3
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作者 詹明 周亮 《电子与信息学报》 EI CSCD 北大核心 2012年第5期1179-1184,共6页
该文提出了一种基于对称性的双向并行译码方案,用于提高802.16 m标准中双二进制卷积Turbo码(DBCTC)的译码速度。定义了分支度量矩阵以降低译码计算复杂度,定义了前向、后向因子矩阵,推导了前、后向度量递归计算中的对称性,并将其应用于... 该文提出了一种基于对称性的双向并行译码方案,用于提高802.16 m标准中双二进制卷积Turbo码(DBCTC)的译码速度。定义了分支度量矩阵以降低译码计算复杂度,定义了前向、后向因子矩阵,推导了前、后向度量递归计算中的对称性,并将其应用于前向、后向度量及后验概率对数似然比的双向并行计算中。构造了采用该方案的DB CTC译码器结构图,详细分析了迭代过程。以计算复杂度,存储空间,译码速度为指标考察了方案的性能,并给出了译码性能仿真曲线。分析表明,该双向并行的译码方法较常规方法提高了一倍的译码速度,而没有增加计算复杂度和存储空间。 展开更多
关键词 双二进制卷积Turbo码 最大后验概率算法 对称性 计算复杂度 译码速度
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基于信道辨识的自适应Turbo-OFDM系统性能研究 被引量:1
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作者 姚如贵 王永生 徐娟 《西北工业大学学报》 EI CAS CSCD 北大核心 2006年第5期590-594,共5页
研究了信噪比对系统性能影响的规律,将信噪比分布分为高信噪比区、中信噪比区和低信噪比区3个区域。当部分平均信噪比分别取3个区域典型值时,引入迭代增益,判断典型信道状态对应的最佳迭代次数。将数据子信道对应的接收信噪比进行排序,... 研究了信噪比对系统性能影响的规律,将信噪比分布分为高信噪比区、中信噪比区和低信噪比区3个区域。当部分平均信噪比分别取3个区域典型值时,引入迭代增益,判断典型信道状态对应的最佳迭代次数。将数据子信道对应的接收信噪比进行排序,计算部分平均信噪比,利用其进行聚类分析,对当前信道进行辨识,在不同的信道状态下,自适应选择迭代译码次数。仿真结果说明,在平坦慢衰落信道下,采用OFDM系统中基于信道辨识的自适应Turbo码译码算法,可以兼顾系统性能和译码速度,得到较低的平均误比特率和较高的平均译码速度。 展开更多
关键词 OFDM TURBO码 译码速度 信道辨识 误比特率
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BEC上基于内插算法的多元SC-LDPC码BP译码波速度分析
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作者 许梦楠 吴雅婷 +1 位作者 施文明 张钟浩 《电讯技术》 北大核心 2022年第10期1498-1505,共8页
针对多元空间耦合低密度奇偶校验(Spatially-Coupled Low-Density Parity-Check,SC-LDPC)码在二进制擦除信道(Binary Erasure Channel,BEC)上置信传播(Belief Propagation,BP)译码的译码波速度分析复杂度较高的问题,提出了内插密度演进(... 针对多元空间耦合低密度奇偶校验(Spatially-Coupled Low-Density Parity-Check,SC-LDPC)码在二进制擦除信道(Binary Erasure Channel,BEC)上置信传播(Belief Propagation,BP)译码的译码波速度分析复杂度较高的问题,提出了内插密度演进(Density Evolution,DE)算法。内插DE算法利用一维函数在非耦合DE递归式的不动点间插值密度来近似表示轮廓译码(Decoding Profile,DP),避免了高维耦合DE递归式的迭代,从而降低了计算复杂度。仿真和分析结果表明,在相同的度分布和信道条件下,内插DE算法计算的译码波速度与传统的耦合DE算法计算的译码波速度误差在[0,0.05],特别在信道删除概率为耦合DE算法的BP阈值时,两者测得速度相等;由内插DE算法计算所得的BP阈值与耦合DE算法的BP阈值相等。 展开更多
关键词 空间耦合低密度奇偶校验码 置信传播译码速度 密度演进 计算复杂度
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