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CMOS毫米波低相噪级联双锁相环频率综合器设计
被引量:
1
1
作者
尹时威
张长春
+1 位作者
唐路
袁珩洲
《微电子学》
CAS
北大核心
2023年第4期588-594,共7页
采用65 nm CMOS工艺,设计了一种低相噪级联双锁相环毫米波频率综合器。该频率综合器采用两级锁相环级联的结构,减轻了单级毫米波频率综合器带内和带外相位噪声受带宽的影响。时间数字转换器采用游标卡尺型结构,改善了PVT变化下时间数字...
采用65 nm CMOS工艺,设计了一种低相噪级联双锁相环毫米波频率综合器。该频率综合器采用两级锁相环级联的结构,减轻了单级毫米波频率综合器带内和带外相位噪声受带宽的影响。时间数字转换器采用游标卡尺型结构,改善了PVT变化下时间数字转换器的量化线性度。数字环路滤波器采用自动环路增益控制技术来自适应调节环路带宽,以提高频率综合器的性能。振荡器采用噪声循环技术,减小了注入到谐振腔的噪声,进而改善了振荡器的相位噪声。后仿真结果表明,在1.2 V电源电压下,该频率综合器可输出的频率范围为22~26 GHz,在输出频率为24 GHz时,相位噪声为-104.8 dBc/Hz@1 MHz,功耗为46.8 mW。
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关键词
全数字
锁相环
噪声循
环
振荡器
亚采样
锁相环
级联
锁相环
相位噪声
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职称材料
一种基于VDFLL和CaKFPLL的INS/GNSS超紧耦合方法
被引量:
2
2
作者
李传军
李兴城
《中国惯性技术学报》
EI
CSCD
北大核心
2013年第6期769-774,共6页
为了提高复杂电磁环境下的GNSS抗干扰能力,针对低成本制导武器的导航需求特点,提出了一种基于矢量延迟锁定环和锁频环并级联卡尔曼滤波锁相环的INS/GNSS超紧耦合的改进算法。分析了INS辅助矢量跟踪结构,给出了基于鉴别器的低复杂度基带...
为了提高复杂电磁环境下的GNSS抗干扰能力,针对低成本制导武器的导航需求特点,提出了一种基于矢量延迟锁定环和锁频环并级联卡尔曼滤波锁相环的INS/GNSS超紧耦合的改进算法。分析了INS辅助矢量跟踪结构,给出了基于鉴别器的低复杂度基带预处理滤波器和基于EKF锁相环滤波器的详细设计方法。此外,设计了干扰环境下的高动态飞行轨迹,用于验证INS/GNSS超紧耦合算法,动态仿真试验结果表明,在干扰环境下INS/GNSS超紧耦合系统的导航能力相对于独立式高动态跟踪技术的接收机有明显优势,跟踪GPS L1 C/A情况下,可容忍干信比为48.6 dB,比独立式接收机的干扰抑制能力提高了约12 dB。
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关键词
高动态接收机
超紧耦合
矢量延迟锁定
环
和锁频
环
级联
锁相环
数控振荡器
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职称材料
一种高性能小数级联型锁相环电路
3
作者
滕海林
孟煦
王晓蕾
《微电子学》
CAS
北大核心
2022年第6期967-973,共7页
提出了一种低抖动、高频率分辨率、快速锁定的小数级联型锁相环。采用倍乘型延迟锁定环和基于和差调制器(DSM)的相位选择器实现小数倍频,并通过级联一个高带宽的整数型锁相环抬升频率且实现对DSM量化噪声的进一步滤除。基于TSMC 65 nm C...
提出了一种低抖动、高频率分辨率、快速锁定的小数级联型锁相环。采用倍乘型延迟锁定环和基于和差调制器(DSM)的相位选择器实现小数倍频,并通过级联一个高带宽的整数型锁相环抬升频率且实现对DSM量化噪声的进一步滤除。基于TSMC 65 nm CMOS工艺,面积为0.27 mm^(2),输出频率为1.064~1.936 GHz。通过电路仿真输入100 MHz参考频率,PLL的1.872 GHz输出频率在300 ns以内完成锁定,1.2 V电源电压下整体功耗为8.6 mW。此时频率分辨率约1 kHz,1 kHz~100 MHz的积分范围内均方根抖动为1.32 ps。
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关键词
级联
型
锁相环
低抖动
高频率分辨率
快速锁定
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职称材料
题名
CMOS毫米波低相噪级联双锁相环频率综合器设计
被引量:
1
1
作者
尹时威
张长春
唐路
袁珩洲
机构
南京邮电大学集成电路科学与工程学院
东南大学毫米波国家重点实验室
国防科技大学计算机学院
出处
《微电子学》
CAS
北大核心
2023年第4期588-594,共7页
基金
国家自然科学基金(62174090,62104257)
并行与分布处理国防科技重点实验室基金(WDZC20215250110)
+1 种基金
国防科技大学学校预研项目(ZK21-34)
毫米波国家重点实验室开放课题(K202325)
文摘
采用65 nm CMOS工艺,设计了一种低相噪级联双锁相环毫米波频率综合器。该频率综合器采用两级锁相环级联的结构,减轻了单级毫米波频率综合器带内和带外相位噪声受带宽的影响。时间数字转换器采用游标卡尺型结构,改善了PVT变化下时间数字转换器的量化线性度。数字环路滤波器采用自动环路增益控制技术来自适应调节环路带宽,以提高频率综合器的性能。振荡器采用噪声循环技术,减小了注入到谐振腔的噪声,进而改善了振荡器的相位噪声。后仿真结果表明,在1.2 V电源电压下,该频率综合器可输出的频率范围为22~26 GHz,在输出频率为24 GHz时,相位噪声为-104.8 dBc/Hz@1 MHz,功耗为46.8 mW。
关键词
全数字
锁相环
噪声循
环
振荡器
亚采样
锁相环
级联
锁相环
相位噪声
Keywords
all-digital phase-locked loop
noise circulating oscillator
sub-sampling phase-locked loop
cascaded phase-locked loop
phase noise
分类号
TN432 [电子电信—微电子学与固体电子学]
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职称材料
题名
一种基于VDFLL和CaKFPLL的INS/GNSS超紧耦合方法
被引量:
2
2
作者
李传军
李兴城
机构
北京理工大学宇航学院飞行器动力学与控制教育部重点实验室
出处
《中国惯性技术学报》
EI
CSCD
北大核心
2013年第6期769-774,共6页
基金
总装预先研究基金(9140A090307)
北京理工大学科技创新计划(2010CX01003)
文摘
为了提高复杂电磁环境下的GNSS抗干扰能力,针对低成本制导武器的导航需求特点,提出了一种基于矢量延迟锁定环和锁频环并级联卡尔曼滤波锁相环的INS/GNSS超紧耦合的改进算法。分析了INS辅助矢量跟踪结构,给出了基于鉴别器的低复杂度基带预处理滤波器和基于EKF锁相环滤波器的详细设计方法。此外,设计了干扰环境下的高动态飞行轨迹,用于验证INS/GNSS超紧耦合算法,动态仿真试验结果表明,在干扰环境下INS/GNSS超紧耦合系统的导航能力相对于独立式高动态跟踪技术的接收机有明显优势,跟踪GPS L1 C/A情况下,可容忍干信比为48.6 dB,比独立式接收机的干扰抑制能力提高了约12 dB。
关键词
高动态接收机
超紧耦合
矢量延迟锁定
环
和锁频
环
级联
锁相环
数控振荡器
Keywords
Algorithms
Computer simulation
Locks (fasteners)
Phase locked loops
Signal receivers
Vectors
分类号
V249.3 [航空宇航科学与技术—飞行器设计]
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职称材料
题名
一种高性能小数级联型锁相环电路
3
作者
滕海林
孟煦
王晓蕾
机构
合肥工业大学微电子设计研究所
出处
《微电子学》
CAS
北大核心
2022年第6期967-973,共7页
基金
国家自然科学基金资助项目(61704043)
文摘
提出了一种低抖动、高频率分辨率、快速锁定的小数级联型锁相环。采用倍乘型延迟锁定环和基于和差调制器(DSM)的相位选择器实现小数倍频,并通过级联一个高带宽的整数型锁相环抬升频率且实现对DSM量化噪声的进一步滤除。基于TSMC 65 nm CMOS工艺,面积为0.27 mm^(2),输出频率为1.064~1.936 GHz。通过电路仿真输入100 MHz参考频率,PLL的1.872 GHz输出频率在300 ns以内完成锁定,1.2 V电源电压下整体功耗为8.6 mW。此时频率分辨率约1 kHz,1 kHz~100 MHz的积分范围内均方根抖动为1.32 ps。
关键词
级联
型
锁相环
低抖动
高频率分辨率
快速锁定
Keywords
cascaded PLL
low jitter
fine frequency resolution
fast-locking
分类号
TN432 [电子电信—微电子学与固体电子学]
下载PDF
职称材料
题名
作者
出处
发文年
被引量
操作
1
CMOS毫米波低相噪级联双锁相环频率综合器设计
尹时威
张长春
唐路
袁珩洲
《微电子学》
CAS
北大核心
2023
1
下载PDF
职称材料
2
一种基于VDFLL和CaKFPLL的INS/GNSS超紧耦合方法
李传军
李兴城
《中国惯性技术学报》
EI
CSCD
北大核心
2013
2
下载PDF
职称材料
3
一种高性能小数级联型锁相环电路
滕海林
孟煦
王晓蕾
《微电子学》
CAS
北大核心
2022
0
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职称材料
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