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FPGA设计中关键问题的研究 被引量：23
1
作者 李刚强 田斌 易克初 《电子技术应用》 北大核心 2003年第6期68-71,共4页
介绍了FPGA的一般设计流程;指出了FPGA设计中的几个重点、难点问题,主要包括时钟设计、延时设计和同步设计中遇到的问题以及电路中毛刺信号的产生机理和消除;结合作者的经验和体会,分析了问题产生的原因并给出解决方案和相关设计技巧。
关键词 FPGA 数字电路 时钟设计 同步设计 延时设计 毛刺消除 毛刺消除
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3GSps超高速ADC系统设计解决方案 被引量：6
2
作者 Paul McCormack 《电子设计技术 EDN CHINA》 2007年第6期168-168,170,171,共3页
包含千兆采样率ADC的系统设计会遇到许多复杂情况。面临的主要挑战包括时钟驱动、模拟输入级和高速数字接口。本文探讨了如何才能克服这些挑战,并给出了在千兆赫兹的速度下进行系统优化的方法。在讨论中．时钟设计、差分输入驱动器的设... 包含千兆采样率ADC的系统设计会遇到许多复杂情况。面临的主要挑战包括时钟驱动、模拟输入级和高速数字接口。本文探讨了如何才能克服这些挑战,并给出了在千兆赫兹的速度下进行系统优化的方法。在讨论中．时钟设计、差分输入驱动器的设计、数字接口和布局考虑都是十分复杂的问题。本文中的参考设计将采用ADC083000／B3000。 展开更多
关键词 ADC系统 时钟设计 超高速 高速数字接口 复杂情况 时钟驱动 差分输入 参考设计
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FPGA设计中时钟设计的探讨 被引量：6
3
作者 段有为 《无线电工程》 2007年第5期62-64,共3页
在FPGA设计过程中,稳定可靠的时钟是系统稳定可靠的重要条件。探讨了FPGA设计过程中5个不同的时钟设计方案,对这些不同方案的优点、缺点和在设计中需要注意的问题进行了分析,并提出了一些合理建议。有利于FPGA设计人员在较短的时间内掌... 在FPGA设计过程中,稳定可靠的时钟是系统稳定可靠的重要条件。探讨了FPGA设计过程中5个不同的时钟设计方案,对这些不同方案的优点、缺点和在设计中需要注意的问题进行了分析,并提出了一些合理建议。有利于FPGA设计人员在较短的时间内掌握FPGA时钟设计技术。 展开更多
关键词 FPGA 时钟设计 逻辑 触发器
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锁相环在处理器时钟设计中的应用 被引量：4
4
作者 杨丰林 沈绪榜 《微电子学与计算机》 CSCD 北大核心 2002年第6期32-38,共7页
文章先讲述了锁相环的基本原理以及相关的数学基础,接着介绍了经典锁相环在高性能处理器时钟产生中的应用,并对模拟压控振荡器的类型以及噪声类型及其抑制两方面作了小结,随后介绍了新发展的全数字锁相环在时钟产生中的应用,最后总结全... 文章先讲述了锁相环的基本原理以及相关的数学基础,接着介绍了经典锁相环在高性能处理器时钟产生中的应用,并对模拟压控振荡器的类型以及噪声类型及其抑制两方面作了小结,随后介绍了新发展的全数字锁相环在时钟产生中的应用,最后总结全文并对两种锁相结构性能特征以及锁相技术发展趋势作了介绍。 展开更多
关键词 锁相环 处理器 时钟设计 时钟产生 频率合成 相位同步 噪声抑制
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基于嵌入式平台ESP32的MicroPython程序的开发与应用 被引量：6
5
作者 王雪 《电子测试》 2020年第15期89-90,68,共3页
本文介绍了嵌入式平台中MicroPython语言的开发与应用,旨在有效提高了嵌入式系统的开发效率。文章首先指出了目前Python语言的发展情况,指出了Python在硬件操作方面存在的短板,并指出了MicroPython在这方面所具备的功能和特点。最后,利... 本文介绍了嵌入式平台中MicroPython语言的开发与应用,旨在有效提高了嵌入式系统的开发效率。文章首先指出了目前Python语言的发展情况,指出了Python在硬件操作方面存在的短板,并指出了MicroPython在这方面所具备的功能和特点。最后,利用一个时钟显示程序,展示了MicroPython的良好特性和实用性。 展开更多
关键词 嵌入式 ESP32 MicroPython 时钟设计
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MSP430x4xx系列微控制器的独特时钟设计 被引量：2
6
作者 赵陆文 屈德新 《国外电子元器件》 2003年第4期7-10,共4页
MSP430x4xx系列微控制器采用了FLL +时钟设计 ,具有功耗极低以及处理能力强、运行速度快的特点。文中首先分析了系统的时钟与功耗之间的关系 ,然后重点介绍了MSP430x4xx系列FLL +的组成 ,同时分析了其工作原理 ,最后总结了FLL
关键词 MSP430x4xx系列 微控制器 时钟设计 锁频环 低功耗
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基于传统文化走马灯的时钟设计与应用
7
作者 周頔 严晗 《丝网印刷》 2023年第6期66-68,共3页
走马灯是传统节日的主要灯具之一。文章选取走马灯鲜明的特征与时钟融合进行现代工业产品创新设计,使其与现代生活更加紧密结合,更好地将传统文化传承与创新发展。
关键词 传统文化 走马灯 时钟设计 现代应用
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基于时钟设计的异步时序逻辑电路设计法 被引量：2
8
作者 吕虹 张海峰 《电气电子教学学报》 2002年第3期72-74,共3页
基于时钟设计的异步时序逻辑电路设计法 ,根据电路状态转换规律 ,立足电路中各位触发器时钟设计 ,使电路完成所要求的逻辑功能 ,从而避免了求解电路状态方程、驱动方程。
关键词 时钟设计 异步时序逻辑电路 时钟信号 时钟函数
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基于PCI2050B总线扩展系统的实现 被引量：3
9
作者 王雪琨 袁卫华 《化工自动化及仪表》 CAS 2007年第3期47-50,共4页
简单介绍PCI桥的结构和PCI2050B芯片特点,重点阐述基于PCI2050B总线扩展系统实现时,在时钟、中断、设备编号、寄存器配置的设计注意事项。时钟方面注意到各扩展槽位时钟线等长和阻抗匹配,中断方面注意到各槽位的中断路由和系统中断的仲... 简单介绍PCI桥的结构和PCI2050B芯片特点,重点阐述基于PCI2050B总线扩展系统实现时,在时钟、中断、设备编号、寄存器配置的设计注意事项。时钟方面注意到各扩展槽位时钟线等长和阻抗匹配,中断方面注意到各槽位的中断路由和系统中断的仲裁,在此基础上结合实例介绍系统的寄存器地址空间分配、配置过程和应用。该系统支持各种类型的应用配置,并且已经成功地应用在Windows和Linux平台下。 展开更多
关键词 PCI总线 PCI桥 PCI2050B 时钟设计 中断设计 总线扩展系统
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基于80C196KC单片机的高精度智能时钟设计 被引量：2
10
作者 王令 王宏华 《计量与测试技术》 2005年第8期22-23,共2页
本文阐述了基于80c196KC单片机的智能时钟软硬件设计,分析了提高时钟精度的关键因素并探索了实现方案。
关键词 单片机 时钟 软件定时器 误差分析 80C196KC单片机 时钟设计 高精度 80C196KC单片机 智能 软硬件设计
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基于片上系统的时钟复位设计 被引量：2
11
作者 任思伟 唐代飞 +3 位作者 祝晓笑 刘昌举 刘戈扬 翟江皞 《半导体光电》 北大核心 2017年第2期293-298,共6页
从方法优化和电路设计入手,提出了基于片上系统(SOC)的复位方法和时钟复位电路。设计了片外按键复位电路、片内上电电路、晶振控制电路、片内RC低频时钟电路、槽脉冲产生电路、分频延时电路、时钟切换电路及异步复位同步释放电路等电路... 从方法优化和电路设计入手,提出了基于片上系统(SOC)的复位方法和时钟复位电路。设计了片外按键复位电路、片内上电电路、晶振控制电路、片内RC低频时钟电路、槽脉冲产生电路、分频延时电路、时钟切换电路及异步复位同步释放电路等电路模块。以上电路模块构成了片上系统的时钟复位电路,形成了特定的电路时钟复位系统。该时钟复位系统将片外按键复位与片内上电复位结合起来,形成多重复位设计,相比单纯按键复位更智能,相比单纯上电复位则更可靠。另外,该时钟复位系统还采用了片内RC振荡时钟电路等一系列电路,借助片内RC时钟实现对芯片的延时复位,进而在保证复位期间寄存器得到正确初始化的同时,还使得芯片能够始终处在稳定的晶振时钟下正常工作。相比传统的时钟复位电路,该时钟复位系统既便捷,又保证了系统初始化和系统工作的可靠性。 展开更多
关键词 片上系统 时钟设计 复位设计 延时复位
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交互设计系统方法在时钟设计上的应用研究 被引量：1
12
作者 黄昊 曹恩国 +1 位作者 甄智椋 赖玲江 《包装工程》 CAS CSCD 北大核心 2015年第24期132-136,共5页
目的将交互设计系统方法引入时钟设计。方法整合交互设计中从心理认知图、角色分析、全面情景法到心智模型、情感语意,再到情景验证的整体系统方法,并将此系统方法应用到时钟设计的过程中(从概念提出到样机制作的过程)。结论交互设计的... 目的将交互设计系统方法引入时钟设计。方法整合交互设计中从心理认知图、角色分析、全面情景法到心智模型、情感语意,再到情景验证的整体系统方法,并将此系统方法应用到时钟设计的过程中(从概念提出到样机制作的过程)。结论交互设计的方法应根据产品的设计流程进行整合,得出完整的交互设计系统方法;通过交互设计系统方法推导出基于时间压力感知的时钟设计,为相关交互产品开发设计提供参考。 展开更多
关键词 产品设计 交互设计 交互设计系统方法 时钟设计
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微处理器时钟分布技术分析
13
作者 冯勇 王礼生 《中国集成电路》 2005年第6期56-61,共6页
当今高性能系统需要低偏斜的时钟分布网络。在同步数字系统中,时钟分布网络的设计是一个巨大的挑战,对时钟严格的控制是系统正确工作的关键。和系统中其它信号相比,时钟信号的负载电容大,布线长度长,扇出点多而且具有快速的开关频率,导... 当今高性能系统需要低偏斜的时钟分布网络。在同步数字系统中,时钟分布网络的设计是一个巨大的挑战,对时钟严格的控制是系统正确工作的关键。和系统中其它信号相比,时钟信号的负载电容大,布线长度长,扇出点多而且具有快速的开关频率,导致了时钟分布网络的设计困难。随着微处理器频率的不断提升及工艺的不断发展,对于时钟设计的要求更加严格,时钟网络设计是影响系统总体性能的一个重要因素。本文介绍了影响时钟分布网络相关的一些基本概念,并就微处理器中的各种时钟分布方法进行了简要分析。 展开更多
关键词 微处理器 时钟分布 技术分析 分布网络 同步数字系统 高性能系统 负载电容 时钟信号 开关频率 时钟设计 总体性能 影响系统 网络设计 布线
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解析媒体矩阵(MediaMatrix)(七十一) 百威媒体矩阵的Dante解决方案(7)
14
作者 兆翦 《音响技术》 2010年第6期12-15,共4页
11Dante系统的时钟设计 一般地来说，对于任意的实时数字信号传输或控制系统来说，时钟信号是一个非常重要的环节。而对于专业音频数字信号来说数字时钟主要包含两个方面的内容。
关键词 媒体矩阵 数字信号传输 解析 控制系统 时钟设计 时钟信号 数字时钟 专业音频
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FPGA的可靠时钟设计方案 被引量：1
15
作者 刘一平 叶媲舟 凌朝东 《华侨大学学报（自然科学版）》 CAS 北大核心 2009年第6期720-722,共3页
对于现场可编程门阵列(FPGA)常见的6种时钟设计,根据建立时间和保持时间的要求,按照同步设计原则,分别给出可靠的时钟设计方案.利用这些方案来设计FPGA的时钟,可以更容易完成FPGA的项目设计,使得FPGA系统更稳定、更可靠.
关键词 现场可编程门阵列 时钟设计 同步设计 建立时间 保持时间
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基于5P1105的低功耗时钟设计 被引量：1
16
作者 罗剑 孙淼 +1 位作者 昌畅 李晓龙 《电子世界》 2020年第13期187-188,共2页
现代电子设备对功耗的要求越来越高,特别是在便携式设备或其他采用电池供电的设备中,低的功耗可以让设备运行的时间更长,同时对散热的要求更低,让产品更具竞争力,因此,人们越来越重视对产品的低功耗设计。在进行低功耗设计时,通常从以... 现代电子设备对功耗的要求越来越高,特别是在便携式设备或其他采用电池供电的设备中,低的功耗可以让设备运行的时间更长,同时对散热的要求更低,让产品更具竞争力,因此,人们越来越重视对产品的低功耗设计。在进行低功耗设计时,通常从以下三个方面进行考虑. 展开更多
关键词 低功耗设计 便携式设备 时钟设计 电子设备 电池供电 设备运行 散热 竞争力
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ADI公司新的电路仿真工具简化通信、图像处理和仪器设备应用中的时钟设计
17
《单片机与嵌入式系统应用》 2005年第10期87-88,共2页
美国模拟器件公司发布了新的ADISIMCLKTM时钟集成电路（IC）设计和仿真工具。同时还发布了三款新的时钟IC，从而增加了其不断增长的时钟IC产品种类，ADIS—IMCLK工具为时钟和时序设计工程师提供了一种易用的仿真工具，用于设计和分析各... 美国模拟器件公司发布了新的ADISIMCLKTM时钟集成电路（IC）设计和仿真工具。同时还发布了三款新的时钟IC，从而增加了其不断增长的时钟IC产品种类，ADIS—IMCLK工具为时钟和时序设计工程师提供了一种易用的仿真工具，用于设计和分析各种应用所需的时钟电路，例如无线收发器、宽带基础设施、医学图像处理、通用仪器设备以及自动测试设备。设计工程师根据该工具的使用指南、 展开更多
关键词 时钟集成电路 医学图像处理 时钟设计 仿真工具 设备应用 仪器设备 ADI公司 美国模拟器件公司 设计工程师
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系列化趣味时钟产品的解构与重构 被引量：1
18
作者 刘雨 贾凯 《工业设计》 2018年第8期36-37,共2页
把解构的设计手法运用到趣味时钟系列化产品设计中,明确产品设计过程的各个环节,解构和重构的内容和方法。解构是一种由表及里的方法,可以增强设计方案的实用性、可行性、全面性;重构需要对构成产品的各要素进行整合,做到内外兼修。解... 把解构的设计手法运用到趣味时钟系列化产品设计中,明确产品设计过程的各个环节,解构和重构的内容和方法。解构是一种由表及里的方法,可以增强设计方案的实用性、可行性、全面性;重构需要对构成产品的各要素进行整合,做到内外兼修。解构产品是展开设计活动的预备阶段,是产品设计的出发点,重构是设计创新的落脚点,对产品的解构和重构是设计师集成创新的有效手段。 展开更多
关键词 时钟设计 解构 重构 集成创新
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基于HyperLynx的高速PECL交流耦合时钟设计 被引量：1
19
作者 张国栋 李楠 刘凯 《电子工程师》 2007年第12期18-21,共4页
随着高速数据传输发展的需求,在高速IC之间的时钟路径变得越来越关键,成为影响系统性能、功耗及噪声的关键因素。PECL(正电压射极耦合逻辑)信号作为一种适合高速逻辑互联的电平标准,越来越多地应用在高速A/D转换器的时钟设计中。介绍了... 随着高速数据传输发展的需求,在高速IC之间的时钟路径变得越来越关键,成为影响系统性能、功耗及噪声的关键因素。PECL(正电压射极耦合逻辑)信号作为一种适合高速逻辑互联的电平标准,越来越多地应用在高速A/D转换器的时钟设计中。介绍了一种交流耦合形式的PECL高速时钟设计方法。在时钟的端接设计中,采用串联终端匹配和并联终端匹配改善信号完整性,并利用HyperLynx软件进行仿真,取得了良好的效果,对于实际电路设计有良好的指导作用。 展开更多
关键词 PECL HYPERLYNX 交流耦合 端接 高速A/D转换器 时钟设计
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基于单片机控制的串行口调时时钟设计 被引量：1
20
作者 白亚林 《山西科技》 2013年第1期92-95,共4页
介绍了单片机的串口通信方式和时钟中断定时方法,采用89S52的定时器0中断实现时钟秒、分、时的控制,使用单片机的串口通信中断对时钟进行调节,设计了硬件电路,编写了软件程序,实现了计算机对时钟的实时控制。
关键词 单片机 串口中断 定时器 时钟设计
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