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ADSP-TS101S与雷达数字中频接口的FPGA实现
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作者 李学华 周伟 +1 位作者 刘易 李婧 《成都信息工程学院学报》 2006年第1期18-21,共4页
介绍了ADSP-TS101S与雷达数字中频接口电路原理及其FPGA实现。采用Cyclone芯片设计系统中FIFO缓存、低压差分(LVDS)转换、时钟倍频、控制译码、时序逻辑电路等电路,很好地解决了传统系统中稳定性差,在线升级难等问题,提高了系统的整体... 介绍了ADSP-TS101S与雷达数字中频接口电路原理及其FPGA实现。采用Cyclone芯片设计系统中FIFO缓存、低压差分(LVDS)转换、时钟倍频、控制译码、时序逻辑电路等电路,很好地解决了传统系统中稳定性差,在线升级难等问题,提高了系统的整体性能。 展开更多
关键词 ADSP-TS101S 雷达数字中频 FIFO CYCLONE
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