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消除CPLD/FPGA器件设计中的毛刺 被引量:10
1
作者 何伟 张玲 《重庆大学学报(自然科学版)》 EI CAS CSCD 北大核心 2002年第12期69-73,共5页
复杂可编程逻辑器件CPLD和现场可编程门列阵FPGA在现代数字系统设计中起着越来越重要的作用 ,但系统设计中出现的毛刺往往成为系统设计成功与否的障碍。本文介绍了CPLD FPGA设计中毛刺产生的原因 ,详细分析了在EDA环境下对毛刺进行判断... 复杂可编程逻辑器件CPLD和现场可编程门列阵FPGA在现代数字系统设计中起着越来越重要的作用 ,但系统设计中出现的毛刺往往成为系统设计成功与否的障碍。本文介绍了CPLD FPGA设计中毛刺产生的原因 ,详细分析了在EDA环境下对毛刺进行判断与定位的原理 ,论述了利用EDA工具消除毛刺的 3种方法与具体实现。通过实例分析表明 ,借助于功能强大的EDA工具 ,不仅可以在设计中十分方便地发现毛刺 ,而且可以精确定位 ,进而寻找消除毛刺的最佳方法和进行结果的验证。 展开更多
关键词 CPLD/FPGA器件 毛刺 复杂可编程逻辑器件 现场可编程门列阵 电子设计自动化 EDA 竞争-冒险现象 大规模集成电路 数字系统设计
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FPGA设计中毛刺问题的研究 被引量:8
2
作者 陆维佳 潘玉 《现代电子技术》 2005年第9期36-38,41,共4页
毛刺现象在FPGA设计中非常普遍,而毛刺的出现往往导致系统结果的错误。本文从FPGA的原理结构的角度深入探讨了毛刺产生的原因及产生的条件,总结了多种不同的解决方法,并结合具体的应用对解决方案进行深入地分析。
关键词 FPGA 毛刺 采样 竞争冒险
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基于机器视觉的弹簧内径尺寸检测研究 被引量:8
3
作者 许昊 范详 +1 位作者 魏文杰 于俊辉 《机电产品开发与创新》 2016年第1期78-79,92,共3页
弹簧的内径尺寸对保证其质量及装配精度有着极其重要的作用,传统的检测方法不仅费时费力,而且误判率较高。针对弹簧外形的特点,论文设计了弹簧外形视觉检测的流程,并使用Labview软件平台开发了检测程序,软件可实现毛刺识别,尺寸测量,筛... 弹簧的内径尺寸对保证其质量及装配精度有着极其重要的作用,传统的检测方法不仅费时费力,而且误判率较高。针对弹簧外形的特点,论文设计了弹簧外形视觉检测的流程,并使用Labview软件平台开发了检测程序,软件可实现毛刺识别,尺寸测量,筛选不合格产品等功能。经验证,这种方案可以满足弹簧内径尺寸的高精度检测。 展开更多
关键词 机器视觉 弹簧检测 毛刺 内径
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FPGA设计中竞争冒险问题的研究 被引量:3
4
作者 张晴 《实验室研究与探索》 CAS 2003年第1期47-49,62,共4页
以现场可编程门阵列(以下简称FPGA)在设计中由于其内部构成,容易引起竞争问题。以我们在实验教学中的应用与实践为主线,详细介绍了消除竞争冒险的各种方法。
关键词 现场可编程门阵列 实验教学 FPGA设计 竞争冒险现象
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Efficient parameter inference for gravitational wave signals in the presence of transient noises using temporal and time-spectral fusion normalizing flow
5
作者 孙天阳 熊春雨 +3 位作者 金上捷 王钰鑫 张敬飞 张鑫 《Chinese Physics C》 SCIE CAS CSCD 2024年第4期240-251,共12页
Glitches represent a category of non-Gaussian and transient noise that frequently intersects with gravitational wave(GW)signals,thereby exerting a notable impact on the processing of GW data.The inference of GW parame... Glitches represent a category of non-Gaussian and transient noise that frequently intersects with gravitational wave(GW)signals,thereby exerting a notable impact on the processing of GW data.The inference of GW parameters,crucial for GW astronomy research,is particularly susceptible to such interference.In this study,we pioneer the utilization of a temporal and time-spectral fusion normalizing flow for likelihood-free inference of GW parameters,seamlessly integrating the high temporal resolution of the time domain with the frequency separation characteristics of both time and frequency domains.Remarkably,our findings indicate that the accuracy of this inference method is comparable to that of traditional non-glitch sampling techniques.Furthermore,our approach exhibits a greater efficiency,boasting processing times on the order of milliseconds.In conclusion,the application of a normalizing flow emerges as pivotal in handling GW signals affected by transient noises,offering a promising avenue for enhancing the field of GW astronomy research. 展开更多
关键词 gravitational wave glitch non-Gaussian and transient noise normalizing flow machine learning likelihood-free parameter inference
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FPGA器件的竞争与冒险现象及消除方法 被引量:5
6
作者 宣丽萍 《现代电子技术》 2005年第10期119-120,共2页
现场可编程门阵列(FPGA)由于其内部构成,容易引起竞争冒险现象,从而使电路工作的稳定性大受影响,电路也容易产生误动作,以致产生意想不到的后果。本文详细介绍了冒险现象的产生,并结合实例介绍了消除竞争冒险现象的各种方法。这些方法... 现场可编程门阵列(FPGA)由于其内部构成,容易引起竞争冒险现象,从而使电路工作的稳定性大受影响,电路也容易产生误动作,以致产生意想不到的后果。本文详细介绍了冒险现象的产生,并结合实例介绍了消除竞争冒险现象的各种方法。这些方法主要通过改变设计,破坏毛刺产生的条件来减少毛刺的发生。他能够使FPGA设计中毛刺的出现几率减到最小,大大减少了逻辑错误,加强了电路工作的稳定性,有效地抑制了干扰,使设计也更加优化、合理。 展开更多
关键词 FPGA 竞争冒险 毛刺 逻辑错误
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Neutron star core-crust transition and the crustal moment of inertia in the nonlinear relativistic Hartree approximation
7
作者 李牛 韦斯纳 +2 位作者 杨荣瑶 叶婧 蒋维洲 《Chinese Physics C》 SCIE CAS CSCD 2024年第3期133-141,共9页
We investigate the effects of theσmeson mass(m_(σ)),symmetry energy,and slope of the symmetry energy on the neutron star core-crust transition density and the crustal moment of inertia(ΔI/I)in the nonlinear relativ... We investigate the effects of theσmeson mass(m_(σ)),symmetry energy,and slope of the symmetry energy on the neutron star core-crust transition density and the crustal moment of inertia(ΔI/I)in the nonlinear relativistic Hartree approach(RHA),which includes vacuum polarization.Although the core-crust transition density(ρ_(t)),pressure(P_(t)),and neutron star radius(R),which are all dependent on the symmetry energy,contribute to determiningΔI/I,we find that changing only the slope of symmetry energy within a reasonable range is not sufficient to reachΔI/I≥7%to achieve the large glitches of the Vela pulsar.However,since all three factors(ρ_(t),P_(t),and R)increase with the increase in mσthrough scalar vacuum polarization,adjusting mσcan easily achieveΔI/I≥7%. 展开更多
关键词 symmetry energy relativistic Hartree approximation random phase approximation core-crust transition density pulsar glitch
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流水线的FPGA低功耗设计 被引量:5
8
作者 李宏钧 胡小龙 《计算机系统应用》 2010年第8期234-237,共4页
在组合逻辑中加入寄存器级形成流水线,减少了信号毛刺的产生和传播,从而降低FPGA动态功耗,通过XPower功耗分析工具总结出了流水线设计和非流水线设计的功耗,为了做出更完整的对比,使用了低翻转率信号,随机翻转率信号和高翻转率信号作为... 在组合逻辑中加入寄存器级形成流水线,减少了信号毛刺的产生和传播,从而降低FPGA动态功耗,通过XPower功耗分析工具总结出了流水线设计和非流水线设计的功耗,为了做出更完整的对比,使用了低翻转率信号,随机翻转率信号和高翻转率信号作为输入,最后得出结论,对于高翻转率的信号,使用流水线可以一定程度的降低FPGA的功耗,对于低翻转率的信号,使用的流水线可能会使用比非流水线更多的功耗,并分析了其原因。 展开更多
关键词 现场可编程门阵列 低功耗 流水线 毛刺 乘累加单元
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碳纤维复合材料超声辅助钻削加工孔质量研究 被引量:4
9
作者 王许 丁凯 +1 位作者 徐铭洲 刘盛 《制造技术与机床》 北大核心 2022年第2期30-34,共5页
碳纤维增强复合材料(carbon fiber reinforced plastics,CFRP)因其是编织材料,具有各向异性、强度高等特点,其加工难度大,加工质量较差。针对这一现状,采用电镀金刚石套料钻,对CFRP开展了超声辅助钻削与普通钻削对比实验,通过出入口质... 碳纤维增强复合材料(carbon fiber reinforced plastics,CFRP)因其是编织材料,具有各向异性、强度高等特点,其加工难度大,加工质量较差。针对这一现状,采用电镀金刚石套料钻,对CFRP开展了超声辅助钻削与普通钻削对比实验,通过出入口质量、内壁形貌分析,研究了超声振动作用对孔出入口、内壁质量的影响。结果表明:相比于普通钻削,超声辅助钻削时,孔出口处毛刺,分层等缺陷形式明显减少,孔内壁上的加工缺陷也得到改善。 展开更多
关键词 碳钎维增强复合材料 超声辅助钻削 电镀金刚石套料钻 毛刺 分层
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电流舵型D/A转换器毛刺理论及改进设计 被引量:4
10
作者 刘卫平 王向展 +2 位作者 宁宁 杨谟华 兰中文 《微电子学》 CAS CSCD 北大核心 2006年第2期141-144,共4页
分析了高速电流舵型D/A转换器中毛刺产生的原因,提出开关对的栅信号转换速度不一致是产生毛刺的主要原因。基于这一理论,解释了输出的三个现象,进行了三个方面的改进,大幅减小了毛刺和建立时间,改善了动态参数。改进后的电路,在电流源... 分析了高速电流舵型D/A转换器中毛刺产生的原因,提出开关对的栅信号转换速度不一致是产生毛刺的主要原因。基于这一理论,解释了输出的三个现象,进行了三个方面的改进,大幅减小了毛刺和建立时间,改善了动态参数。改进后的电路,在电流源输出为30μA、负载为70Ω时,输出电流毛刺峰值从-4.570μA减小到-1.633μA,电压毛刺面积从5.6 pV.s降到2.3 pV.s;在相同仿真条件下,D/A转换器的SFDR值上升了10 dB。 展开更多
关键词 电流舵 D/A转换器 毛刺 电流开关 寄生电容
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基于延时控制的Glitch PUF电路设计 被引量:2
11
作者 董永兴 徐金甫 李军伟 《计算机应用与软件》 北大核心 2020年第11期311-315,333,共6页
Glitch PUF具有良好的非线性特性,可以很好地抵御建模攻击的威胁,保证信息安全。提出一种延时控制的Glitch PUF电路架构。利用延时调节模块控制不同路径的延时大小,T触发器利用产生毛刺数量的奇偶性判决响应比特,使用Monte Carlo仿真验... Glitch PUF具有良好的非线性特性,可以很好地抵御建模攻击的威胁,保证信息安全。提出一种延时控制的Glitch PUF电路架构。利用延时调节模块控制不同路径的延时大小,T触发器利用产生毛刺数量的奇偶性判决响应比特,使用Monte Carlo仿真验证所设计电路的性能。实验结果表明,所设计的Glitch PUF具有良好的唯一性和稳定性,且节约了资源。 展开更多
关键词 glitch PUF 延时控制 Monte Carlo仿真 信息安全
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FPGA在恶劣电磁环境下的抗干扰设计 被引量:3
12
作者 李涛 高扬英 韩力 《电子工程师》 2004年第6期38-39,47,共3页
在恶劣电磁环境下 ,对现场可编程逻辑阵列 (FPGA)工作稳定性影响较大的是外界杂波脉冲和毛刺信号。从 FPGA芯片内部设计和外部设计两方面介绍了提高 FPGA芯片工作稳定性的一些措施。
关键词 现场可编程逻辑阵列 杂波脉冲 毛刺 抗干扰设计
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一种14位400MS/s分段型电流舵DAC的设计 被引量:4
13
作者 王向展 宁宁 +1 位作者 徐振涛 杜翎 《微电子学》 CAS CSCD 北大核心 2011年第2期199-202,共4页
基于TSMC 0.25μm CMOS工艺,采用分段开关电流结构,设计了一种基于2.5 V电源电压的14位400 MS/s D/A转换器。该D/A转换器内置高精度带隙基准源、高速开关驱动电路和改进的Cascode单位电流源电路,以提高性能。D/A转换器的积分非线性(INL... 基于TSMC 0.25μm CMOS工艺,采用分段开关电流结构,设计了一种基于2.5 V电源电压的14位400 MS/s D/A转换器。该D/A转换器内置高精度带隙基准源、高速开关驱动电路和改进的Cascode单位电流源电路,以提高性能。D/A转换器的积分非线性(INL)和微分非线性(DNL)均小于0.5 LSB。在400 MHz采样频率1、99.8 MHz输出信号频率时,其无杂散动态范围(SFDR)达到85.4 dB。 展开更多
关键词 分段式电流舵 D/A转换器 驱动信号交叉点 毛刺
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可编程逻辑阵列减少毛刺的低功耗布线算法 被引量:4
14
作者 黄娟 杨海钢 +2 位作者 李威 谭宜涛 崔秀海 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2010年第10期1664-1670,共7页
随着集成电路工艺的进步和集成度的提高,功耗成为制约FPGA发展的主要问题.为此提出一种减少毛刺的FPGA低功耗布线算法.通过修改代价函数,在布线过程中动态地调节信号的路径,使信号到达查找表输入端的时间基本趋于一致,从而减少毛刺,降... 随着集成电路工艺的进步和集成度的提高,功耗成为制约FPGA发展的主要问题.为此提出一种减少毛刺的FPGA低功耗布线算法.通过修改代价函数,在布线过程中动态地调节信号的路径,使信号到达查找表输入端的时间基本趋于一致,从而减少毛刺,降低电路的动态功耗.该算法从软件方面来减少毛刺,不需要增加任何硬件电路开销.在运算时间相同的情况下,将文中算法与VPR布线算法进行比较.实验结果表明,该算法平均能消除23.4%的毛刺,降低5.4%的功耗,而关键路径延时平均仅增加1%. 展开更多
关键词 FPGA 低功耗布线 毛刺 代价函数 动态功耗
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XPNAV-1和NICER对Crab脉冲星观测数据的比较分析
15
作者 王浙宇 韩孟纳 童明雷 《时间频率学报》 CSCD 2023年第3期178-187,共10页
通过对比NICER(Neutron Star Interior Composition Explorer)和XPNAV-1(X-ray Pulsar Navigation-1)关于Crab脉冲星同一时段(108天)观测数据的计时处理结果,发现在周期跃变发生前的时段(95天),NICER数据的拟合前计时残差的RMS(root mea... 通过对比NICER(Neutron Star Interior Composition Explorer)和XPNAV-1(X-ray Pulsar Navigation-1)关于Crab脉冲星同一时段(108天)观测数据的计时处理结果,发现在周期跃变发生前的时段(95天),NICER数据的拟合前计时残差的RMS(root mean square)为5.77μs,远优于XPNAV-1数据的拟合前计时残差的RMS 51.56μs,体现了NICER在有效面积、探测效率、数据采集等方面的优势,给未来我国的X射线脉冲星探测器研制提供了发展方向;而在周期跃变发生后的时段(13天),发现XPNAV-1数据的拟合前计时残差的RMS为55.87μs,而NICER数据的拟合前计时残差的RMS为167.27μs,周期跃变对NICER的影响更大,说明在处理周期跃变发生后时段的NICER数据时,由于NICER的观测精度非常高,需要更频繁地更新Crab星历。最后分别得到了两个探测器整段数据的计时残差。XPNAV-1数据的拟合前计时残差的RMS为55.94μs,而NICER数据的拟合前计时残差的RMS为64.34μs,这说明NICER数据受周期跃变影响更为明显,进一步证明了上述结论。 展开更多
关键词 Crab脉冲星 脉冲星计时 脉冲周期跃变 X射线脉冲星探测器
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Observational features of pulsar glitches 被引量:1
16
作者 WANG Na1 & YUAN JianPing1,2 1 Urumqi Observatory, NAOC, Urumqi 830011, China 2 Graduate University of CAS, Beijing 100049, China 《Science China(Physics,Mechanics & Astronomy)》 SCIE EI CAS 2010年第S1期3-8,共6页
Pulsar glitches are sudden increases in the rotation rate which probably result from angular momentum transfer within the neutron star. We review the observational features of the 39 glitches detected at Nanshan from ... Pulsar glitches are sudden increases in the rotation rate which probably result from angular momentum transfer within the neutron star. We review the observational features of the 39 glitches detected at Nanshan from 2000 to 2008, including several events which appear to be slow glitches. A wide variety of post-glitch behavior is observed with very little recovery in some pulsars and over-recovery in others. Analysis of the whole sample of known glitches shows that fractional glitch amplitudes are correlated with characteristic age with a peak at about 105 years, but there is a spread of two or three orders of magnitude at all ages. For individual pulsars with many glitches, the time until the next glitch is sometimes proportional to the fractional glitch amplitude. 展开更多
关键词 NEUTRON STAR pulsar OBSERVATION TIMING glitch
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A low reference spur quadrature phase-locked loop for UWB systems 被引量:1
17
作者 傅海鹏 蔡德鋆 +2 位作者 任俊彦 李巍 李宁 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2011年第11期132-138,共7页
This paper presents a low phase noise and low reference spur quadrature phase-locked loop (QPLL) circuit that is implemented as a part ofa fi'equency synthesizer for China UWB standard systems. A glitch-suppressed ... This paper presents a low phase noise and low reference spur quadrature phase-locked loop (QPLL) circuit that is implemented as a part ofa fi'equency synthesizer for China UWB standard systems. A glitch-suppressed charge pump (CP) is employed for reference spur reduction. By forcing the phase frequency detector and CP to operate in a linear region of its transfer function, the linearity of the QPLL is further improved. With the proposed series-quadrature voltage-controlled oscillator, the phase accuracy of the QPLL is guaranteed. The circuit is fab- ricated in the TSMC 0.13/Jm CMOS process and operated at 1.2-V supply voltage. The QPLL measures a phase noise of -95 dBc/Hz at 100-kHz offset and a reference spur of-71 dBc. The fully-integrated QPLL dissipates a current of 13 mA. 展开更多
关键词 QPLL charge pump UWB glitch S-QVCO
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高阶掩码防护的设计实现安全性研究 被引量:1
18
作者 李延斌 唐明 +3 位作者 李煜光 胡晓波 彭敏 张焕国 《计算机学报》 EI CSCD 北大核心 2018年第2期323-335,共13页
掩码对抗方案自提出以来,从一阶对抗逐渐发展至高阶对抗阶段,安全性及通用性也不断提高.最早的一阶掩码方案主要针对DES算法提出,而后出现的一阶掩码方案则大多以AES为防护目标,并针对于不同的软硬件平台,同时不断减少时间和空间耗费.... 掩码对抗方案自提出以来,从一阶对抗逐渐发展至高阶对抗阶段,安全性及通用性也不断提高.最早的一阶掩码方案主要针对DES算法提出,而后出现的一阶掩码方案则大多以AES为防护目标,并针对于不同的软硬件平台,同时不断减少时间和空间耗费.在追求更高安全性的同时,高阶掩码方案也不断朝着通用化的方向发展,主要工作在于设计通用化的S盒掩码方案,保证可应用于任何S盒设计且可抵抗任意阶侧信道攻击.高阶掩码方案已被普遍接受为一种算法级可证明安全的侧信道防护方法,出现以ISW安全性框架为代表的理论安全性证明,以及在此框架下的任意阶掩码方案.然而面向侧信道分析,密码算法设计实现的安全性无法仅仅基于算法安全,针对这种掩码方案理论安全与实际安全间的差距,Roche与Prouff于2011年提出面向硬件设计的安全性掩码方案,但该方案无法运用于已有高阶掩码设计,只是对Rivain和Prouff在CHES2010上提出的RivP方案进行硬件级安全性实现.同时,以实现d阶安全的有限域乘法为例,实现需要加法和乘法的执行次数由O(d^2)增加到O(d^3),由于增加过多的设计资源而对执行效率有较大的影响,降低了方案的实用性.在高效安全的硬件设计平台上,首先,作者分析由于时延不同导致的glitch有可能泄露敏感信息.相比于组合逻辑设计,时序设计下的电路不会产生降阶泄露.除了已有的glitch泄露外,文中还发现存在与硬件设计结构相关的泄露.作者从密码芯片设计者的角度出发,对掩码方案中关键部件的不同硬件设计结构进行分析.作者利用互信息的方法分析并行设计所产生的安全性问题,从理论上证明并行设计存在的安全隐患.在找出掩码设计隐患的基础上给出安全、轻量的安全设计建议,并最终通过实验对比不同设计结构下高阶掩码方案硬件设计的安全性,证明实验结果与理 展开更多
关键词 侧信道 高阶掩码方案 glitch 硬件设计结构 安全性设计隐患
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基于MLP算法的Glitch PUF机器学习攻击 被引量:1
19
作者 徐金甫 董永兴 李军伟 《电子技术应用》 2019年第12期62-66,共5页
随着攻击技术的不断进步,基于机器学习(Machine Learning,ML)、深度学习(Deep Learning,DL)等技术的建模攻击严重威胁了PUF的安全。针对Glitch PUF单元电路静态输出的缺陷,首次提出使用多层感知器(Multilayer Perceptron,MLP)算法对Glit... 随着攻击技术的不断进步,基于机器学习(Machine Learning,ML)、深度学习(Deep Learning,DL)等技术的建模攻击严重威胁了PUF的安全。针对Glitch PUF单元电路静态输出的缺陷,首次提出使用多层感知器(Multilayer Perceptron,MLP)算法对Glitch PUF进行机器学习,解决了Glitch PUF输出为非线性可分数据的问题,能够对Glitch PUF攻击并预测其输出。实验表明,对比于逻辑回归(Logistic Regression,LR)算法和随机森林(Random Forest,RF)二分类算法,提出的MLP算法显著降低了预测错误率。 展开更多
关键词 信息安全 glitch PUF 机器学习 建模攻击
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Soft error generation analysis in combinational logic circuits
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作者 丁潜 汪玉 +2 位作者 罗嵘 汪蕙 杨华中 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2010年第9期141-146,共6页
Reliability is expected to become a big concern in future deep sub-micron integrated circuits design.Soft error rate(SER) of combinational logic is considered to be a great reliability problem.Previous SER analysis ... Reliability is expected to become a big concern in future deep sub-micron integrated circuits design.Soft error rate(SER) of combinational logic is considered to be a great reliability problem.Previous SER analysis and models indicated that glitch width has a great impact on electrical masking and latch window masking effects,but they failed to achieve enough insights.In this paper,an analytical glitch generation model is proposed.This model shows that after an inflexion point the collected charge has an exponential relationship with glitch duration and the model only introduces an estimation error of on average 2.5%. 展开更多
关键词 soft error glitch generation analytical model
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