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题名一种染色体编码新方法的硬件进化
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作者
张超
刘峥
赵伟
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机构
西安电子科技大学雷达信号处理国家重点实验室
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出处
《智能系统学报》
2011年第5期450-455,共6页
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基金
陕西省自然科学基础研究计划资助项目(SJ08F19)
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文摘
提出了基于FPLA的染色体编码及在此基础上的并行硬件进化方法.该编码方式以与或非门为基本单元,进化时将电路编码染色体按逻辑门分解,进行适应度计算时采用分解逆过程使染色体合并,可以有效缩短进化时间,有利于大规模复杂电路的进化.以4位二进制码转换为格雷码的电路为例进行试验,该方法在20次实验中平均速度提高了32.25%.为实现内进化编写了由染色体生成Verilog硬件语言的C程序,该编码方式同时适用于多输入多输出电路进化且染色体长度可变,利用此特性生成了异构电路,完成了容错,对于实现故障模块在线修复,提高太空恶劣环境中电子系统可靠性具有一定意义.
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关键词
硬件进化
染色体编码
fpla
Verilog硬件语言
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Keywords
hardware evolution
chromosome encoding
field programmable logic array（fpla）
Verilog HDL
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分类号
TN911.2
[电子电信—通信与信息系统]
TP18
[电子电信—信息与通信工程]
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