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变电设备状态监测大数据的查询优化方法 被引量:24
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作者 王德文 李静芳 《电力系统自动化》 EI CSCD 北大核心 2017年第2期165-172,共8页
变电设备状态监测数据体积大、价值密度低,传统数据处理方法不能很好地满足状态监视、评估与诊断等应用快速查询的需要。文中通过对状态监测数据特点和分布式列数据存储方法的分析,给出了变电设备状态监测的大数据处理框架。通过对监测... 变电设备状态监测数据体积大、价值密度低,传统数据处理方法不能很好地满足状态监视、评估与诊断等应用快速查询的需要。文中通过对状态监测数据特点和分布式列数据存储方法的分析,给出了变电设备状态监测的大数据处理框架。通过对监测时间、监测设备编号和设备编号等数据属性的组合,设计了3种状态监测数据复合行键结构,以提高状态监测数据行键查询的灵活性。为了解决在行键未知情况下全表扫描效率低下的问题,提出基于协处理器的二级索引构建方法,实现在非行键约束条件下的快速查询。实验结果表明,基于协处理器的二级索引方法在查询效率上比无索引和IHBase二级索引方式有了明显提高,对状态监测数据写入速度影响较小,能够较好地满足大数据环境下变电设备状态监测大数据快速、灵活查询的需要。 展开更多
关键词 状态监测 大数据 行键 协处理器 二级索引
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基于协处理器的HBase区域级第二索引研究与实现 被引量:16
2
作者 丁飞 陈长松 +2 位作者 张涛 杨涛 张岩峰 《计算机应用》 CSCD 北大核心 2014年第A01期181-185,共5页
针对HBase全表扫描查询效率问题,对HBase第二索引功能进行研究,实现一种基于HBase协处理器的服务端区域级第二索引扩展功能。通过将索引维护与查询放到服务端完成,极大地减少了网络通信开销。索引文件使用HFile格式组织。利用HFile成熟... 针对HBase全表扫描查询效率问题,对HBase第二索引功能进行研究,实现一种基于HBase协处理器的服务端区域级第二索引扩展功能。通过将索引维护与查询放到服务端完成,极大地减少了网络通信开销。索引文件使用HFile格式组织。利用HFile成熟的编程接口以及高效的读写性能,使得索引维护变得简单易行,也保证了索引读写的效率,提供了高效的查询性能。实践表明,该索引扩展机制能有效地满足集群应用中对大数据集的第二索引查询功能需求。 展开更多
关键词 HBase数据库 区域级 第二索引 协处理器 HFile格式
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AVS熵解码与DSP实现 被引量:6
3
作者 陈光法 姚立敏 虞露 《电视技术》 北大核心 2004年第10期43-46,共4页
阐述了AVS标准的进展情况及AVS标准的特点,重点介绍了AVS熵解码的原理和采用Equator公司MAP-CABSP-15处理器中的协处理器(Vlx)实现AVS熵解码的方法。
关键词 宽带信号处理器 单指令多数据流 AVS标准 协处理器 熵解码
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可重构密码协处理器的组成与结构 被引量:12
4
作者 曲英杰 《计算机工程与应用》 CSCD 北大核心 2003年第23期32-34,共3页
文章提出了一些关于可重构密码协处理器的组成与结构的设计思想和方法。可重构密码协处理器组成与结构是指可重构密码协处理器的组成模块及其相互之间的连接网络。可重构密码协处理器组成与结构的设计直接影响到可重构密码协处理器的性... 文章提出了一些关于可重构密码协处理器的组成与结构的设计思想和方法。可重构密码协处理器组成与结构是指可重构密码协处理器的组成模块及其相互之间的连接网络。可重构密码协处理器组成与结构的设计直接影响到可重构密码协处理器的性能,因此是可重构密码协处理器设计中的一个关键问题。 展开更多
关键词 可重构密码协处理器 组成模块 结构 设计
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可重构计算综述 被引量:12
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作者 王志远 王建华 徐旸 《小型微型计算机系统》 CSCD 北大核心 2009年第6期1203-1207,共5页
可重构计算是一种介于软件和专用硬件之间的新的求算方式,其兼具了软件的通用性和硬件的高效性.20世纪90年代以来,随着电子技术和计算机技术的不断进步,可重构计算正逐步成为一个新的研究热点.目前,可重构计算已经广泛应用于高速数字滤... 可重构计算是一种介于软件和专用硬件之间的新的求算方式,其兼具了软件的通用性和硬件的高效性.20世纪90年代以来,随着电子技术和计算机技术的不断进步,可重构计算正逐步成为一个新的研究热点.目前,可重构计算已经广泛应用于高速数字滤波器、图像压缩、密码处理,硬件演化计算、定制计算(Custom Computing)、嵌入式系统等领域.本文对可重构计算的定义,分类,国内外研究现状和常见的研究方向和方法做了较为详细的介绍,其中包括一些最新的研究成果和方法,供从事该项研究的人员参考. 展开更多
关键词 可重构计算 可重构件 协处理器 FPGA
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可重构密码协处理器指令系统的设计方法 被引量:11
6
作者 曲英杰 刘卫东 战嘉瑾 《计算机工程与应用》 CSCD 北大核心 2004年第2期10-12,22,共4页
可重构密码协处理器是采用可重构体系结构的思想和方法设计而成的,用于对数据进行加/解密处理的集成电路芯片,它能够灵活、快速地实现多种不同的密码算法。文章提出了可重构密码协处理器的指令系统的设计方法,并评估了按照该方法所设计... 可重构密码协处理器是采用可重构体系结构的思想和方法设计而成的,用于对数据进行加/解密处理的集成电路芯片,它能够灵活、快速地实现多种不同的密码算法。文章提出了可重构密码协处理器的指令系统的设计方法,并评估了按照该方法所设计的指令系统的特性。 展开更多
关键词 可重构 密码 协处理器 指令系统
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一种新型硬件可配置公钥制密码协处理器的VLSI实现 被引量:9
7
作者 陈超 曾晓洋 章倩苓 《通信学报》 EI CSCD 北大核心 2005年第1期6-11,26,共7页
提出了一种新型的硬件可配置的密码协处理器,同时适用于 GF(p)和 GF(2m)两种域,可以实现 RSA和 ECC 两种目前主流的加密算法。同时又具备硬件可配置的特点,可以完成 32~512bit 的模乘运算而无需对硬件做任何修改。本文的密码协处理芯片... 提出了一种新型的硬件可配置的密码协处理器,同时适用于 GF(p)和 GF(2m)两种域,可以实现 RSA和 ECC 两种目前主流的加密算法。同时又具备硬件可配置的特点,可以完成 32~512bit 的模乘运算而无需对硬件做任何修改。本文的密码协处理芯片用 TSMC 0.35μm 标准单元库综合,可以工作在 100MHz 时钟下,等效单元 45k 等效门,512bit 的模乘运算速度可以达到 190kbit/s,一次椭圆曲线上的 233bit 的点加运算只需 18μs。 展开更多
关键词 密码系统 协处理器 RSA 椭圆曲线密码
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基于HBase的海量数据分布式序列存储策略优化 被引量:11
8
作者 党引 吴旻荣 李强 《自动化技术与应用》 2020年第8期39-43,共5页
针对海量数据分布式序列数据量大、增长速度快、序列重复性高等特点,结合HBase分布式数据库的相关理论和技术提出并实现了一套基于HBase的海量数据分布式序列存储方案。该方案设计了基于分布式数据分类码的预分区和行键优化策略,解决了... 针对海量数据分布式序列数据量大、增长速度快、序列重复性高等特点,结合HBase分布式数据库的相关理论和技术提出并实现了一套基于HBase的海量数据分布式序列存储方案。该方案设计了基于分布式数据分类码的预分区和行键优化策略,解决了服务器的均衡负载问题。通过构造文件索引替代二进制码序列实现了数据的高效存取。利用HBase协处理器实现了分布式序列记录单次提交多表插入的功能,提升了分布式多格式存储的效率。实验表明,通过上述方案设计的分布式序列存储系统具有良好的存储能力和扩展性。 展开更多
关键词 HBASE 分布式序列 分类码 文件索引 协处理器
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高性能可扩展公钥密码协处理器研究与设计 被引量:11
9
作者 黎明 吴丹 +1 位作者 戴葵 邹雪城 《电子学报》 EI CAS CSCD 北大核心 2011年第3期665-670,共6页
本文提出了一种高效的点乘调度策略和改进的双域高基Montgomery模乘算法,在此基础上设计了一种新型高性能可扩展公钥密码协处理器体系结构,并采用0.18μm 1P6M标准CMOS工艺实现了该协处理器,以支持RSA和ECC等公钥密码算法的计算加速.该... 本文提出了一种高效的点乘调度策略和改进的双域高基Montgomery模乘算法,在此基础上设计了一种新型高性能可扩展公钥密码协处理器体系结构,并采用0.18μm 1P6M标准CMOS工艺实现了该协处理器,以支持RSA和ECC等公钥密码算法的计算加速.该协处理器通过扩展片上高速存储器和使用以基数为处理字长的方法,具有良好的可扩展性和较强的灵活性,支持2048位以内任意大数模幂运算以及576位以内双域任意椭圆曲线标量乘法运算.芯片测试结果表明其具有很好的加速性能,完成一次1024位模幂运算仅需197μs、GF(p)域192位标量乘法运算仅需225μs、GF(2m)域163位标量乘法运算仅需200.7μs. 展开更多
关键词 协处理器 椭圆曲线密码体制 MONTGOMERY模乘 可扩展性
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海量自动气象站分钟数据存储检索系统设计 被引量:10
10
作者 王建荣 季刚 《计算机与现代化》 2017年第9期40-44,共5页
地面自动气象站的时空密度不断增加,产生的观测数据量呈指数级增长,传统的关系型数据库在海量数据存储与检索方面存在能力不足、检索性能下降等问题。鉴于此,本文设计一种自动站分钟数据存储与检索系统。使用Quartz定时采集自动站分钟... 地面自动气象站的时空密度不断增加,产生的观测数据量呈指数级增长,传统的关系型数据库在海量数据存储与检索方面存在能力不足、检索性能下降等问题。鉴于此,本文设计一种自动站分钟数据存储与检索系统。使用Quartz定时采集自动站分钟文件并解码入库;应用HBase分布式数据库建立分钟数据存储模型;针对多要素查询需求,应用Elasticsearch建立辅助索引,实现HBase的二级索引。系统测试结果表明,分钟数据入库平均耗时54.6 s,二级索引完整可靠,数据检索结果返回时效达到毫秒级,能够满足业务应用中对自动站分钟数据存储和检索时效的要求。 展开更多
关键词 自动站分钟数据 Kafka HBASE Elasticsearch 协处理器
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可重构密码协处理器简介及其特性 被引量:7
11
作者 曲英杰 刘卫东 战嘉瑾 《计算机工程》 CAS CSCD 北大核心 2004年第13期166-168,共3页
可重构密码协处理器是采用可重构体系结构的思想和方法设计而成的,用于对数据进行加/解密处理的集成电路芯片,它能够灵活、快速地实现多种不同的密码算法。文章简要介绍了可重构密码协处理器的设计方法和使用方法,并对其灵活性、安全性... 可重构密码协处理器是采用可重构体系结构的思想和方法设计而成的,用于对数据进行加/解密处理的集成电路芯片,它能够灵活、快速地实现多种不同的密码算法。文章简要介绍了可重构密码协处理器的设计方法和使用方法,并对其灵活性、安全性、性能和规模进行了分析。 展开更多
关键词 可重构 密码 协处理器
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基于网络处理器及协处理器的高速网IDS的研究 被引量:5
12
作者 范华春 王颖 +3 位作者 杨彬 李雪莹 陈宇 许榕生 《计算机工程与应用》 CSCD 北大核心 2005年第1期124-126,138,共4页
随着高速网技术的不断成熟,网络数据的传输速度与传统IDS(入侵检测系统)的检测能力之间的差距越来越大,已成为在高速网络环境中实现网络安全所要解决的一个重要问题。文章提出了一种基于网络处理器及应用层匹配查找协处理器的硬件解决方... 随着高速网技术的不断成熟,网络数据的传输速度与传统IDS(入侵检测系统)的检测能力之间的差距越来越大,已成为在高速网络环境中实现网络安全所要解决的一个重要问题。文章提出了一种基于网络处理器及应用层匹配查找协处理器的硬件解决方案,来实现高速网络环境的入侵检测。此架构易于升级,针对于实现千兆带宽的网络入侵检测具有很强的应用前景。 展开更多
关键词 高速网 IDS 网络处理器 协处理器
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协处理器是未来CPU发展的关键技术 被引量:2
13
作者 刘亚峰 《电脑知识与技术(过刊)》 2007年第14期465-,539,共2页
简述了协处理器的定义和任务,综述了协处理器的发展历程,介绍了协处理器的架构与组成,阐述了协处理器引起人们重视的起因和新的应用,以及对未来CPU发展所起的关键作用.
关键词 协处理器 CELL 协处理器的架构 主核心+协处理器
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一种RSA算法的新型ASIC实现 被引量:4
14
作者 朱柯嘉 杨青松 +1 位作者 徐科 闵昊 《复旦学报(自然科学版)》 CAS CSCD 北大核心 2004年第1期16-20,共5页
提出了一种实现RSA算法的新型ASIC结构,具有较小的芯片面积和较强的灵活性,适合于智能IC卡应用.利用0.5μmCMOS标准单元库实现了该RSA协处理器,约折合14K(210)等效门,面积约3mm2,最高工作频率40MHz,完成1024位RSA加/解密运算需时375ms.
关键词 专用集成电路 RSA算法 协处理器 智能IC卡
原文传递
A Novel Defibrillator-Specific Coprocessor Capable of Running Entropy and CNN Integration Algorithms
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作者 Xuelong Wang Peng Xia +4 位作者 Changjiang Zhou Zhenyi Huang Hao Zhao Haipo Cui Shiju Yan 《Journal of Biosciences and Medicines》 2024年第11期310-322,共13页
It is difficult for the existing Automated External Defibrillator (AED) on-board microprocessors to accurately classify electrocardiographic signals (ECGs) mixed with Cardiopulmonary Resuscitation artifacts in real-ti... It is difficult for the existing Automated External Defibrillator (AED) on-board microprocessors to accurately classify electrocardiographic signals (ECGs) mixed with Cardiopulmonary Resuscitation artifacts in real-time. In order to improve recognition speed and accuracy of electrocardiographic signals containing Cardiopulmonary Resuscitation artifacts, a new special coprocessor system-on-chip (SoC) for defibrillators was designed. In this study, a microprocessor was designed based on the RISC-V architecture to achieve hardware acceleration for ECGs classification;Besides, an Approximate Entropy (ApEn) and Convolutional neural networks (CNNs) integrated algorithm capable of running on it was designed. The algorithm differs from traditional electrocardiographic (ECG) classification algorithms. It can be used to perform ECG classification while chest compressions are applied. The proposed co-processor can be used to accelerate computation rate of ApEn by 34 times compared with pure software computation. It can also be used to accelerate the speed of CNNs ECG recognition by 33 times. The combined algorithm was used to classify ECGs with CPR artifacts. It achieved a precision of 96%, which was significantly superior to that of simple CNNs. The coprocessor can be used to significantly improve the recognition efficiency and accuracy of ECGs containing CPR artifacts. It is suitable for automatic external defibrillator and other medical devices in which one-dimensional physiological signals. 展开更多
关键词 DEFIBRILLATOR SoC ENTROPY Vector Multiplication coprocessor RISCV ECG Classification
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基于FPGA的指令集架构神经网络协处理器的设计与验证 被引量:6
16
作者 邓良 陈章进 +1 位作者 乔栋 屠程力 《小型微型计算机系统》 CSCD 北大核心 2021年第6期1129-1135,共7页
针对大多数基于FPGA的加速器受限于运算资源与访存带宽,很难部署大型的神经网络这一问题,通过研究神经网络的计算特点,运用通用计算模型的思想,提出了一种指令集架构的神经网络协处理器的设计方案.该方案中的协处理器具有一套专用的运... 针对大多数基于FPGA的加速器受限于运算资源与访存带宽,很难部署大型的神经网络这一问题,通过研究神经网络的计算特点,运用通用计算模型的思想,提出了一种指令集架构的神经网络协处理器的设计方案.该方案中的协处理器具有一套专用的运算指令集,支持多种神经网络结构的运算,搭配相应的指令生成程序,能够灵活快速的进行神经网络在FPGA平台上的部署.考虑神经网络运算的相似性,对电路进行复用,降低资源的占用;设计内存多端口读写控制模块,通过协调片上缓存与片外存储,降低对访存带宽的需求.使用python与UVM验证方法学搭建验证平台进行验证,并在PYNQ-Z2开发板上进行实验.结果表明:方案中的协处理器对激活函数的运算误差在0.05以下,对其他类型指令的运算误差在10-4级别,工作在100MHz下的运算性能达到41.73GOPS,达到同类设计的主流水平,消耗的资源比同类设计平均降低80%. 展开更多
关键词 协处理器 神经网络加速 指令集架构 可编程逻辑器件
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基于计算机技术的并行测试实现方法研究 被引量:5
17
作者 程嗣怡 吴华 肖明清 《计算机测量与控制》 CSCD 2007年第8期981-983,共3页
并行测试已成为未来自动测试领域的发展趋势,而计算机技术的飞速发展为并行测试提供了许多思想和实现方法;在给出理想的并行测试结构框架后,文中着重从计算机技术应用的角度论述了并行测试的方法;多处理器和单处理器并行测试结构成为并... 并行测试已成为未来自动测试领域的发展趋势,而计算机技术的飞速发展为并行测试提供了许多思想和实现方法;在给出理想的并行测试结构框架后,文中着重从计算机技术应用的角度论述了并行测试的方法;多处理器和单处理器并行测试结构成为并行测试的两种主要体系,这其中又具体为分布式并行测试结构、协处理器结构,以及多进程、多线程结构等;这些结构体系各有特点,在搭建并行测试系统时应适情况选取,以便更大程度地提高测试速度、效率,节约测试资源。 展开更多
关键词 并行测试 分布式结构 协处理器 多进程 多线程
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数值预报产品分布式处理与存储系统设计 被引量:6
18
作者 王建荣 华连生 +2 位作者 唐怀瓯 王云 王静 《计算机技术与发展》 2018年第2期167-172,共6页
气象数值预报产品数据日益增长,传统的关系型数据库对其存储和管理能力不足,查询规模较大的历史数据时效率较低。针对上述问题,设计了分布式的数值预报产品处理与存储系统。通过Quartz任务调度定时采集数值预报产品文件;运用Kafka分布... 气象数值预报产品数据日益增长,传统的关系型数据库对其存储和管理能力不足,查询规模较大的历史数据时效率较低。针对上述问题,设计了分布式的数值预报产品处理与存储系统。通过Quartz任务调度定时采集数值预报产品文件;运用Kafka分布式消息队列解耦数值预报产品解码与入库程序;将解码日志文件、原始产品文件和解码得到的要素GRIB文件写入HDFS分布式文件系统,应用MapReduce分布式程序将解码日志记录存入HBase。因HBase对Rowkey的一级索引支持较好,而对多条件查询支持不足,需辅助Solr索引加以优化。HBase接收数据时自动触发协处理器同步记录到Solr索引库,实现了HBase的二级索引。测试结果表明,产品文件写入Hadoop文件系统平均速度为82.54 MB/s,而HBase最快入库速度可达每秒13 677条,数据检索结果返回时效达到毫秒级,能够满足业务应用中对数值预报产品存储和检索时效的要求。 展开更多
关键词 QUARTZ 解码日志文件 Kafka HBASE SOLR 协处理器
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基于FPGA的AES密码协处理器的设计和实现 被引量:4
19
作者 吕晓斌 杨峰 赵志新 《微电子学与计算机》 CSCD 北大核心 2005年第5期121-123,127,共4页
文章基于FPGA设计了一种能完成AES算法加密的密码协处理器,设计中利用VirtexII系列FPGA的结构特点,对AES算法的实现做了优化。实验证明,这种实现方式用较少的电路资源达到了较高的数据吞吐率。该密码协处理器还提供了和ARM处理器的接口... 文章基于FPGA设计了一种能完成AES算法加密的密码协处理器,设计中利用VirtexII系列FPGA的结构特点,对AES算法的实现做了优化。实验证明,这种实现方式用较少的电路资源达到了较高的数据吞吐率。该密码协处理器还提供了和ARM处理器的接口逻辑,实现了用于加/解密和数据输入输出的协处理器指令,作为ARM微处理器指令集的扩展,大大提高了嵌入式系统处理数据加/解的效率,实现数据的安全传输。 展开更多
关键词 协处理器 高级加密标准 现场可编程门阵列 密钥扩展
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H.264硬件编码器设计 被引量:1
20
作者 杨洋 宋锐 +2 位作者 吴成柯 高玉娥 张磊 《电视技术》 北大核心 2007年第4期25-27,75,共4页
介绍了H.264硬件编码器的发展状况及设计要点,分析比较了两种不同设计思路的实现架构特点,引入了多核编码器设计的概念,提出了两级指令发射概念,实现了模块多模式可配置操作。
关键词 H.264标准 多核 协处理器 两级指令发射
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