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基于电源、地桥的电源网络布线后优化 被引量:1
1
作者 黄凯 《现代电子技术》 2006年第23期54-55,共2页
随着集成电路规模的不断增大,电源网络的重要性日趋显著,电源网络的分布直接影响芯片的电压降(IR-drop)。一种布线后通过在空闲处插入电源桥和地桥的方法,可以在不增加芯片面积的情况下,改善IR-drop效应。实验结果表明在芯片布局... 随着集成电路规模的不断增大,电源网络的重要性日趋显著,电源网络的分布直接影响芯片的电压降(IR-drop)。一种布线后通过在空闲处插入电源桥和地桥的方法,可以在不增加芯片面积的情况下,改善IR-drop效应。实验结果表明在芯片布局利用率不高的情况下(70~75%),该方法可以使IR-drop得到明显的优化。 展开更多
关键词 ir-drop SOC 电源网络 P/G BRIDGE
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基于多场景FSDB向量解析提高电源完整性分析覆盖率 被引量:2
2
作者 徐慧敏 朱薇薇 施建安 《电子技术应用》 2018年第8期10-12,共3页
超高晶体管密度和不断增加的工作频率导致更严重的电源完整性问题,基于FSDB的门级向量进行仿真可实现更精确的分析结果。FSDB持续时间太长,在整个仿真周期内分析全芯片电源完整性是不切实际的,需解析其中实际案例覆盖率最高的时间段。... 超高晶体管密度和不断增加的工作频率导致更严重的电源完整性问题,基于FSDB的门级向量进行仿真可实现更精确的分析结果。FSDB持续时间太长,在整个仿真周期内分析全芯片电源完整性是不切实际的,需解析其中实际案例覆盖率最高的时间段。本文所述方法基于电源完整性相关特征,通过多场景FSDB向量解析,提高IRDrop和Power EM违例覆盖率,实现更全面的电源完整性分析方案。 展开更多
关键词 电源完整性 FSDB 向量解析 ir-drop PowerEM
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一种基于权值缩减克服IR-Drop的忆阻器阵列神经网络训练方法
3
作者 缪伟伟 《智能计算机与应用》 2023年第3期51-57,63,共8页
忆阻器阵列(Memristor-Based Crossbar)能够有效地加速神经网络中的矩阵运算。然而,忆阻器阵列会受到IR-Drop的影响,降低到达忆阻器的计算电压,导致计算精度下降。为减轻IR-Drop对忆阻器阵列计算精度的影响,提出了一种基于权值缩减的神... 忆阻器阵列(Memristor-Based Crossbar)能够有效地加速神经网络中的矩阵运算。然而,忆阻器阵列会受到IR-Drop的影响,降低到达忆阻器的计算电压,导致计算精度下降。为减轻IR-Drop对忆阻器阵列计算精度的影响,提出了一种基于权值缩减的神经网络训练方法。首先,在网络训练中添加L2正则化,使训练后的神经网络权值尽可能分布在较小值范围,以此提高计算精度对IR-Drop的鲁棒性。然后,利用基于行列约束的映射算法将大权值映射到受IR-Drop影响小的忆阻器上,减小忆阻器阵列精度损失。最后,迭代减小受到IR-Drop影响大的大权值,再通过重训练调整被减小值的附近权值,提升忆阻器阵列的计算精度。实验结果表明,所提方法能够有效地提高忆阻器阵列的计算精度,最多可以将忆阻器阵列计算精度提升至接近理想状态,精度损失小于1%。 展开更多
关键词 忆阻器阵列 神经网络训练 ir-drop 映射算法
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深亚微米下芯片电源网络的设计和验证 被引量:1
4
作者 樊俊峰 王国雄 +1 位作者 沈海斌 楼久怀 《电子器件》 EI CAS 2006年第4期1164-1167,共4页
随着芯片集成度的逐渐提高,芯片单位面积所消耗的功耗也越来越大,因此,可靠的电源网络设计和验证已成为芯片设计成败的关键因素之一。在以往,集成电路(IC)设计工程师往往根据经验来设计电源网络,但工艺到0.18μm,这往往会引起芯片功能... 随着芯片集成度的逐渐提高,芯片单位面积所消耗的功耗也越来越大,因此,可靠的电源网络设计和验证已成为芯片设计成败的关键因素之一。在以往,集成电路(IC)设计工程师往往根据经验来设计电源网络,但工艺到0.18μm,这往往会引起芯片功能失效。根据这个问题,本文首先介绍电压降(IR-Drop)和电子迁移率(Electro-migration)现象和对芯片性能的影响;其次,提出一种有效的电源网络设计和验证方法,并在芯片的物理设计初期对电源网络作可靠性估计;最后,经过椭圆曲线加密芯片(ECC&RSA)的流片,表明采用该方法设计的芯片,工作情况良好。 展开更多
关键词 电源网络 电压降 电子迁移率
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一种基于电流源模型的芯片系统电源分析与验证方法 被引量:1
5
作者 邬少国 《国外电子测量技术》 2004年第4期46-49,共4页
随着半导体技术的进步 ,SoC设计日益复杂和向低功耗方向发展 ,电源网络的设计日益关键。因此可靠的电源分析和验证结果已经成为向Foundry交付设计数据的先决条件之一。本文分析了SoC电源设计中存在的潜在问题 ,给出了业界适用的设计、... 随着半导体技术的进步 ,SoC设计日益复杂和向低功耗方向发展 ,电源网络的设计日益关键。因此可靠的电源分析和验证结果已经成为向Foundry交付设计数据的先决条件之一。本文分析了SoC电源设计中存在的潜在问题 ,给出了业界适用的设计、验证方法 ,并以工程设计为例 ,给出层次性SoC设计中电源设计、验证的相关流程。 展开更多
关键词 SOC设计 电源设计 芯片系统 电流源 验证方法 半导体技术 低功耗 设计数据 模型 网络
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基于稀疏化训练和聚类降低IR-Drop影响的方法
6
作者 王子杰 《智能计算机与应用》 2022年第11期127-133,共7页
忆阻器阵列(Memristor based Crossbar)在加速神经网络计算上有很好的效果。然而,忆阻器阵列会受到IR-Drop的影响,导致忆阻器阵列的计算精度下降。为此,提出一种方案来提高计算精度,该方案是基于对权值矩阵稀疏化以及对权值矩阵的行向... 忆阻器阵列(Memristor based Crossbar)在加速神经网络计算上有很好的效果。然而,忆阻器阵列会受到IR-Drop的影响,导致忆阻器阵列的计算精度下降。为此,提出一种方案来提高计算精度,该方案是基于对权值矩阵稀疏化以及对权值矩阵的行向量进行聚类实现的。该方案首先通过分析IR-Drop对忆阻器阵列的影响,根据忆阻器阵列和权值矩阵的映射关系,对权值矩阵进行稀疏化训练,将受到较大IR-Drop影响的权值置零。然后对权值矩阵的行向量进行聚类,找到近似全零行向量将其权值置零,在保证零权值不变的前提下重新训练权值矩阵,接着删除全零行向量和全零列向量降低矩阵规模。最后在IR-Drop影响下计算权值矩阵行向量的权值损失,根据损失大小降序排列行向量得到新的权值矩阵,并映射到忆阻器阵列上。实验表明,经过此方案处理后,忆阻器阵列受到的IR-Drop显著降低,有效地提高了计算精度并且降低了硬件规模。 展开更多
关键词 忆阻器阵列 神经网络 ir-drop
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YHFT-DX处理器全定制EDA技术的开发与应用
7
作者 李振涛 刘尧 +2 位作者 陈书明 徐庆光 付志刚 《国防科技大学学报》 EI CAS CSCD 北大核心 2013年第1期151-154,共4页
在YHFT-DX处理器的研制中,研究并实现了多项支撑全定制设计的EDA技术。针对全定制设计的功能验证,研究并实现了层次式功能模型自动提取技术,能够将晶体管级网表转化为等效的RTL级网表。研究并实现了晶体管级混合时序分析方法,可自动分... 在YHFT-DX处理器的研制中,研究并实现了多项支撑全定制设计的EDA技术。针对全定制设计的功能验证,研究并实现了层次式功能模型自动提取技术,能够将晶体管级网表转化为等效的RTL级网表。研究并实现了晶体管级混合时序分析方法,可自动分析全定制设计的延时,并采用多线程并行的方法获得了约10倍左右的速度提升。为提高模拟结果分析的效率,开发了一个延时提取的工具Aimeasure。开发了两个信号完整性分析工具PNVisual和NoiseSpy,分别用于全定制设计的IR-Drop分析和噪声分析。上述技术已在YHFT-DX处理器的设计中得到了广泛应用,有效提高了全定制设计的效率与质量。 展开更多
关键词 全定制设计 功能验证 时序分析 ir-drop 噪声分析
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晶上系统电源分配网络建模及IR-drop研究
8
作者 王家怡 朱熙铖 +1 位作者 顾林 王梦雅 《固体电子学研究与进展》 CAS 北大核心 2023年第5期401-407,共7页
为预测和评估晶上系统电性能,提出了一种结合电磁和分析模拟的晶上系统电源分配网络(PDN)建模方法。该方法将PDN结构划分为单独组件,用电磁工具和公式计算提取无源电阻、电感、电容参数后,按组件位置组装成等效电路模型。通过与三维全... 为预测和评估晶上系统电性能,提出了一种结合电磁和分析模拟的晶上系统电源分配网络(PDN)建模方法。该方法将PDN结构划分为单独组件,用电磁工具和公式计算提取无源电阻、电感、电容参数后,按组件位置组装成等效电路模型。通过与三维全波仿真自阻抗曲线比较对模型进行了验证,并基于模型,用ADS研究了模组位置排布、垂直互连密度、芯片功耗及去耦电容对电压降(IR-drop)的影响。结果表明:模型自阻抗曲线与三维全波仿真基本吻合;在一定范围内,合理排布模组位置、增加垂直互连密度、减少芯片功耗、使用较大去耦电容能降低IR-drop,为晶上系统设计和制造提供了参考。 展开更多
关键词 晶上系统 电源分配网络 电磁和分析模拟 等效电路模型 电压降
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大规模SoC的电源网络设计 被引量:1
9
作者 张玲 王澧 《电子与封装》 2015年第8期21-24,共4页
介绍了适用于SoC的电源网络设计方法。通过优化power pad的数目与布局,合理设计power ring和power grid的宽度,有效降低了电源网络上的EM和IR-drop。保证了电源网络分配的可靠性,实现了一种So C的电源网络设计。
关键词 电源网络设计 优化 电迁移 电压降
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面向电压降的忆阻神经网络精度优化
10
作者 王超 查晓婧 夏银水 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2023年第4期633-639,共7页
由于忆阻器交叉阵列自身的模拟特性可高效实现乘累加运算,因此,它被广泛用于构建神经形态计算系统的硬件加速器.然而,纳米线电阻的存在,会引起忆阻器与纳米线构成的电阻网络出现电压降问题,导致忆阻器阵列的输出信号损失而影响神经网络... 由于忆阻器交叉阵列自身的模拟特性可高效实现乘累加运算,因此,它被广泛用于构建神经形态计算系统的硬件加速器.然而,纳米线电阻的存在,会引起忆阻器与纳米线构成的电阻网络出现电压降问题,导致忆阻器阵列的输出信号损失而影响神经网络的精度.分析忆阻器电压降与忆阻器状态、位置,输出电流和输出位置的关系,通过稀疏映射优化电压降,并采用输出补偿进一步提高输出精度.仿真实验的结果表明,该方法可以有效地解决电压降引起的问题,忆阻神经网络在手写数字数据集MNIST的识别率达到95.8%,较优化前提升了33.5%. 展开更多
关键词 忆阻器 神经网络 忆阻器阵列模型 电压降
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基于AMS的异步电路设计方法 被引量:1
11
作者 万立 贺雅娟 +2 位作者 张波 李金朋 马斌 《微处理机》 2016年第4期1-4,共4页
相比于同步时序电路,异步时序电路具有更低的功耗、更高的鲁棒性、更低的压降(IR-drop)等明显优势。正是由于这些显著优势,在如今亚微米级乃至深亚微米级工艺线宽条件下,异步时序电路越来越受到电路设计者的重视。然而,由于缺乏成熟的... 相比于同步时序电路,异步时序电路具有更低的功耗、更高的鲁棒性、更低的压降(IR-drop)等明显优势。正是由于这些显著优势,在如今亚微米级乃至深亚微米级工艺线宽条件下,异步时序电路越来越受到电路设计者的重视。然而,由于缺乏成熟的专门对异步时序电路设计的设计软件和硬件描述语言,异步时序电路设计并未形成如同步时序电路设计般的标准设计流程。现存的异步时序电路设计方法虽然能设计一定规模的异步时序电路,但存在明显的缺陷。提出一种基于AMS(Analog Mixed-Signal)的异步时序电路设计方法,该方法完全采用现今主流的商业软件,并与同步时序电路设计软件相兼容。 展开更多
关键词 异步时序电路 鲁棒性 压降 同步时序电路 设计方法
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多层金属电源线地线网络拓扑结构的IR-drop分析方法 被引量:1
12
作者 王一 杨海钢 +1 位作者 余乐 孙嘉斌 《电子学报》 EI CAS CSCD 北大核心 2015年第12期2542-2546,共5页
提出了一种电源/地线(P/G)网络压降(IR-drop)静态分析方法.该方法探索了多层金属立体P/G网络结构,通过输入各金属层的坐标和通孔(Via)的工艺规则,分析不同多层金属P/G网络的拓扑结构对IR-drop的影响.实验结果表明,文中方法的压降评估结... 提出了一种电源/地线(P/G)网络压降(IR-drop)静态分析方法.该方法探索了多层金属立体P/G网络结构,通过输入各金属层的坐标和通孔(Via)的工艺规则,分析不同多层金属P/G网络的拓扑结构对IR-drop的影响.实验结果表明,文中方法的压降评估结果与SPICE仿真结果相比有着高度的一致性,平均误差小于0.4%,且算法时间复杂度与通孔数目成线性关系.并且指出中间层金属的拓扑结构对IR-drop的分布和大小有重要影响. 展开更多
关键词 电源/地线网络 多层 压降 通孔
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抑制SSN的新型内插L-EBG结构
13
作者 李开敬 张根 《电子产品世界》 2016年第7期52-55,33,共5页
本文提出的是一种基于平面型EBG(Electromagnetic Bandgap)结构的创新型结构,对于同步开关噪声(Simultaneous Switching Noise,SSN)的抑制有更优秀的特性。我们设计的这款新型EBG结构,是在周期性L-bridge EBG结构的基础上,在一些单元内... 本文提出的是一种基于平面型EBG(Electromagnetic Bandgap)结构的创新型结构,对于同步开关噪声(Simultaneous Switching Noise,SSN)的抑制有更优秀的特性。我们设计的这款新型EBG结构,是在周期性L-bridge EBG结构的基础上,在一些单元内插小型的L-bridge EBG。通过仿真验证,此结构具有传统型L-bridge EBG结构所不具有的超带宽抑制能力和较大的抑制深度。然后我们运用电路模型和平行板谐振腔原理分析了该结构上下变频。另外,通过3-D仿真,得到结构的IR-Drop和直流阻抗。最后,通过眼图验证该结构的信号传输特性。 展开更多
关键词 EBG SSN 电源完整性 ir-drop
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一种基于电流源模型的SoC电源分析与验证方法
14
作者 邬少国 《中国集成电路》 2004年第6期38-42,共5页
随着半导体技术的进步,SoC设计日益复杂和向低功耗方向发展,电源网络的设计日益关键。因此可靠的电源分析和验证结果已经成为向Foundry交付设计数据的先决条件之一。本文分析了SoC电源设计中存在的潜在问题,给出了业界适用的设计、验证... 随着半导体技术的进步,SoC设计日益复杂和向低功耗方向发展,电源网络的设计日益关键。因此可靠的电源分析和验证结果已经成为向Foundry交付设计数据的先决条件之一。本文分析了SoC电源设计中存在的潜在问题,给出了业界适用的设计、验证方法,并以工程设计为例,给出层次性SoC设计中电源设计、验证的相关流程。 展开更多
关键词 电流源模型 SOC 电源分析 验证 ir-drop 电迁移
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考虑电压降的SoC布局规划算法
15
作者 陈珊珊 周晓方 +1 位作者 荆明娥 王琳凯 《复旦学报(自然科学版)》 CAS CSCD 北大核心 2010年第2期236-241,共6页
针对SoC布局中的电压降问题,根据SoC布局特点以及芯片电压降物理模型,提出一种模块选择策略和目标函数共同约束算法.该算法在实现SoC布局的同时,极大降低了芯片的电压降,有效提高后端设计的收敛速度.实验结果表明了该算法的有效性.
关键词 布局规划 系统级芯片 B—tree 电压降
原文传递
一款微处理器芯片电源网络的验证及优化
16
作者 张彦 张萌 《电子工程师》 2007年第10期18-20,36,共4页
当CMOS工艺进入深亚微米设计阶段,器件密度和时钟频率增加,电源线和地线网络传送的电流也同样增加,导致功率密度的增加,这些都将对电源网络产生不利影响。因此,设计良好的电源网络显得尤为重要。为了确保较短的设计周期以及满足可靠性... 当CMOS工艺进入深亚微米设计阶段,器件密度和时钟频率增加,电源线和地线网络传送的电流也同样增加,导致功率密度的增加,这些都将对电源网络产生不利影响。因此,设计良好的电源网络显得尤为重要。为了确保较短的设计周期以及满足可靠性和可制造性的要求,电源网络的验证及优化已成为整个设计流程中关键的一步。首先介绍了存在于电源网络的欧姆电压效应,并且给出了一款系统芯片的电源网络的验证优化流程,基于此流程进行欧姆压降的分析,在尽量缩小设计周期的考虑下,给出了优化的几个方法,并应用于工程实际,达到了设计要求。 展开更多
关键词 信号完整性 电源网络 欧姆电压降 功耗
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利用VoltageStorm和APSI工具进行chip-package静态电源分析
17
作者 于洪杰 李海军 王艳 《电子设计应用》 2008年第11期58-60,62,共4页
目前的片上系统(SoC)设计特点是持续增大的芯片尺寸,集成更多的IP模块,多种电源电压供电,以及封装对供电电压的影响,这加大了不可预测的电压降带来芯片失败的风险。为降低此风险,可使用Cadence公司的SoC电源完整性分析和验证工具Voltage... 目前的片上系统(SoC)设计特点是持续增大的芯片尺寸,集成更多的IP模块,多种电源电压供电,以及封装对供电电压的影响,这加大了不可预测的电压降带来芯片失败的风险。为降低此风险,可使用Cadence公司的SoC电源完整性分析和验证工具VoltageStorm,并结合APSI提取的封装模型,进行chip-package电源完整性分析。本文将结合实际设计项目,介绍利用Cadence公司VoltageStorm和APSI工具进行chip-package电源完整性分析的具体实现。 展开更多
关键词 irdrop EMI VoltageStorm APSI
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封装设计中的核电源PI评估方法
18
作者 陈意 《中国科技期刊数据库 工业A》 2021年第3期230-235,共6页
本文介绍了电源完整性(power supply integrity,PI)分析的基本问题及研究方法,以及如何应用到芯片封装设计中,特别是核电源的PI分析。本文首先介绍了PI的主要领域以及分析方法,说明了关键的交流成分分析和直流成分分析原理和实现方法。... 本文介绍了电源完整性(power supply integrity,PI)分析的基本问题及研究方法,以及如何应用到芯片封装设计中,特别是核电源的PI分析。本文首先介绍了PI的主要领域以及分析方法,说明了关键的交流成分分析和直流成分分析原理和实现方法。针对核电源的特点,涉及到处理器多核启动模式,结合PI分析方法研究不同的启动模式对电源性能的影响,给出了具体的分析数据和结论。 展开更多
关键词 PACKAGE PI Target IMPEDANCE RIPPLE VRM ir-drop
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概率统计在电源网格完整性分析中的应用
19
作者 朱月珍 范新强 《自动化与仪器仪表》 2011年第6期91-92,95,共3页
在认真研究电源网格结构的基础上,介绍了一种电压降分析的新方法。这种基于概率统计的方法能够快速简便的估计出电压降的概率分布情况。这种利用概率统计分析电压降的方法在一些电源网格(包括一些工业处理器)中得到了较为理想的结果。
关键词 超大规模集成电路 概率统计 电压降
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深亚微米下芯片后端物理设计方法学研究 被引量:5
20
作者 曾宏 《中国集成电路》 2010年第2期30-35,49,共7页
随着摩尔定律的发展,90/65nm工艺下的大规模芯片越来越多,后端物理设计变得更加复杂,遇到了很多新问题,如高集成度、层次化设计、泄漏功耗、多角落-多模式、串扰噪声等,签收的标准也发生了变化。因此必须改进物理设计方法学,适应新的情... 随着摩尔定律的发展,90/65nm工艺下的大规模芯片越来越多,后端物理设计变得更加复杂,遇到了很多新问题,如高集成度、层次化设计、泄漏功耗、多角落-多模式、串扰噪声等,签收的标准也发生了变化。因此必须改进物理设计方法学,适应新的情况,来取得流片成功。 展开更多
关键词 90/65nm 后端设计 集成度 层次化设计 串扰噪声 多模式-多角落 泄漏功耗 动态电压降 签收
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