基于VHDL描述语言的高级数据链路控制协议实现 被引量：5

1

作者 岳绚 杨健 《电气自动化》 2012年第2期16-18,共3页

VHDL硬件描述语言是一种用于数字系统进行设计和测试的语言,系统硬件描述能力强,模块化和自上而下的设计思路,使得系统设计周期短、设计灵活,便于移植。通过对EDA设计方法的研究,设计采用模块化思路和VHDL语言设计实现OSI参考模型数据... VHDL硬件描述语言是一种用于数字系统进行设计和测试的语言,系统硬件描述能力强,模块化和自上而下的设计思路,使得系统设计周期短、设计灵活,便于移植。通过对EDA设计方法的研究,设计采用模块化思路和VHDL语言设计实现OSI参考模型数据链路层重要协议-HDLC协议,主要设计模块有:帧同步模块、"0"比特填充与删除模块、去帧首和帧尾模块、CRC循环冗余校验生成模块等。设计能够实现利用HDLC协议的通信过程,基本功能具备。 展开更多

关键词 hdlc协议 VHDL语言 CRC校验 帧同步

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高级数据链路控制(HDLC)的操作行为研究 被引量：2

2

作者 代玉梅 张彬 张瑞玲 《现代电子技术》 2013年第8期10-12,共3页

高级数据链路控制(HDLC)是重要的数据链路控制协议之一,HDLC不仅使用最广泛,而且它还是其他许多重要数据链路控制协议的基础。为了更好地提高高速网络的性能与服务质量,在此主要对HDLC的操作行为进行研究。详细解释HDLC的三个阶段的操作... 高级数据链路控制(HDLC)是重要的数据链路控制协议之一,HDLC不仅使用最广泛,而且它还是其他许多重要数据链路控制协议的基础。为了更好地提高高速网络的性能与服务质量,在此主要对HDLC的操作行为进行研究。详细解释HDLC的三个阶段的操作,并用范例对HDLC的操作原理进行了说明,易于理解接受。 展开更多

关键词 hdlc 操作行为 帧 数据链路控制协议

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宽带IP网数据链路协议帧同步性能研究 被引量：1

3

作者 陶滢 吴重庆 +1 位作者 刘学 张勇 《通信学报》 EI CSCD 北大核心 2002年第12期110-117,共8页

在阐述数据链路层帧同步原理的基础上,对应用于宽带IP传送网络中的GFP与HDLC两种数据链路层协议的帧同步性能进行定量的比较,分析表明,GFP高的协议实现性能、高传送效率以及高传输速率等优点使之更适合于下一代高速IP传送网络。

关键词 宽带IP网 数据链路协议 帧同步 GFP协议 hdlc协议

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HDLC能否用于局域网作为数据链路控制协议的探讨

4

作者 耿红琴 《天中学刊》 1999年第5期10-11,共2页

从帧格式和服务方式两方面，论述了HDLC能否用于局域网作为数据链路控制协议．

关键词 hdlc 局域网 协议 帧 数据链路控制

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在VB中实现基于HDLC的数据链路层协议

5

作者 张爱民 吴友宇 《微机发展》 2003年第8期75-76,79,共3页

介绍了一种基于HDLC的数据链路层协议,实现了单片机和PC机之间的无差错数据通信,并使用VB语言实现。同时也比较了该协议和HDLC之间的区别,详细说明了协议各部分的功能和内容。

关键词 VB语言 hdlc协议 数据链路层协议 通信协议 帧结构

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HDLC协议处理芯片在微机查号系统中的应用 被引量：2

6

作者 周琳 沈剑沧 鲍培明 《通信技术》 2010年第2期184-187,共4页

在目前的数字通信系统或网络设计中,普遍采用了HDLC协议,该协议是在同步网上传输数据时需要遵守的数据链路层协议,也是一种面向比特位的数据链路控制协议。HDLC协议的实现方式有两种,分别是软件实现和硬件实现。本文介绍了HDLC协议的特... 在目前的数字通信系统或网络设计中,普遍采用了HDLC协议,该协议是在同步网上传输数据时需要遵守的数据链路层协议,也是一种面向比特位的数据链路控制协议。HDLC协议的实现方式有两种,分别是软件实现和硬件实现。本文介绍了HDLC协议的特点,采用硬件实现的方法,及采用HDLC协议处理芯片MT8952B设计和实现了在微机查号系统中的数据传输,并对采用此方法实现数据通信的优点进行了阐述。 展开更多

关键词 数据链路层协议 同步网 帧校验

原文传递

HDLC/SDLC协议帧校验序列的计算方法

7

作者 陈华 《西北民族大学学报（自然科学版）》 1998年第1期132-135,共4页

HDLC/SDLC 数据通信链路规程是目前广泛采用的串行通信规程,但当前大多数文献资料就HDLC/SDLC 规程帧校验序列的生成都未给出准确的定义,因而常常给用户造成一些概念上的模糊或误解。该文依据 HDLC 规程的原始定义给出了 HDLC 帧校验序... HDLC/SDLC 数据通信链路规程是目前广泛采用的串行通信规程,但当前大多数文献资料就HDLC/SDLC 规程帧校验序列的生成都未给出准确的定义,因而常常给用户造成一些概念上的模糊或误解。该文依据 HDLC 规程的原始定义给出了 HDLC 帧校验序列 FCS 的计算方法及硬件实现系统码字编码的方案。 展开更多

关键词 数据通信规程 纠错码 hdlc/SDLC 规程 帧结构 帧校验序列

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GSM-R传输恢复时间指标研究

8

作者 李雪 华尧 邵龙飞 《铁路通信信号工程技术》 2012年第6期15-20,共6页

传输干扰率指标是GSM-R网络服务质量评估的一个重要指标,用传输干扰时间和传输恢复时间来衡量。其描述GSM-R系统的传输干扰水平,同时描述GSM-R网络误码性能对列控信息传输的影响。引起数据传输干扰的原因可分为3类:一类是基站间切换,一... 传输干扰率指标是GSM-R网络服务质量评估的一个重要指标,用传输干扰时间和传输恢复时间来衡量。其描述GSM-R系统的传输干扰水平,同时描述GSM-R网络误码性能对列控信息传输的影响。引起数据传输干扰的原因可分为3类:一类是基站间切换,一类是网络外部或内部频率干扰,还有一种是随机出现的"短干扰"。频率干扰在网络优化期间可以规避,短干扰随机出现,干扰时间短,出现位置不可控。所以,通过研究切换引起的数据传输干扰,分析传输恢复时间指标的设置是否合理。最后,通过实验室测试,分析不同的传输恢复时间对CTCS-3(简称C3)业务的实际影响。 展开更多

关键词 C3 传输干扰 hdlc帧

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基于Thor-2-PCMCIA卡的7号信令接口模块设计

9

作者 别其璋 《计算机工程》 EI CAS CSCD 北大核心 2005年第10期197-199,共3页

以使用OdinTeleSystems公司出品的7号信令接口卡Thor-2-PCMCIA开发7号信令接口模块为例,介绍了开发7号信令接口模块的基本步骤、程序构架以及定时器要求,提供了快速开发7号信令模块的简易方法。在此基础上,可快捷地为电信运营商开发设计... 以使用OdinTeleSystems公司出品的7号信令接口卡Thor-2-PCMCIA开发7号信令接口模块为例,介绍了开发7号信令接口模块的基本步骤、程序构架以及定时器要求,提供了快速开发7号信令模块的简易方法。在此基础上,可快捷地为电信运营商开发设计7号信令网监视设备、信令仿真仪表以及增值业务生成平台等。 展开更多

关键词 7号信令 PCMCIA接口 PCI接口 hdlc帧

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LN82530串行通讯控制器测试技术研究

10

作者 于祥苓 冯蕊 唐琳 《微处理机》 2004年第1期16-17,20,共3页

LN8 2 5 30串行通讯控制器 ( SCC)是一种双通道、多重协议数据通讯外围接口电路。此电路包括复杂的内部功能 ,可当作串行—并行 ,并行—串行转换器 /控制器。本文对 LN82 5 30内部各功能块的测试作了详细的研究 ,并对其直流测试中存在... LN8 2 5 30串行通讯控制器 ( SCC)是一种双通道、多重协议数据通讯外围接口电路。此电路包括复杂的内部功能 ,可当作串行—并行 ,并行—串行转换器 /控制器。本文对 LN82 5 30内部各功能块的测试作了详细的研究 ,并对其直流测试中存在的某些问题的解决作了简要的介绍。 展开更多

关键词 LN82530 串行通讯控制器 测试 电路结构

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LN8274多规程串行控制器的测试与应用

11

作者 薛宏 耿爽 《微处理机》 2002年第2期16-19,共4页

基于 LN82 74芯片的串行通信应用越来越多 ,尤其是在采样率较高的实时控制系统中应用更加普遍。本文介绍了 LN82

关键词 LN8274 多规程串行控制器 测试

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PPP数据报解析 被引量：1

12

作者 王燕燕 严明 孙慰迟 《计算机工程》 CAS CSCD 北大核心 2000年第11期104-105,170,共3页

ＰＰＰ协议是个被普遍支持，用来实现ＬＡＮ协议中继的ＷＡＮ数据封装协议．在规范缺乏的ＷＡＮ中，ＰＰＰ被广泛使用，而且随着补充协议的完善，它的功能也日渐丰富．该文讨论了ＰＰＰ的各种帧结构以及实现ＰＰＰ中帧解析的细节．

关键词 PPP 数据封装 hdlc扩展帧结构 帧解析

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HDLC数据帧并行搜帧解封装模块的设计与验证 被引量：1

13

作者 钱勇 刘威 《电子技术应用》 2022年第1期80-83,共4页

HDLC信号链路是国际标准化组织(ISO)制定的高级数据链路的控制规程(High Level Data Link Control,HDLC)。遵循HDLC标准数据链路层规范,采用硬件描述语言Verilog HDL实现了一种基于并行结构的HDLC搜帧解封装电路,并采用System Verilog... HDLC信号链路是国际标准化组织(ISO)制定的高级数据链路的控制规程(High Level Data Link Control,HDLC)。遵循HDLC标准数据链路层规范,采用硬件描述语言Verilog HDL实现了一种基于并行结构的HDLC搜帧解封装电路,并采用System Verilog技术搭建验证平台,随机生成HDLC数据帧来验证设计正确性。使用Modelsim软件仿真波形,在仿真过程中,对于净荷区数据长度为10个字节的HDLC数据帧,解码器电路工作完成需要16个时钟周期,兼顾了处理速度和灵活性。使用QuartusII软件综合,在Altera CycloneV器件上,电路使用了8块自适应逻辑模块ALM,24个寄存器,35个引脚。 展开更多

关键词 hdlc协议 搜帧解封装 System Verilog MODELSIM

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基于82530芯片的HDLC/SDLC规程高速数字通信应用的研究 被引量：2

14

作者 李勇 杨友庆 《微处理机》 1995年第4期13-18,共6页

Intel82530多规程串行通信控制器是美国英特尔公司推出的继Intel8274芯片后的新品种，其性能和功能等各项指标比8274、8251等同类产品均有明显提高。基于8253O芯片的串行通信应用越来越多，尤其是在采样率较高的实时控制系统中。本文介... Intel82530多规程串行通信控制器是美国英特尔公司推出的继Intel8274芯片后的新品种，其性能和功能等各项指标比8274、8251等同类产品均有明显提高。基于8253O芯片的串行通信应用越来越多，尤其是在采样率较高的实时控制系统中。本文介绍了82530芯片的物理特性，并根据笔者在实际应用中的体会，较详细地介绍了82530芯片的编程要点及芯片在中断处理中的有关问题。 展开更多

关键词 SDLC/hdlc 接口板 数字通信 串行通信控制器

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