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VLSI与电子系统的层次化可测性设计
1
作者
陈庆方
吴烈诩
+1 位作者
戴昌培
赵振峰
《装甲兵工程学院学报》
1996年第3期11-15,共5页
论述了一种对电子系统VLSI自顶向下的层次化自动化测试方法及层次化自测试的概念和相应的可测试性设计结构,并讨论了数模混合集成电路的可测试性设计问题。
关键词
层次化自测试
可测性设计
数模混合集成电路
系统级测试
原文传递
题名
VLSI与电子系统的层次化可测性设计
1
作者
陈庆方
吴烈诩
戴昌培
赵振峰
机构
北京自动测试技术研究所
北京自动测试技术研究所 北京
出处
《装甲兵工程学院学报》
1996年第3期11-15,共5页
基金
北京市自然科学基金
文摘
论述了一种对电子系统VLSI自顶向下的层次化自动化测试方法及层次化自测试的概念和相应的可测试性设计结构,并讨论了数模混合集成电路的可测试性设计问题。
关键词
层次化自测试
可测性设计
数模混合集成电路
系统级测试
Keywords
Hierarchical
self-test
dft
(
testable
design
for
testable
)
mixedsignal
ICs
system
level
test
分类号
TN402 [电子电信—微电子学与固体电子学]
原文传递
题名
作者
出处
发文年
被引量
操作
1
VLSI与电子系统的层次化可测性设计
陈庆方
吴烈诩
戴昌培
赵振峰
《装甲兵工程学院学报》
1996
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