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基于FPGA的LPDC译码实现
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作者 程方 蓝希令 《电子世界》 2011年第13期11-12,共2页
低密度奇偶校验码(Low-Density Parity-Check codes,LDPC codes)是一种基于图和迭代译码的信道编码方案,它是据Turbo码的另外一种性能非常接近Shannon极限的信道编码。本文在探讨了LDPC码的经典BP(Belief Propagation)译码算法的基础上... 低密度奇偶校验码(Low-Density Parity-Check codes,LDPC codes)是一种基于图和迭代译码的信道编码方案,它是据Turbo码的另外一种性能非常接近Shannon极限的信道编码。本文在探讨了LDPC码的经典BP(Belief Propagation)译码算法的基础上,采用一种改进行的复杂度较低,性能较好的LLRBP译码算法在FPGA上进行实现,验证了LDPC码的优异性能,对于译码算法的硬件实现具有指导意义。 展开更多
关键词 LDPC LLRBP算法 FPGA
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